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其他  功能是检测一个5位二进制序列“10010”。考虑到序列重叠的可能

功能是检测一个5位二进制序列“10010”。考虑到序列重叠的可能，有限状态机共提供8个状态（包括初始状态IDLE）。

https://www.eeworm.com/dl/534/316163.html

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matlab例程  利用matlab产生二进制调制信号波形

利用matlab产生二进制调制信号波形，以实现噪声信号干扰研究

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matlab例程  bpsk二进制相位调制

bpsk二进制相位调制，原理，源代码都有，基于matlab的仿真

https://www.eeworm.com/dl/665/317659.html

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VHDL/FPGA/Verilog 用层次化设计完成倒计时装置输入：16位二进制倒计时起始数字、倒计时起始数字的输入使能信号、倒计时开始信号、复位信号、1MHz时钟信号、10Hz时钟信号。输出：数码管数据信号及宣统信号

用层次化设计完成倒计时装置输入：16位二进制倒计时起始数字、倒计时起始数字的输入使能信号、倒计时开始信号、复位信号、1MHz时钟信号、10Hz时钟信号。输出：数码管数据信号及宣统信号，倒计时结束信号。

https://www.eeworm.com/dl/663/322268.html

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其他  进制转换,该程序实现进制之间的转换可以在二进制、八进制、十进制、十进制之间转换

进制转换,该程序实现进制之间的转换可以在二进制、八进制、十进制、十进制之间转换

https://www.eeworm.com/dl/534/324989.html

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其他  实现bcd码与二进制码之间的相互转换功能

实现bcd码与二进制码之间的相互转换功能，小于9时不变，高于九时加6功能

https://www.eeworm.com/dl/534/325504.html

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VHDL/FPGA/Verilog --功能描述 --1 刷卡后产生与本人身份唯一对应的串行二进制码元序列

--功能描述 --1 刷卡后产生与本人身份唯一对应的串行二进制码元序列，作为模拟系统的输入信号（此处不妨设为8位学生学号）。 --2 经过串并转换，序列变成一个8位二进制数。 --3 遍历预先存储在rom中的学号信息，逐一和这个8位数相比较，如果有相匹配的信息，显示欢迎字样（此处用一个高电平表示），同时打开栅栏门（也用一 ...

https://www.eeworm.com/dl/663/326018.html

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VHDL/FPGA/Verilog 七段显示译码器（功能：将思维二进制数译成七段输出信号

七段显示译码器（功能：将思维二进制数译成七段输出信号，驱动数码管显示）

https://www.eeworm.com/dl/663/326340.html

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汇编语言  实现二进制转换

实现二进制转换，主要是一些源程序，通过tc也能运行

https://www.eeworm.com/dl/644/327432.html

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微处理器开发  44b0的bootloader中的文件系统,是二进制的

44b0的bootloader中的文件系统,是二进制的

https://www.eeworm.com/dl/655/328295.html

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