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VHDL/FPGA/Verilog
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--功能描述 --1 刷卡后产生与本人身份唯一对应的串行二
--功能描述 --1 刷卡后产生与本人身份唯一对应的串行二进制码元序列
VHDL/FPGA/Verilog
2 K
45 次下载
2013-11-29
资源详细信息
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文件大小
2 K
资源分类
VHDL/FPGA/Verilog
上传者
leaveyourjam
发布时间
2013-11-29 20:29
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45
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--功能描述 --1 刷卡后产生与本人身份唯一对应的串行二进制码元序列 - 资源详细说明
--功能描述 --1 刷卡后产生与本人身份唯一对应的串行二进制码元序列,作为模拟系统的输入信号(此处不妨设为8位学生学号)。 --2 经过串并转换,序列变成一个8位二进制数。 --3 遍历预先存储在rom中的学号信息,逐一和这个8位数相比较,如果有相匹配的信息,显示欢迎字样(此处用一个高电平表示),同时打开栅栏门(也用一个高电平表示)。
--功能描述 --1 刷卡后产生与本人身份唯一对应的串行二进制码元序列 - 源码文件列表
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