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二进制码 的查询结果
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其他 实现bcd码与二进制码之间的相互转换功能
实现bcd码与二进制码之间的相互转换功能,小于9时不变,高于九时加6功能
VHDL/FPGA/Verilog --功能描述 --1 刷卡后产生与本人身份唯一对应的串行二进制码元序列
--功能描述
--1 刷卡后产生与本人身份唯一对应的串行二进制码元序列,作为模拟系统的输入信号(此处不妨设为8位学生学号)。
--2 经过串并转换,序列变成一个8位二进制数。
--3 遍历预先存储在rom中的学号信息,逐一和这个8位数相比较,如果有相匹配的信息,显示欢迎字样(此处用一个高电平表示),同时打开栅栏门(也用一 ...
VC书籍 内容为二进制码和HDB3码的转换用C语言
内容为二进制码和HDB3码的转换用C语言
汇编语言 EM78的BCD码转十六进制表示的二进制码内带有详细注解.
EM78的BCD码转十六进制表示的二进制码内带有详细注解.
VHDL/FPGA/Verilog 序列检测器可用于检测一组或多组二进制码组成的脉冲序列信号
序列检测器可用于检测一组或多组二进制码组成的脉冲序列信号,这在数字通信领域中有广泛的应用。当序列检测器连续收到一组二进制码后,如果这组码与检测器中预先设置的码相同,则输出1,否则输出0。由于这种检测的关键在于正确码的收到必须是连续的,这就要求检测器必须记住前一次的正确码及正确序列,直到连续的检测中收到 ...
其他 本函数实现将输入的一段二进制码编为相应的单极性非归零码输出和单极性归零码输出
本函数实现将输入的一段二进制码编为相应的单极性非归零码输出和单极性归零码输出
其他 使用状态机设计一个5位序列检测器。从一串二进制码中检测出一个已预置的5位二进制码
使用状态机设计一个5位序列检测器。从一串二进制码中检测出一个已预置的5位二进制码
文章/文档 1位全加器 可以进行1位的二进制码的加法 想进行改进 改为4位或8位的全加器代码
1位全加器 可以进行1位的二进制码的加法 想进行改进 改为4位或8位的全加器代码
matlab例程 用matlab实现ASCII和二进制码的互换
用matlab实现ASCII和二进制码的互换,在matlab输入ASCII码字符或字符串即可,源文件里有详细的使用说明,一共有5个文件。
邮电通讯系统 GMSK基带系统仿真 本试验是用数字基带处理方法来实现调试期算法的基带硬件实验。 通过用软件matlab进行了GMSK相位路径和眼图的仿真,之后对任何一种五位随机码
GMSK基带系统仿真
本试验是用数字基带处理方法来实现调试期算法的基带硬件实验。
通过用软件matlab进行了GMSK相位路径和眼图的仿真,之后对任何一种五位随机码,每周期八次的任一抽样时刻,和任一相位区域(0、1、2、3)的任一组合,计算出相位 ,并对 以及 进行1024位的量化、编码成10位二进制码表。进一步利用matlab从上述的 ...