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VHDL/FPGA/Verilog 用VerilogHDL编写的

用VerilogHDL编写的，一个占空比为50％的6分频电路

https://www.eeworm.com/dl/663/177778.html

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VerilogHDL 编写

VHDL/FPGA/Verilog 帧同步检测源码

帧同步检测源码，包括同步跟踪模块，fifo,分频模块，还有系统的测试平台

https://www.eeworm.com/dl/663/182620.html

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帧同步检测源码

源码  EMD分解

对信号进行分频处理，以便于更加清晰的看清信号或者数据的规律

https://www.eeworm.com/dl/520783.html

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EMD

技术资料  The Design of Active Crossovers by Douglas Self

各种常见分频器滤波器的设计，很详细，有计算参考

https://www.eeworm.com/dl/869729.html

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分频器滤波器设计

技术资料  基于Verlog的数字频率计

用Verlog写的数字频率计代码，分频，计数有详细介绍。

https://www.eeworm.com/dl/994373.html

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Verlog

单片机编程  看门狗定时器看门狗休眠模式

在正常操作期间，一次WDT 超时溢出将产生一次器件复位。如果器件处于休眠状态，一次WDT超时溢出将唤醒器件，使其继续正常操作（即称作WDT 唤醒）。对WDTE 设置位清零可以永久性地关闭WDT。后分频器分配完全是由软件控制，即它可在程序执行期间随时更改。在例26-1 中，如果需要的预分频值不是1:1，就不需要对OPTION_REG 寄存 ...

https://www.eeworm.com/dl/502/31668.html

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看门狗定时器看门狗休眠模式

DSP编程  利用达盛DSP试验箱设计键盘输入发生装置

利用达盛DSP试验箱设计键盘输入发生装置，要求： 1、用键盘输入分频置，控制蜂鸣器发声。 2、采用将DSP通用I/O引脚直接驱动的方式。 3、用发光数码管显示分频值。

https://www.eeworm.com/dl/516/420823.html

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DSP 试验箱发生装置

VHDL/FPGA/Verilog VHDL语言描述

VHDL语言描述，时钟分频,给定CPLD试验板系统时钟设置50M，但由于本作品的需要，我们将系统时钟经过20分频得到DS18B20所需的工作时钟，大约为1.25M。

https://www.eeworm.com/dl/663/475739.html

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VHDL 语言

技术书籍  电子工程手册系列丛书-二极管、闸流晶体管实用手册-917页-10.0M.pdf

专辑类-器件数据手册专辑-120册-2.15G 电子工程手册系列丛书-二极管、闸流晶体管实用手册-917页-10.0M.pdf

https://www.eeworm.com/dl/537/6153.html

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10.0 917 电子工程

技术书籍  乾坤工贸产品样本-二极管-三极管-场管-电阻-电容-电感-光耦管-++-75.9M.zip

专辑类-元器件样本专辑-116册-3.03G 乾坤工贸产品样本-二极管-三极管-场管-电阻-电容-电感-光耦管-++-75.9M.zip

https://www.eeworm.com/dl/537/6854.html