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乘法器 的查询结果
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VHDL/FPGA/Verilog 二位BCD码加法器 加数与被加数都是2进制。输出和为10进制。 结果显示在LED上。
二位BCD码加法器
加数与被加数都是2进制。输出和为10进制。
结果显示在LED上。
VHDL/FPGA/Verilog 加法器 用VerilogHDL实现加罗华域加法器
加法器
用VerilogHDL实现加罗华域加法器
书籍源码 flch3rlseg3.m递推的最小二乘辨识程序
flch3rlseg3.m递推的最小二乘辨识程序
数学计算 flch3lseg1.m二阶系统一次性完成最小二乘辨识程序
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数学计算 flch4gaeg1.m梯度校正最小二乘辨识程序
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VHDL/FPGA/Verilog 用DE2板子实现的控制64乘64点阵LED的点亮,硬件需要de2板及led点阵
用DE2板子实现的控制64乘64点阵LED的点亮,硬件需要de2板及led点阵
其他书籍 这是一篇关于最小二乘支持向量机的文章
这是一篇关于最小二乘支持向量机的文章，主要是应用最小二乘支持向量机来对文本进行分类！
VHDL/FPGA/Verilog 《Verilog HDL语言编程》 常有加法器（基于Verilog）
《Verilog HDL语言编程》
常有加法器（基于Verilog）
数学计算 实现矩阵加、减、乘和求逆的C++程序
实现矩阵加、减、乘和求逆的C++程序，本人已经调试过，运行良好！
通讯/手机编程 这是经过改进后的加法器源代码
这是经过改进后的加法器源代码，改进后运算速度更快