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基于DSPFPGA的CAN总线数据通信系统.rar

CAN-bus(Corltroller Area Network)即控制器局域网,是国际上应用最广泛的现场总线之一。它是一种多主方式的串行通讯总线,在工业控制通讯方面拥有高位速率,高抗电磁干扰性,而且能够检测出产生的任何错误。作为一种灵活,可靠的通讯系统,CAN总线已被广泛运用于各个工业控制现场。 基于FPGA+DSP的CAN ...
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https://www.eeworm.com/dl/913511.html 技术资料

基于DSPFPGA的CAN总线数据通信系统

CAN-bus(Corltroller Area Network)即控制器局域网,是国际上应用最广泛的现场总线之一。它是一种多主方式的串行通讯总线,在工业控制通讯方面拥有高位速率,高抗电磁干扰性,而且能够检测出产生的任何错误。作为一种灵活,可靠的通讯系统,CAN总线已被广泛运用于各个工业控制现场。 基于FPGA+DSP的CAN ...
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由单片机构成的带串行接口的LED显示

在单片机的人机对话中,经常用到多位LED进行数据显示.微机通常采用并行接口的静态或分时显示接口.这种方式占用比较多的I/O口及连线,如微机系统的主要硬件电路在主印制板上,而显示器在面板上,则它们之间的连线在10根以上;况且用并行显示,I/O也紧张.对于单片机系统来说,也可以采用串行口来作显示电路的驱 ...
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https://www.eeworm.com/dl/1004282.html 技术资料

电路图

一、主电路 从交流电网输入、直流输出的全过程,包括: 1、输入滤波器:其作用是将电网存在的杂波过滤,同时也阻碍本机产生的杂波反馈到公共电网。 2、整流与滤波:将电网交流电源直接整流为较平滑的直流电,以供下一级变换。 3、逆变:将整流后的直流电变为高频交流电,这是高频开关电源的核心 ...
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https://www.eeworm.com/dl/514/8594.html 学术论文

MEMS传感器弱信号检测电路及集成设计.rar

高精度惯性加速度计能够实现实时位移检测,在当今民用和军用系统如汽车电子、工业控制、消费电子、卫星火箭和导弹等中间具有广泛的需求。在高精度惯性加速度计中,特别需要稳定的低噪声高灵敏度接口电路。事实上,随着传感器性能的不断提高,接口电路将成为限制整个系统的主要因素。 本论文在分析差动 ...
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并联型有源电力滤波器仿真及其设计.rar

有源电力滤波器(Active Power Filter,简称 APF)是近年来治理电力系统谐波污染的非常有效的装置。众所周知,电力电子装置和非线性负载的广泛使用,使谐波电流和无功电流大量注入电网,严重威胁电网和电气设备的安全运行与正常使用,并且产生大量的能源浪费。随着我国“十一五”规划中关于建设节约型 ...
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基于FPGA的海事卫星突发信号位同步检测研究及实现.rar

码元定时恢复(位同步)技术是数字通信中的关键技术。位同步信号本身的抖动、错位会直接降低通信设备的抗干扰性能,使误码率上升,甚至会使传输遭到完全破坏。尤其对于突发传输系统,快速、精确的定时同步算法是近年来研究的一个焦点。本文就是以Inmarsat GES/AES数据接收系统为背景,研究了突发通信传输 ...
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https://www.eeworm.com/dl/514/12762.html 学术论文

海事卫星突发信号位同步检测

码元定时恢复(位同步)技术是数字通信中的关键技术。位同步信号本身的抖动、错位会直接降低通信设备的抗干扰性能,使误码率上升,甚至会使传输遭到完全破坏。尤其对于突发传输系统,快速、精确的定时同步算法是近年来研究的一个焦点。本文就是以Inmarsat GES/AES数据接收系统为背景,研究了突发通信传输 ...
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https://www.eeworm.com/dl/fpga/doc/32069.html 教程资料

Xilinx UltraScale:为您未来架构而打造的新一代架构

  Xilinx UltraScale™ 架构针对要求最严苛的应用,提供了前所未有的ASIC级的系统级集成和容量。    UltraScale架构是业界首次在All Programmable架构中应用最先进的ASIC架构优化。该架构能从20nm平面FET结构扩展至16nm鳍式FET晶体管技术甚至更高的技术,同 时还能从单芯片扩展到3D IC。 ...
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https://www.eeworm.com/dl/kbcluoji/38739.html 可编程逻辑

Xilinx UltraScale:为您未来架构而打造的新一代架构

  Xilinx UltraScale™ 架构针对要求最严苛的应用,提供了前所未有的ASIC级的系统级集成和容量。    UltraScale架构是业界首次在All Programmable架构中应用最先进的ASIC架构优化。该架构能从20nm平面FET结构扩展至16nm鳍式FET晶体管技术甚至更高的技术,同 时还能从单芯片扩展到3D IC。 ...
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