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VIP专区  VIP专区-PCB源码精选合集系列（23）

VIP专区-PCB源码精选合集系列（23）资源包含以下内容：1. PCB线路板还原电路原理图.2. PCB布线知识面试题_PCB工程师必备.3. 新设计的电路板调试方法.4. PCB布局布线技巧100问.5. 高速PCB设计误区与对策.6. 如何做好pcb板详谈.7. PCB工序解析.8. 抑制△I噪声的PCB设计方法.9. PCB封装手册详解.10. PCB纯手工设计.11. 印刷电 ...

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编辑器/阅读器  SDI接口的源程序,包括扰码编码,并串转换,用VHDL硬件描述语言编写

SDI接口的源程序,包括扰码编码,并串转换,用VHDL硬件描述语言编写

https://www.eeworm.com/dl/626/211682.html

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VHDL/FPGA/Verilog 用Verilog实现QPSK中的差分,扰码,串并,解差分,解扰码,解串并,用MUXPLUS2进行仿真

用Verilog实现QPSK中的差分,扰码,串并,解差分,解扰码,解串并,用MUXPLUS2进行仿真

https://www.eeworm.com/dl/663/218584.html

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学术论文  采用FPGA实现基于ATCA架构的2.5Gbps串行背板接口

当前，在系统级互连设计中高速串行I/O技术迅速取代传统的并行I/O技术正成为业界趋势。人们已经意识到串行I/O“潮流”是不可避免的，因为在高于1Gbps的速度下，并行I/O方案已经达到了物理极限，不能再提供可靠和经济的信号同步方法。基于串行I/O的设计带来许多传统并行方法所无法提供的优点，包括：更少的器件引脚、更低的电 ...

https://www.eeworm.com/dl/514/10020.html

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VHDL/FPGA/Verilog 系数为4的扰码生成器

系数为4的扰码生成器，并每四位扰码产生一个触发串并转换的触发信号，可用于4b/5b编码的触发信号。verilog程序，带test程序

https://www.eeworm.com/dl/663/127647.html

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C语言  VC++ Turbo C串口通信编程实践龚建伟

VC++ Turbo C串口通信编程实践龚建伟

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C语言  Visual C++ Turbo C串口通信编程实践

Visual C++ Turbo C串口通信编程实践

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C语言  Visual C++ Turbo C串口通信编程实践配套代码

Visual C++ Turbo C串口通信编程实践配套代码

https://www.eeworm.com/dianzishu/410/661.html

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C语言  Visual C++ 串口通信技术与工程实践

Visual C++ 串口通信技术与工程实践

https://www.eeworm.com/dianzishu/410/673.html

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C语言  VISUAL C++串口通信技术与工程实践

VISUAL C++串口通信技术与工程实践

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