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三分频 的查询结果
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VHDL/FPGA/Verilog 一个实现整数分频的VHDL代码
一个实现整数分频的VHDL代码，只要把n设置成你所需要的分频的数值就行
VHDL/FPGA/Verilog 主时钟为15.36MHz的带选通的8位输出分频器
主时钟为15.36MHz的带选通的8位输出分频器，可得到100Hz,120Hz,1kHz,10kHz的频率
VHDL/FPGA/Verilog 一个八分频的VHDL程序,经过编译和仿真.
一个八分频的VHDL程序,经过编译和仿真.
并行计算 一个1.5分频的VHDL程序,经过编译和仿真.
一个1.5分频的VHDL程序,经过编译和仿真.
VHDL/FPGA/Verilog 该模块为分频器
该模块为分频器，将1KHZ的时钟频率分频成每分钟一次的时钟频率
事实上，该源码可以实现任意整数的分频，主要让N的值设置好相应的数字
VHDL/FPGA/Verilog 利用VHDL语言描述的5分频器（改变程序中m1,m2值
利用VHDL语言描述的5分频器（改变程序中m1,m2值，可作为任意奇数分频器）
VHDL/FPGA/Verilog 任意小数分频器产生原理
任意小数分频器产生原理，及详细说明文档，任意数分频(包括奇偶数和小数)的设计方法(含VHDL例子)
书籍源码 以C语言来实现DPSK（差分频移键控）的调制与解调
以C语言来实现DPSK（差分频移键控）的调制与解调
单片机开发 实用的任意时钟分频Verilog代码 可以任意分频的！
实用的任意时钟分频Verilog代码
可以任意分频的！
数学计算 基2分频与基于分裂基的fft的实现
基2分频与基于分裂基的fft的实现，特别是新型的倒序算法提高了程序的质量