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vhd语言

vhd语言，简单cpu程序实例，包含所有源码文件。
2016-02-17 20:32:01 下载 161 查看 1,051
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FIFO.VHD

fifo,VHDL源码，模块化设计，适用于很多场合。
2025-06-04 20:00:02 下载 5 查看 3,963
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Verilog test file not vhd

Verilog test file not vhd
2017-05-03 10:48:02 下载 158 查看 1,059
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fredivn.vhd 偶数分频 fredivn1.vhd 奇数分频 frediv16.vhd 16分频 PULSE.vhd 数控分频器

fredivn.vhd 偶数分频 fredivn1.vhd 奇数分频 frediv16.vhd 16分频 PULSE.vhd 数控分频器
2016-11-21 10:36:01 下载 105 查看 1,118
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<Floating Point Unit Core> fpupack.vhd pre_norm_addsub.vhd addsub_28.vhd post_norm_addsub.

<Floating Point Unit Core> fpupack.vhd pre_norm_addsub.vhd addsub_28.vhd post_norm_addsub.vhd
2014-01-18 15:14:02 下载 50 查看 1,150
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pulse_sequence.vhd 并行脉冲控制器 light.vhd.vhd 交通脉冲控制器 division1.vhd 电压脉冲控制器中的分频 ad.vhd 电压脉冲控制器中的A/D控制

pulse_sequence.vhd 并行脉冲控制器 light.vhd.vhd 交通脉冲控制器 division1.vhd 电压脉冲控制器中的分频 ad.vhd 电压脉冲控制器中的A/D控制
2014-08-12 15:15:02 下载 114 查看 1,130
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fulladder.vhd 一位全加器 adder.vhd 四位全加器 multi4.vhd 四位并行乘法器

fulladder.vhd 一位全加器 adder.vhd 四位全加器 multi4.vhd 四位并行乘法器
2015-09-03 10:46:02 下载 42 查看 1,460
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para13： fifo.vhd FIFO（双口RAM） fifo1.vhd FIFO（嵌入式EAB） fifo2.vhd FIFO（LPM）

para13： fifo.vhd FIFO（双口RAM） fifo1.vhd FIFO（嵌入式EAB） fifo2.vhd FIFO（LPM）
2013-12-17 03:32:04 下载 67 查看 1,062
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数字钟的vhd文档

数字钟的vhd文档，个人感觉还是蛮完善的，大家可以下载了一同改进。
2014-11-18 06:51:29 下载 29 查看 1,053
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Microsoft VHD规格说明书

Microsoft VHD规格说明书，是由微软公司制定，Microsoft 及 Critrix 两大公司在虚拟机合作领域主推的虚拟磁盘文件格式描述，其功能强大而且实现COPY OF WRITE 特性，体现简单易用高效实现虚拟磁盘管理
2014-11-29 18:06:02 下载 153 查看 1,113
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基于VHD UARTIP设计与实现

UART（Universal Asynchronous Receiver/Transmitter），通用异步接收/发送装置，具有可编程性和高度兼容性，在数字通信及控制系统等各种嵌入式领域中得到了广泛的应用。介绍了一种利用VHDL语言设计的UART核心功能的方法，具体阐述了发送、接收以及波特率发生器模块的设计，并将其集成到可编程逻辑器件CPLD上，最后通过串口调试软件验证该UART IP核的功能。
2024-05-23 03:40:01 下载 9 查看 7,762
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xen source 推出最新的VHD操作工具VHD-UTIL 实现源码,超强

xen source 推出最新的VHD操作工具VHD-UTIL 实现源码,超强，学习高手的设计思路
2017-04-27 20:02:02 下载 158 查看 1,181
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最大公约数七段显示器编码,各个源描述的编译顺序gcd_disp.vhd,vhdl.vhd,stim.vhd

最大公约数七段显示器编码,各个源描述的编译顺序gcd_disp.vhd,vhdl.vhd,stim.vhd
2017-01-14 20:05:02 下载 60 查看 1,090
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gold_code_vhd_217源程序

gold_code_vhd_217源程序
2014-01-22 20:30:01 下载 174 查看 1,031
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本例对各个文件进行编译的顺序是: 17_parity.vhd 17_test_bench.vhd

本例对各个文件进行编译的顺序是: 17_parity.vhd 17_test_bench.vhd
2013-12-08 19:00:38 下载 98 查看 1,062
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用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench

用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench
2014-01-20 12:53:02 下载 59 查看 1,280
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最大公约数的计算,各个源描述的编译顺序:gcd.vhd,gcd_stim.vhd

最大公约数的计算,各个源描述的编译顺序:gcd.vhd,gcd_stim.vhd
2014-01-18 14:08:01 下载 83 查看 1,078
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avr usb 开发教程 avr usb 开发教程

avr usb 开发教程 avr usb 开发教程
2017-06-24 00:43:02 下载 74 查看 1,048
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Vxworks的bsp开发教程！Vxworks的bsp开发教程！Vxworks的bsp开发教程！Vxworks的bsp开发教程！

Vxworks的bsp开发教程！Vxworks的bsp开发教程！Vxworks的bsp开发教程！Vxworks的bsp开发教程！
2014-09-07 18:30:26 下载 41 查看 1,120
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Verilog_and_VHD_stata_machine_design.rar.外国的

Verilog_and_VHD_stata_machine_design.rar.外国的，写得很好，值得一看啊。
2013-12-09 22:27:01 下载 180 查看 1,011
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