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锁相环(PLL)基本原理
锁相环是一种反馈系统，其中电压控制振荡器(VCO)和相位比较器相互连接，使得振荡器可以相对于参考信号维持恒定的相位角度。锁相环可用来从固定的低频信号生成稳定的输出高频信号等。
2013-11-22 11:00:02
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可重配置PLL使用手册
本文档主要是以Altera公司的Stratix II系列的FPGA器件为例，介绍了其内嵌的增强型可重配置PLL在不同的输入时钟频率之间的动态适应，其目的是通过提供PLL的重配置功能，使得不需要对FPGA
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可重配置PLL使用手册
本文档主要是以Altera公司的Stratix II系列的FPGA器件为例，介绍了其内嵌的增强型可重配置PLL在不同的输入时钟频率之间的动态适应，其目的是通过提供PLL的重配置功能，使得不需要对FPGA
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costas for gps its a pll tracking used for gps and galileo
costas for gps its a pll tracking used for gps and galileo
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DDS PLL短波频率合成器设计
本文讨论了DDS+PLL 结构频率合成器硬件电路设计中需要考虑的几方面问题并给
出了设计原则，依此原则我们设计了一套短波波段频率合成器，实验结果证实了其可行性。
出了设计原则，依此原则我们设计了一套短波波段频率合成器，实验结果证实了其可行性。
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基于FPGA的PLL频率合成器
应用FPGA，采用PLL频率合成技术，设计出半整数\整数频率合成器，输出范围为1Khz-999.5Khz，步进频率可达到0.5Khz，经过验证性能很好！