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RS232

RS232 通讯原理 ,RS485通讯原理,RS422 是什么.
2025-06-28 10:40:02 下载 6 查看 9,973
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现在漏洞已经封了,所以把源码没加密的部分公开,应该有点值得大家学习的地方, 技术是什么呢?技术就是细心和发现.可能我真不应该公开这个漏洞,结果一下子 就让QQ公司封了,没办法,大家关注我,我将会再

现在漏洞已经封了,所以把源码没加密的部分公开,应该有点值得大家学习的地方, 技术是什么呢?
2013-12-26 22:35:08 下载 62 查看 1,081
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Knowledge manager。Storing articles,quotes..and managing them We have used a third party component A

Storing articles,quotes..and managing them We have used a third party component Active skin control
2016-12-16 10:24:02 下载 30 查看 1,051
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电路与滤波手册 《The Circuits and Filters Handbook》

《The Circuits and Filters Handbook：Passive, active, and digital filters》-Wai_Kai Chen-Third Edition-CRC

2022-10-13 23:30:02 下载 3 查看 9,788
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人工智能的课程作业

输入动物特征，系统判断是什么动物。
2017-05-11 10:28:02 下载 199 查看 1,038
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ppt模板

ppt模板，296个，需要的下，虽然不是什么代码，也可以为部分人使用
2014-01-18 22:38:13 下载 133 查看 1,083
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VerilogHDL设计方法概述

它的主要作用是什么？
2024-04-26 15:10:01 下载 6 查看 1,990
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采用Verilog HDL 用CPLD 设计控制时序实现了DS

采用Verilog HDL 用CPLD 设计控制时序实现了DSP 和 CPCI 总线桥接器PCI9054 之间的普通传输和高速DMA 传输。
2013-12-24 14:12:01 下载 161 查看 1,125
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包含了四位计数器等基本数字模块的的verilog HDL程序代码,该功能实现,可以直接利用DC进行综合,得到硬件电路,亦能够转换成VHDL语言进行综合

包含了四位计数器等基本数字模块的的verilog HDL程序代码,该功能实现,可以直接利用DC进行综合,得到硬件电路,亦能够转换成VHDL语言进行综合
2013-12-19 04:33:04 下载 121 查看 1,357
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华为verilog教程

本文主要介绍了Verilog HDL 语言的一些基本知识，目的是使初学者能够迅速掌握HDL
设计方法，初步了解并掌握Verilog HDL语言的基本要素，能够读懂简单的设计代码并能
2017-04-08 22:43:23 下载 2 查看 21
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XHDL 4.21附带破解

Verilog／Vhdl转换的XHDL软件X-HDL执行智能翻译你的HDL代码,而不只是语法转换。
2023-04-16 19:30:02 下载 5 查看 3,196
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介绍了一些非常实用的ASP组件

介绍了一些非常实用的ASP组件，DOC格式，介绍了 什么叫活动服务器组件 活动服务器组件的基本知识与介绍 为什么Active Server Pages需要组件 理解Active Server Pages
2013-12-21 02:35:08 下载 86 查看 1,087
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FPGA课件38

3.1.2HDL语言输入。。。。。。。。。。。。。。。。。。
2025-04-18 23:50:01 下载 1 查看 7,239
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是个很不错的游戏

是个很不错的游戏，不过忘记是什么了，自己下了玩玩就知道了
2014-12-20 15:16:01 下载 53 查看 1,087
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7816协议

7816协议，搞IC卡的应该都知道这是什么东东，里面有7816-3 -4。
2016-11-14 10:17:02 下载 201 查看 1,070
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This file include the normalized LMS algorithm and subband LMS algorithm. all of them are in m.file

subband LMS algorithm. all of them are in m.file This file can be used to echo noise cancellation, and active
2014-02-06 19:30:01 下载 55 查看 1,082
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VERILOG

verilgo的学习书什么是Verilog HDL Verilog HDL是一种用于数字逻辑电路设计的硬件描述语言（Hradware Description Language )，可以用来进行数字电路的仿真验证
2025-04-03 10:30:02 下载 2 查看 900
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matalab与vc的编程相结合的运用

matalab与vc的编程相结合的运用，我在其它网站找的，不知道是什么
2015-11-03 00:28:02 下载 180 查看 1,046
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生物识别项目

生物识别项目，能够识别生物体，通过采集生物特征继而区别是什么个体
2014-09-08 17:00:02 下载 177 查看 1,048
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关于RS232的VHDL程序

关于RS232的VHDL程序，具体是什么还不是太清楚，不过程序还是可以借鉴
2017-08-11 00:00:02 下载 21 查看 1,044
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