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利用开发工具ModelSim6.2和QuartusⅡ7.2，并结合硬件描述语言Verilog，以EP2S60F1020C3开发板为目标器件完成了DDS设计的开发、仿真、综合及在线逻辑调试与分析。
2024-07-04 03:30:02
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21．无绳电话机上常见的英文是什么？
2013-11-05 21:12:01
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它们的优缺点是什么？
如何解释它们的输出？本书将使你能够选择并正确应⽤最适合你的机器学习项⽬的解释⽅法。
2021-02-08 21:29:33
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最权威的是网上流传的04版Synopsys公司的培训教程，此外就是各个论坛上零星的技术贴，这给使用者尤其是初学者带来许多困惑和不便，经常在论坛或讨论群中有使用者在问，这个参数适什么含义，如何设置，仿真出现这样的错误信息是什么问题造成的
2022-03-29 13:30:02
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随着社会的发展，电子技术已经不是什么神秘的东西了，人们天天都在和它打交道。在今天的时代，它正飞速地向前发展，面貌日新月异。它产生的种种效果强烈地吸引着青少年和其他初学的电子爱好者。
2022-06-23 20:00:02
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因为通常的C++教材都只会介绍C++的语法什么
的，很少会告诉我们如何去编译、运行，告诉我们什么是控制台程序，什么事Win
程序，什么是GUI程序，C++能干什么，VC和C++的区别是什么。
2022-09-06 13:50:02
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3．采用软件仿真的方法设计和验证了MODELSIM仿真平台以及仿真波形图分析。 4．对比分析了FPGA和传统的ASIC开发过程的区别以及优缺点。
2013-05-25 10:10:01
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整个设计及各个模块都在Altera公司的开发环境QuartusⅡ以及第三方仿真软件Modelsim上进行了逻辑综合以及仿真。
2013-06-08 00:20:02
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Max-Log-MAP算法子译码器关键运算单元的FPGA设计和基于3GPP标准的Turbo码译码器的内交织的FPGA设计进行了深入研究，完成了固定译码长度的Turbo码译码器的FPGA设计实现，并利用ModelSim
2013-07-09 10:20:02
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设计中，通过QuartusⅡ、ModelSim和Protel 99等电子设计自动化开发工具完成了一个高性能嵌入式软硬件系统的设计及仿真验证；采用了实用小巧的嵌入式实时操作系统μC／OS-Ⅱ，为应用系统的实时性提供了保证
2013-07-22 00:50:01
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对于每种编码器，分别设计了其整体结构，并对每种编码器的功能模块进行深入研究，设计完成后利用第3方软件MODELSIM对编码器进行了时序仿真；根据时序仿真结果和综合报告对三种编码方案进行比较，最终选择串行准循环编码器作为硬件实现的编码方案
2013-08-02 03:20:01
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3、利用ModelSim仿真工具对程序进行功能仿真和时序仿真，以验证设计是否能获得所期望的功能，确定设计程序配置到逻辑芯片之后是否可以运行，以及程序在目标器件中的时序关系。
2013-04-24 16:38:35
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本文研究的系统分别在Matlab、ISE、Modelsim、Visual DSP++、ChipScope Pro等软件中进行了仿真和验证，并已交付使用。
2013-04-24 16:38:36
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采用Synplifty Pro、ModelSim和TimingDesigner等各种EDA软件工具对系统中各个层次的模块进行时序设计、代码编写、仿真验证等。
2013-08-05 06:50:01
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MATLAB仿真选择合适的参数，再在Xilinx公司的ISE10.0开发环境下，编写Verilog程序完成了数字下变频器中 NCO、CIC积分梳状滤波抽取器、HB滤波器和FIR滤波器等关键模块设计，并利用Modelsim
2023-06-03 01:50:18
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3、利用ModelSim仿真工具对程序进行功能仿真和时序仿真，以验证设计是否能获得所期望的功能，确定设计程序配置到逻辑芯片之后是否可以运行，以及程序在目标器件中的时序关系。
2023-06-12 14:30:06
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设计中，通过QuartusⅡ、ModelSim和Protel 99等电子设计自动化开发工具完成了一个高性能嵌入式软硬件系统的设计及仿真验证；采用了实用小巧的嵌入式实时操作系统μC／OS-Ⅱ，为应用系统的实时性提供了保证
2023-06-15 06:30:06
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其次,参照IEEE 802.15.3协议标准,设计了(2,1,6)卷积码Viterbi译码器,采用串行方式进行回溯译码,利用双口RAM存储路径度量和幸存信息.电路使用Verilog HDL语言进行描述,ModelSim
2023-06-26 16:40:03
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通过这样的分工可以更全面的发挥两个平台的长处，更具体的来说，在Linux阶段的设计时充分的利用了modelsim与verdi配合的优势，从而更好的设计代码、分析代码和测试代码。
2023-09-11 10:20:01
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采用模块化设计思想，借助Verilog语言及调用FPGA内部IP核完成了系统逻辑设计，包括：12C配置模块、有效数据提取模块、灰度分量提取模块、帧缓存模块、图像算法处理模块、报警模块及显示模块，并借助Modelsim
2023-09-26 10:20:02
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