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在本论文的目标实现部分模块FPGA的硬件设计，用Verilog完成了关键部分的设计。
2024-03-16 07:40:02
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使用Verilog语言实现了本文提出的算法，并对算法进行了功能仿真。为了实现低成本，该算法采用了FPGA和SSRAM的硬件结构实现。
2013-04-24 16:38:22
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根据DDR2-SDRAM的特点，选择合适的内存调度方案，采用Verilog HDL语言设计实现了该高速实时数据采集系统，并对系统功能进行验证与分析，结果表明本设计完全能够满足系统的性能指标。
2013-06-24 00:40:01
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本论文中的主控制器采用Verilog HDL作为硬件描述语言，系统在QuartusⅡ，ModelSim和Synplify软件平台下开发，并在硬件上得到实现，达到了预期效果。
2013-07-21 02:00:01
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在理论研究和分析的基础上，提出模拟器的FPGA的设计与实现,以FPGA为平台，用verilog硬件语言实现了卫星信号的模拟，详细研究了基带模块的实现方法,包括C/A码产生模块，导航电文合成模块，码转换模块
2013-05-30 19:00:02
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基于这些理论知识，确定了OFDM低中频收发信机系统实现方案，并选择ALTERA公司的Cyclone<'TM>ⅡDE2教学评估板和DK-DAP-2C70N开发套件作为FPGA硬件平台，通过使用Verilog
2013-06-29 05:00:01
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根据DDR2-SDRAM的特点，选择合适的内存调度方案，采用Verilog HDL语言设计实现了该高速实时数据采集系统，并对系统功能进行验证与分析，结果表明本设计完全能够满足系统的性能指标。
2013-06-24 06:50:02
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在研究信号采样理论、多速率数字信号处理理论、滤波器设计理论、FPGA硬件数字算法等基础上，并结合实际应用要求，提出了适合于FPGA实现的数字化中频处理系统方案，对系统进行了仿真，验证了系统方案的可行性，然后通过Verilog
2013-07-19 07:30:01
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SystemC的寄存器传输级设计和SystemC的可综合语言子集，以及根据作者设计经历归结的RTL设计准则和经验；接口、端口和通道等SystemC行为建模实例——片上总线系统；SystemC与VHDL/Verilog
2014-11-29 12:06:02
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全书共分为3篇22章，第1篇为基础知识篇，简要介绍了CPLD/FPGA硬件结构知识、VHDL硬件编程语言、Verilog与SystemC编程、常用开发工具；第2篇为常用模块设计实例篇，通过14个模块设计实例
2022-09-08 09:30:02
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根据DDR2-SDRAM的特点，选择合适的内存调度方案，采用Verilog HDL语言设计实现了该高速实时数据采集系统，并对系统功能进行验证与分析，结果表明本设计完全能够满足系统的性能指标。
2023-06-26 23:10:03
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使用Verilog语言实现了本文提出的算法，并对算法进行了功能仿真。为了实现低成本，该算法采用了FPGA和SSRAM的硬件结构实现。
2023-09-28 22:20:01
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本文的主要工作有： 1)采用更高效的ME算法，不仅减少了逻辑单元的使用量，而且速度上也得到提高；2)用Verilog HDI，语言实现RS的译码，包括伽罗华(Galoias)域内的乘法除法器的设计，关键方程求解电路等等
2023-10-01 17:50:01
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在理论研究和分析的基础上，提出模拟器的FPGA的设计与实现,以FPGA为平台，用verilog硬件语言实现了卫星信号的模拟，详细研究了基带模块的实现方法,包括C/A码产生模块，导航电文合成模块，码转换模块
2023-10-03 01:10:01
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在理论研究和分析的基础上，提出模拟器的FPGA的设计与实现,以FPGA为平台，用verilog硬件语言实现了卫星信号的模拟，详细研究了基带模块的实现方法,包括C/A码产生模块，导航电文合成模块，码转换模块
2024-03-16 05:50:01
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根据DDR2-SDRAM的特点，选择合适的内存调度方案，采用Verilog HDL语言设计实现了该高速实时数据采集系统，并对系统功能进行验证与分析，结果表明本设计完全能够满足系统的性能指标。
2024-04-05 09:50:01
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本文的主要工作有： 1)采用更高效的ME算法，不仅减少了逻辑单元的使用量，而且速度上也得到提高；2)用Verilog HDI，语言实现RS的译码，包括伽罗华(Galoias)域内的乘法除法器的设计，关键方程求解电路等等
2024-04-12 20:40:01
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本文正是针对这一现状，在详细分析比较了目前存在的仿真验证软件后，根据本课题的特性及要求从中选取了Gtkwave和Icarus Verilog两个仿真软件，进行二次开发。
2024-04-13 02:30:02
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在研究信号采样理论、多速率数字信号处理理论、滤波器设计理论、FPGA硬件数字算法等基础上，并结合实际应用要求，提出了适合于FPGA实现的数字化中频处理系统方案，对系统进行了仿真，验证了系统方案的可行性，然后通过Verilog
2024-05-08 01:10:01
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信道编码方案进行了详细的阐述,这是本人制定信道内码解码方案的基础.然后,在对内码解码所有模块进行C语言和MATLAB算法仿真的基础上,完成了内码解码总模块的FPGA设计,系统所有的硬件电路设计都采用了Verilog
2024-05-09 22:50:01
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