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从基础语法到测试验证，循序渐进讲解如何用Verilog实现Tone功能的测试流程。涵盖模块设计、激励生成与结果分析，适合提升数字电路仿真能力。
2026-01-25 14:17:49
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此设计采用Verilog HDL硬件语言设计,在掌宇开发板上实现.
将整个电路分为两个子模块，一个提供同步信号（H_SYNC和V_SYNC）及像素位置信息；另一个接收像素位置信息，并输出颜色信号。
2015-04-11 20:52:01
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所用语言Verilog HDL.
2014-11-05 17:30:02
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本书从实际的角度介绍了硬件描述语言Verilog-HDL。通过动手实践体验其语法结构、功能等内涵
2014-08-04 22:59:27
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用Verilog HDL写的数字时钟,已经在开发板上验证过的,绝对原创,使用数码管进行显示!
2013-12-03 11:36:03
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lab1——FPGA这个文件中体统了如何如何使用verilog Hdl以及如何使其在FPGA开发板上实现
2014-10-29 06:15:44
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16阶FIR滤波器--本设计用VERILOG HDL语言串行DA算法实现16阶有限频率响应滤波器！
2016-11-26 00:21:01
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异步FIFO verilog实现
异步FIFO verilog实现
2016-05-20 10:25:01
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·HDL Chip Design
2013-06-18 21:40:02
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针对Virtex-6 给出了HDL设计指南，其中，赛灵思为每个设计元素给出了四个设计方案元素，并给出了Xilinx认为是最适合你的解决方案。
2013-11-07 02:48:01
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针对Virtex-6 给出了HDL设计指南，其中，赛灵思为每个设计元素给出了四个设计方案元素，并给出了Xilinx认为是最适合你的解决方案。
2015-01-02 00:46:01
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学习使用HDL Bencher生成测试积累，并直接调用ModelSim进行仿真的方法.
2015-04-19 20:45:01
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Vlerilog HDL高级数字设计源码，有兴趣者可以来看看，保证是完整版
2013-12-29 00:19:05
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FPGA设计流程指南
本部门所承担的FPGA设计任务主要是两方面的作用：系统的原型实现和ASIC的原型验证。
编写本流程的目的是： z 在于规范整个设计流程，实现开发的合理性、一致性、高效性。 z 形成风格良好和完整的文档。 z 实现在FPGA不同厂家之间以及从FPGA到ASIC的顺利移植。 z 便于新员工快速掌握本部门FPGA的设计流程。
由于目前所用到的FPGA器件以Al
2023-03-22 23:50:02
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本书主要以HDL（verilog/vhdl）为例，详细讲述了在IC DESIGN FLOW中 Verification 以及Test的设计思想、方法和技巧，涵概了测试的各个方面， 是目前进行IC设计的同仁们最为推荐的一本宝典
2024-03-03 19:30:02
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本书主要以HDL（verilog/vhdl）为例，详细讲述了在IC DESIGN FLOW中 Verification 以及Test的设计思想、方法和技巧，涵概了测试的各个方面， 是目前进行IC设计的同仁们最为推荐的一本宝典
2024-03-03 19:50:01
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本书主要以HDL（verilog/vhdl）为例，详细讲述了在IC DESIGN FLOW中 Verification 以及Test的设计思想、方法和技巧，涵概了测试的各个方面， 是目前进行IC设计的同仁们最为推荐的一本宝典
2024-03-03 21:50:01
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·HDL Chip Design
2024-11-21 03:00:01
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看过后就知道USB是什么回事了,对USB接口的操作,读取
2015-08-30 20:45:01
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查找ORACLE系统最耗费系统资源是是什么任务或什么语句
2014-12-05 15:43:02
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