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最后在EP1S808956C6芯片上，应用ALTERA公司的FPGA开发工具QUARTUS 6.1，采用了国际标准的硬件描述语言—VHDL语言和框图设计，对此算法给予硬件实现。
2023-10-01 18:50:01
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最后，采用VHDL 硬件描述语言对系统进行了设计与实现。文中对位定时同步以及CIC滤波器的可变速设计做了创新与改进。
2023-10-04 01:40:01
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主要包括采用了FPGA 芯片，使用VHDL 语言进行编程，使其具有了更强的移植性，更加利于产品升级；利用LCD 液晶显示取代了传统的LED显示，使其在显示时更灵活多变，可以按需要改变显示内容而不拘泥于硬件
2023-10-07 20:00:02
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论文设计的最后部分是利用Altera公司Cyclone系列FPGA芯片EP1C6F256C6和EPCS4配置芯片设计设计SD转换器，在QuartusⅡ4.0下采用VHDL语言和逻辑电路图结合的设计方法，
2024-01-06 20:30:01
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研究了椭圆曲线数字签名算法的FPGA的实现:以基本的数论理论、抽象代数和复杂度理论为依据,结合信息论、密码学的一些知识以及一些具体的相关算法,确定了ECDSA的硬件实现方案:按照层次化、模块化的设计思想,采用硬件描述语言VHDL
2024-01-26 04:40:02
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最后，采用VHDL 硬件描述语言对系统进行了设计与实现。文中对位定时同步以及CIC滤波器的可变速设计做了创新与改进。
2024-02-01 07:20:02
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主要包括采用了FPGA 芯片，使用VHDL 语言进行编程，使其具有了更强的移植性，更加利于产品升级；利用LCD 液晶显示取代了传统的LED显示，使其在显示时更灵活多变，可以按需要改变显示内容而不拘泥于硬件
2024-03-05 14:40:01
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时钟透传技术白皮书
-2019-11-13 16:37
华为专利——一种将异步时钟域转换成同步时钟域的方法
-2019-11-13 16:37
华为coding style
-2019-11-13 16:37
华为VHDL
2021-01-22 17:36:49
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想要实现硬件加速电路——作为配合CPU处理单元的重要组成部分，cache访问技术又成为制约其速度快慢的关键部分，而cache与内存(SDRAM)的通信方式可以直接导致访问速度的不同。
2023-10-02 07:20:02
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想要实现硬件加速电路——作为配合CPU处理单元的重要组成部分，cache访问技术又成为制约其速度快慢的关键部分，而cache与内存(SDRAM)的通信方式可以直接导致访问速度的不同。
2024-02-19 05:20:02
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硬件电路上，系统设计了三块电路板：FPGA核心处理板、图像采集卡、图像显示卡，其中通过I2C总线对采集卡的工作模式进行配置，在采集模块控制下，将采集到的图像数据存储到SDRAM；根据VGA显示原理及其时序关系
2013-08-05 06:30:01
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它的内核模块采用了ARM920T核的S3C2410，外部有SDRAM、FLASH、串口、网卡、鼠标、键盘、LCD等，同时还提供有扩展插槽，该平台主要面向高性能的电力、工业控制等，适用于网络的研究；本文探讨嵌入式软件开发模式
2013-07-10 11:40:02
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存储器方面外扩了NOR FLASH、NAND FLASH、SDRAM。接口方面设计了CAN、USB、RS232、以太网等标准接口，和GPIO、AD等接口。
2013-05-30 19:50:01
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数据拆分采用线路循环与帧间插相结合的方法,A路插满一帧(30时隙)后,转入B路E1间插数据,依此类推,循环间插所有的数据.接收电路进行HDB3解码,帧同步定位(子帧同步和复帧同步),线路延迟判断,FIFO和SDRAM
2013-07-16 23:00:01
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在更多进一步的实验中还用到了SRAM，SDRAM Fash以及16×驸字符液晶。需要进行处理器和O接口试验时，可以简单的用 Altera Niosll处理器和象RS-232和PS/2标准接口。
2022-04-01 05:30:02
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数据拆分采用线路循环与帧间插相结合的方法,A路插满一帧(30时隙)后,转入B路E1间插数据,依此类推,循环间插所有的数据.接收电路进行HDB3解码,帧同步定位(子帧同步和复帧同步),线路延迟判断,FIFO和SDRAM
2023-06-15 23:30:15
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存储器方面外扩了NOR FLASH、NAND FLASH、SDRAM。接口方面设计了CAN、USB、RS232、以太网等标准接口，和GPIO、AD等接口。
2023-06-18 10:20:04
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它的内核模块采用了ARM920T核的S3C2410，外部有SDRAM、FLASH、串口、网卡、鼠标、键盘、LCD等，同时还提供有扩展插槽，该平台主要面向高性能的电力、工业控制等，适用于网络的研究；本文探讨嵌入式软件开发模式
2023-06-20 18:10:04
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该系统采用FPGA为核心控制芯片，前端对接收的200MB/s中频数据流解码并进行数据处理后，将其缓存于大容量内存条DDR2 SDRAM内，后端通过PCI与主机进行通讯，接收波形显示控制命令，从而根据控制参数对波形进行处理
2023-06-27 13:50:02
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硬件电路上，系统设计了三块电路板：FPGA核心处理板、图像采集卡、图像显示卡，其中通过I2C总线对采集卡的工作模式进行配置，在采集模块控制下，将采集到的图像数据存储到SDRAM；根据VGA显示原理及其时序关系
2023-06-29 10:50:03
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