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北大verilog hdl课件！内部资料，内含大量的工程实例，是学习的好资料
2013-12-29 15:52:06
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清华大学verilog hdl源码例子，作业，内含源代码，详细的文档说明，非常有用
2013-12-27 06:37:01
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数据交织器
verilog HDL源文件
2013-12-23 08:23:18
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verilog HDL语言编写的数字秒表，仿真已经通过，可供参考
2013-12-19 11:45:06
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周立功Verilog HDL黄金参考指南，学习VerriLog的东西。
2014-01-17 22:15:02
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用verilog HDL写的VGA驱动，在FPGA上实测可用（实际上是别人的劳动成果，呵呵）。
2014-01-15 05:56:01
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verilog HDLverilog HDLverilog HDLverilog HDLverilog HDLverilog HDL
2014-01-04 07:26:11
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verilog hdlverilog hdlverilog hdlverilog hdlverilog hdlverilog hdl
2017-06-24 00:55:01
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用Verilog HDL编写的秒表设计，可以实现百分之一秒，十分之一秒，秒，十秒等功能。
2017-07-09 20:31:02
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用verilog HDL 写的时钟程序，在DE2上实现了。
2017-07-11 00:57:02
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"font-family:Verdana, Geneva, sans-serif;white-space:normal;background-color:#F5F5F5;">常用模块的Verilog-HDL
2020-03-20 17:16:41
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基于Verilog-HDL的DDS设计
这是一份非常不错的资料，欢迎下载，希望对您有帮助！
2021-12-21 00:30:02
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Verilog HDL是一种硬件描述语言（，以文本形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式，还可以表示数字逻辑系统所完成的逻辑功能。
2022-09-05 05:10:02
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阐述了Verilog语言的基本语法，这是一本定位于Verilog语言初学者必须要首先看懂的一本电子书
2022-10-15 17:20:02
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学习Verilog需要注意的地方，讲解详细认真，值得推荐
2022-11-19 00:10:02
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本书通过100多个模块实例，详细地讲解了veriloghdl程序设计语言，全书共分13章，内容涉及veriloghdl语言基本概念、建模、同步设计、异步设计、功能验证等，实例包括各种加法器/计数器、乘法器/除法器、编码器/译码器、状态机、spimastercontroller、i2cmastercontroller、canprotocolcontroller、memory模块、jpeg图像压缩模块
2022-12-12 14:50:02
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这是我个人整理的资料，希望大家有兴趣的选择性下载：Verilog_HDL系列。
2023-01-26 02:20:02
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Verilog_HDL高级数字设计知识，英文版
2023-02-16 23:50:02
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编写本流程的目的是： z 在于规范整个设计流程，实现开发的合理性、一致性、高效性。 z 形成风格良好和完整的文档。 z 实现在FPGA不同厂家之间以及从FPGA到ASIC的顺利移植。
2023-03-22 23:50:02
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资料->【C】嵌入系统->【C2】IC设计与FPGA->【3】其它->【Verilog HDL、VHDL、硬件描述语言】->Verilog HDL的基础知识.pdf
2023-04-25 11:00:03
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