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音乐，用vhdl编写的程序
2014-01-20 09:05:14
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一个8X8的矩阵键盘的VHDL文件,并且有长安键和短按键之分,即一共能做到128个键值,扫描用的时钟用1ms的就行了
2013-12-13 23:40:02
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包含了四位计数器等基本数字模块的的verilog HDL程序代码,该功能实现,可以直接利用DC进行综合,得到硬件电路,亦能够转换成VHDL语言进行综合
2013-12-19 04:33:04
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这个是基于NIOS II的FPGA平台的一个CF卡的接口模块，是在Quartus II下的完整工程包
2015-05-04 20:46:01
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在开发板上实现svga条形信号发生器的源代码，是在quartus II 6.0的开发环境中运行的
2013-12-23 18:26:19
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QuartusII6.0的英文培训资料277页的ppt宝贵资料，图文并茂，一步步教你使用Quartus
2013-12-12 08:12:01
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基于vhdl的电子时钟设计
2013-10-13 03:20:01
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基于vhdl的电子时钟设计
2013-11-05 15:28:01
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baseband解调，vhdl硬件实现，matlab仿真
2016-05-18 10:52:02
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Verilog黄金指南，比VHDL编程容易
2014-01-18 15:33:19
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Altera Sdram IP 源码，VHDL写的
2014-01-01 05:47:01
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Advanced Electronic Design Automation Examples of VHDL Descriptions
2024-11-04 15:50:01
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该报告简述了QuartusⅡ仿真软件的基本操作方法，同时介绍FPGA逻辑器件的相关知识和Verilog硬件描述语言的相关知识，在基于FPGA逻辑器件、QuartusⅡ仿真软件和Verilog硬件描述语言下
2022-11-08 09:30:02
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AVR单片机
是什么意思？
2013-11-23 19:44:02
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使晶闸管导通的条件是什么？
答：使晶闸管导通的条件是：晶闸管承受正向阳极电压，并在门极施加触发电流（脉冲）。
或：uAK>0且uGK>0。
2013-11-22 12:36:01
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对 CAN 是什么、CAN 的特征、标准规格下的位置分布等、CAN 的概要及 CAN 的协议进行了说明。
2023-03-11 02:40:02
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VHDL硬件设计入门学习。VHDL基本語法架構，VHDL的零件庫(Library)及包裝(Package)等内容。
2014-01-22 22:21:16
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二进制码转换为格雷码，整个工程包括了波形文件，在Quartus上的可以直接进行仿真。
2014-07-30 03:00:22
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是基于EDA系统上的一24小时制的数字钟设计，利用EDA系统通过Quartus2直接运行。
2014-01-11 00:26:01
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基于FPGA的SDRAM控制器Verilog代码，开发环境为Quartus6.1，控制SDRAM实现对同一片地址先写后读。
2013-12-20 11:51:03
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