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非常号的Verilog HDL教学源码，大家多
2014-01-06 07:17:02
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Vlerilog HDL高级数字设计源码，有兴趣者可以来看看，保证是完整版
2013-12-29 00:19:05
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《设计与验证Verilog HDL》光盘内容
2013-12-02 18:17:01
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VERILOG hdl
2016-03-30 00:09:02
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cordic算法的Verilog HDL具体实现
2013-12-06 02:57:10
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PWM的Verilog HDL代码用于FPGA
2013-12-22 09:05:09
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multiplier_6x6___verilog hdl
2016-06-14 20:47:02
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北大verilog hdl课件！内部资料，内含大量的工程实例，是学习的好资料
2013-12-29 15:52:06
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清华大学verilog hdl源码例子，作业，内含源代码，详细的文档说明，非常有用
2013-12-27 06:37:01
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数据交织器
verilog HDL源文件
2013-12-23 08:23:18
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verilog HDL语言编写的数字秒表，仿真已经通过，可供参考
2013-12-19 11:45:06
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周立功Verilog HDL黄金参考指南，学习VerriLog的东西。
2014-01-17 22:15:02
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用verilog HDL写的VGA驱动，在FPGA上实测可用（实际上是别人的劳动成果，呵呵）。
2014-01-15 05:56:01
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verilog HDLverilog HDLverilog HDLverilog HDLverilog HDLverilog HDL
2014-01-04 07:26:11
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2017-06-24 00:55:01
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用Verilog HDL编写的秒表设计，可以实现百分之一秒，十分之一秒，秒，十秒等功能。
2017-07-09 20:31:02
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用verilog HDL 写的时钟程序，在DE2上实现了。
2017-07-11 00:57:02
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"font-family:Verdana, Geneva, sans-serif;white-space:normal;background-color:#F5F5F5;">常用模块的Verilog-HDL
2020-03-20 17:16:41
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基于Verilog-HDL的DDS设计
这是一份非常不错的资料，欢迎下载，希望对您有帮助！
2021-12-21 00:30:02
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Verilog HDL是一种硬件描述语言（，以文本形式来描述数字系统硬件的结构和行为的语言，用它可以表示逻辑电路图、逻辑表达式，还可以表示数字逻辑系统所完成的逻辑功能。
2022-09-05 05:10:02
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