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多路选择器 verilog CPLD EPM1270 源代码

多路选择器 verilog CPLD EPM1270 源代码
2016-11-24 00:25:02 下载 75 查看 1,130
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模拟交通灯 verilog CPLD EPM1270 源代码

模拟交通灯 verilog CPLD EPM1270 源代码
2016-11-24 00:26:01 下载 166 查看 1,041
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802.3an Ethernet 以太网络 LDPC Verilog 网表实现

802.3an Ethernet 以太网络 LDPC Verilog 网表实现
2016-11-27 10:21:02 下载 79 查看 1,065
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fft代码,采用蝶形算法,包括C,matlab和verilog代码

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2013-12-28 18:36:01 下载 137 查看 1,041
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Verilog-RISC CPU 代码 实现了简单的RISC cpu

Verilog-RISC CPU 代码 实现了简单的RISC cpu,可供初学者参考,学习硬件描述语言,及设计方法。该程序通过了modelsim仿真验证。 北航
2016-12-25 00:37:02 下载 86 查看 1,143
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<I believe> song _verilog code for any device.

<I believe> song _verilog code for any device.
2013-12-22 19:06:06 下载 72 查看 1,075
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实用的任意时钟分频Verilog代码 可以任意分频的!

实用的任意时钟分频Verilog代码 可以任意分频的!
2016-12-27 10:16:02 下载 192 查看 1,233
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一个LCD控制器的verilog源代码

一个LCD控制器的verilog源代码,可以方便的控制TFT LCD!
2014-01-05 06:39:07 下载 92 查看 1,087
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Verilog的135个经典设计实例。包含源码和说明

Verilog的135个经典设计实例。包含源码和说明
2017-01-02 10:27:02 下载 25 查看 1,073
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精通verilog_hdl语言编程实例程序代码

精通verilog_hdl语言编程实例程序代码,基于verilog硬件语言的程序设计实例,主要是数字电路方面
2017-02-13 10:13:02 下载 104 查看 1,122
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Verilog HDL 在QUARTUS II下的编译和仿真顺序

Verilog HDL 在QUARTUS II下的编译和仿真顺序
2014-01-14 02:04:12 下载 63 查看 1,141
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这是一个Quartus的工程文件和verilog代码

这是一个Quartus的工程文件和verilog代码,讲如何把memory 变成vector
2017-03-07 10:54:02 下载 41 查看 1,081
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完整的九层电梯控制器verilog源代码

完整的九层电梯控制器verilog源代码
2013-11-29 22:42:01 下载 176 查看 1,067
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Hardware UDP, implementation of UDP based on Altera DE2 using Verilog

Hardware UDP, implementation of UDP based on Altera DE2 using Verilog
2017-03-09 00:13:01 下载 172 查看 1,085
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详细介绍verilog语言中的阻塞和非阻塞问题

详细介绍verilog语言中的阻塞和非阻塞问题
2014-12-06 00:42:02 下载 150 查看 1,078
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实现USB接口功能的VHDL和verilog完整源代码

实现USB接口功能的VHDL和verilog完整源代码
2017-03-21 00:24:01 下载 198 查看 1,082
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it is a verilog code written for MELAY state machine based UART and it wll synthesize in xinlix

it is a verilog code written for MELAY state machine based UART and it wll synthesize in xinlix ise
2013-12-11 21:55:01 下载 197 查看 1,125
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比较经典的使用verilog RTL规范coding style的书。

比较经典的使用verilog RTL规范coding style的书。
2013-12-25 11:40:07 下载 114 查看 1,060
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基于Verilog HDL 的一个CAN总线IP核。

基于Verilog HDL 的一个CAN总线IP核。
2013-12-08 15:58:19 下载 179 查看 1,119
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《无线通信FPGA设计》书里的matlab和verilog代码

《无线通信FPGA设计》书里的matlab和verilog代码
2013-12-10 05:21:05 下载 21 查看 1,136
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