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占空比50 的三分频Verilog代码，包含PDF说明和源代码
2017-08-24 10:29:01
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王金明老师书上verilog的程序 相当经典
2014-01-02 09:46:01
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I2C verilog HDL code including test environment
2017-09-06 00:20:02
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I2S verilog HDL code including test environment
2013-12-24 07:36:09
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用verilog设计一个简单的cpu系统
2014-01-05 18:31:01
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DM9000A读寄存器模块, verilog HDL
2014-01-16 09:50:01
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以太网控制器MAC的verilog代码，已经过验证，可以用。
2017-09-18 20:43:02
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上传文件为：常用乘法器verilog设计.rar
2013-12-17 13:02:02
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上传文件为：常用加法器verilog设计.rar
2014-11-18 06:30:38
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积分梳状滤波器(CIC)verilog设计.rar
2014-02-25 11:30:01
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基于verilog hdl的UART串口发送子程序。
2017-09-24 00:13:02
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11阶滤波器的verilog基本代码描述
2013-12-26 10:09:01
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Turbo码的verilog实现，可以运行。
2015-05-18 23:10:33
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硬件描述语言Verilog 清华大学出版社 刘明业 蒋敬旗等译 学习Verilog的一本很好的资料
2016-03-18 21:13:16
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:Verdana, Geneva, sans-serif;line-height:normal;white-space:normal;background-color:#F5F5F5;">硬件描述语言Verilog
2016-04-05 08:55:18
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本设计采用Verilog实现（4200,4096，17）的BCH 编码设计。
2016-09-22 20:39:47
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用verilog编写的三分频器代码，用modelsim测试没有问题，有问题请反馈给我
2017-02-26 20:14:34
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数字系统设计,数字系统设计,数字系统设计
2018-03-08 08:54:57
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用户接口Wishbone bus 接口，
驱动LPC master去主动访问 slave 寄存器表（地址可更改）
读取到寄存器封装到用户层
可按要求更改设计
2020-05-21 11:46:35
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该文档为用FPGA实现SRAM读写控制的Verilog代码讲解资料，讲解的还不错，感兴趣的可以下载看看…………………………
2021-10-21 22:00:01
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