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Verilog编写的EPROM串行数据的读取模块

这份详尽的Verilog代码示例,专注于EPROM串行数据读取模块的设计与实现。通过深入解析EPROM的工作原理及数据传输机制,为工程师们提供了从理论到实践的一站通解决方案。
2025-12-09 05:41:09 下载 1 查看 47
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可维护可移植的Verilog工程设计技巧

从基础语法到工程实践,循序渐进讲解如何编写可维护、可移植的Verilog代码。掌握模块化设计、命名规范与代码结构优化技巧,提升开发效率与协作能力。
2026-01-10 14:06:03 下载 1 查看 62
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使用fpga设置的信号发生器verilog代码

帮助开发者快速上手FPGA信号生成,通过Verilog实现AM与FM调制功能,掌握数字信号处理核心逻辑,提升硬件设计实战能力。
2026-01-30 09:04:51 下载 1 查看 95
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特权《Verilog边码边学》视频教程全集

01 001 Vivado下载与安装.flv 02 002 Notepad++安装与设置.flv 03 003 Modelsim安装配置与库编译.flv 04 004 Modelsim自动仿真环境搭建.flv 05 101 组合逻辑与时序逻辑.flv 06 102 分频计数器设计.flv 07 103 使能时钟设计.flv 08 104 基于Xilinx BUFGCE原语的门控时钟设计.flv 0
2021-08-25 16:17:36
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arm9_fpga2_verilog是一个可以综合的用verilog写的arm9的ip软核

arm9_fpga2_verilog是一个可以综合的用verilog写的arm9的ip软核,对学习arm和FPGA开发有帮助。
2013-08-23 06:00:01 下载 175 查看 1,292
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arm9_fpga2_verilog是一个可以综合的用verilog写的arm9的ip软核

arm9_fpga2_verilog是一个可以综合的用verilog写的arm9的ip软核,对学习arm和FPGA开发有帮助。
2014-12-02 09:48:01 下载 198 查看 1,111
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北大微电子学系于敦山老师的课件

北大微电子学系于敦山老师的课件,介绍Verilog HDL、Cadence Verilog仿真器、可综合的Verilog HDL、设计举例、自动布局布线工具、Verilog的词汇约定等内容
2013-11-25 20:54:05 下载 174 查看 1,229
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也许你还在想ERP是什么!看看这个就知道了(企业资源计划)的简称.

也许你还在想ERP是什么!看看这个就知道了(企业资源计划)的简称.
2014-01-13 02:14:13 下载 122 查看 1,074
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这是数据结构书上的代码,我自己写的,就是厦门大学用的那本,不是什么高手,大家一起讨论哦

这是数据结构书上的代码,我自己写的,就是厦门大学用的那本,不是什么高手,大家一起讨论哦
2013-12-20 13:34:04 下载 39 查看 1,105
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一61 板是什么开发板有什么功能 二硬件框图及简要说明 三如何利用61 板进行开发 四学习向导

一61 板是什么开发板有什么功能 二硬件框图及简要说明 三如何利用61 板进行开发 四学习向导
2017-08-05 20:41:02 下载 37 查看 1,053
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一61 板是什么开发板有什么功能 二硬件框图及简要说明 三如何利用61 板进行开发 四学习向导

一61 板是什么开发板有什么功能 二硬件框图及简要说明 三如何利用61 板进行开发 四学习向导
2014-09-03 01:30:03 下载 144 查看 1,051
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Verilog HDL语言编写,在Quartus II 8.1 (32-Bit)软件中编译,并下载至EPM7

Verilog HDL语言编写,在Quartus II 8.1 (32-Bit)软件中编译,并下载至EPM7128SLC84-10芯片中通过. 文件中有详细的注解.
2017-02-20 00:15:02 下载 22 查看 1,127
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SystemVerilog for Design

·SystemVerilog is a rich set of extensions to the IEEE 1364-2001 Verilog Hardware Description Language
2013-07-14 16:00:01 下载 100 查看 1,108
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SystemVerilog for Design

·SystemVerilog is a rich set of extensions to the IEEE 1364-2001 Verilog Hardware Description Language
2023-05-03 09:50:14 下载 7 查看 7,547
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直接频率合成器

直接频率合成器,采用verilog hdl
2013-12-11 11:22:01 下载 95 查看 1,018
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模数变换器

模数变换器,采用verilog hdl编写
2013-12-20 01:57:04 下载 115 查看 1,032
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发都通常都使用典型场景(scenarios)来理解一个系统的需要是什么和系统是怎样工作的。不幸的是

发都通常都使用典型场景(scenarios)来理解一个系统的需要是什么和系统是怎样工作的。不幸的是,尽管开发都已经这样做了,但它极少用有效的形式归档。
2017-09-05 10:13:02 下载 88 查看 1,086
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用verlog HDL写的电子日历,可以显示年,月,日和时间,具有闹铃的功能

用verlog HDL写的电子日历,可以显示年,月,日和时间,具有闹铃的功能
2015-05-12 20:44:01 下载 61 查看 1,211
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此程序为用VERLOG HDL编写的一个完整的3位加法器。

此程序为用VERLOG HDL编写的一个完整的3位加法器。
2013-12-29 01:53:07 下载 59 查看 1,094
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用verillog HDL 写的数字频率计.在实验箱上测试通过

用verillog HDL 写的数字频率计.在实验箱上测试通过
2013-12-28 20:23:05 下载 163 查看 1,137
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