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System Verilog中的随机化激励
在SystemVeri log更强调了利用随机化激励函数以提高验证代码的效率和验证可靠性的重要性。本文以VMM库为例，阐述了如何在SystemVeri 1og中使用随机化函数来编写高效率的测试代码，重点介绍了可重验证函数库的使用方法，以帮助读者理解如何使用SystemVeri1og高效率地完成复杂的设计验证。
2013-11-06 22:20:01
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Verilog基本电路设计指导书
本文列举了大量的基本电路的Verilog HDL 代码，使初学者能够迅速熟悉基本的HDL 建模；同时也列举了一些常用电路的代码，作为设计者的指导。
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设计与验证Verilog HDL（吴继华）
设计与验证Verilog HDL【作者：王诚、吴继华；出版社：人民邮电出版社】
本书以实例讲解的方式对HDL语言的设计方法进行介绍。