step_a.fit.rpt

基于FPGA的直流电机的PWM控制和步进电机的细分驱动控制。使用VHDL语言编写

; Slow Slew Rate                                     ; Off                ; Off                            ;
; PCI I/O                                            ; Off                ; Off                            ;
; Weak Pull-Up Resistor                              ; Off                ; Off                            ;
; Enable Bus-Hold Circuitry                          ; Off                ; Off                            ;
; Auto Global Memory Control Signals                 ; Off                ; Off                            ;
; Auto Packed Registers -- Cyclone                   ; Auto               ; Auto                           ;
; Auto Delay Chains                                  ; On                 ; On                             ;
; Auto Merge PLLs                                    ; On                 ; On                             ;
; Perform Physical Synthesis for Combinational Logic ; Off                ; Off                            ;
; Perform Register Duplication                       ; Off                ; Off                            ;
; Perform Register Retiming                          ; Off                ; Off                            ;
; Physical Synthesis Effort Level                    ; Normal             ; Normal                         ;
; Logic Cell Insertion - Logic Duplication           ; Auto               ; Auto                           ;
; Auto Register Duplication                          ; Off                ; Off                            ;
; Auto Global Clock                                  ; On                 ; On                             ;
; Auto Global Register Control Signals               ; On                 ; On                             ;
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; Fitter Device Options                                                   ;
+----------------------------------------------+--------------------------+
; Option                                       ; Setting                  ;
+----------------------------------------------+--------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off                      ;
; Enable device-wide reset (DEV_CLRn)          ; Off                      ;
; Enable device-wide output enable (DEV_OE)    ; Off                      ;
; Enable INIT_DONE output                      ; Off                      ;
; Configuration scheme                         ; Active Serial            ;
; Error detection CRC                          ; Off                      ;
; Reserve all unused pins                      ; As output driving ground ;
; Base pin-out file on sameframe device        ; Off                      ;
+----------------------------------------------+--------------------------+


+------------------+
; Fitter Equations ;
+------------------+
The equations can be found in E:/GW48-PK3/EDA新板子/Chpt12_vga_moto/EP1C3_12_1_2_MOTO/step_a.fit.eqn.


+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/GW48-PK3/EDA新板子/Chpt12_vga_moto/EP1C3_12_1_2_MOTO/step_a.pin.


+------------------------------------------------------------------------+
; Fitter Resource Usage Summary                                          ;
+---------------------------------------------+--------------------------+
; Resource                                    ; Usage                    ;
+---------------------------------------------+--------------------------+
; Total logic elements                        ; 481 / 2,910 ( 16 % )     ;
;     -- Combinational with no register       ; 123                      ;
;     -- Register only                        ; 92                       ;
;     -- Combinational with a register        ; 266                      ;
;                                             ;                          ;
; Logic element usage by number of LUT inputs ;                          ;
;     -- 4 input functions                    ; 115                      ;
;     -- 3 input functions                    ; 135                      ;
;     -- 2 input functions                    ; 118                      ;
;     -- 1 input functions                    ; 66                       ;
;     -- 0 input functions                    ; 47                       ;
;                                             ;                          ;
; Logic elements by mode                      ;                          ;
;     -- normal mode                          ; 382                      ;
;     -- arithmetic mode                      ; 99                       ;
;     -- qfbk mode                            ; 36                       ;
;     -- register cascade mode                ; 0                        ;
;     -- synchronous clear/load mode          ; 126                      ;
;     -- asynchronous clear/load mode         ; 254                      ;
;                                             ;                          ;
; Total LABs                                  ; 78 / 291 ( 26 % )        ;
; Logic elements in carry chains              ; 116                      ;
; User inserted logic elements                ; 0                        ;
; Virtual pins                                ; 0                        ;
; I/O pins                                    ; 33 / 104 ( 31 % )        ;
;     -- Clock pins                           ; 2 / 2 ( 100 % )          ;
; Global signals                              ; 8                        ;
; M4Ks                                        ; 5 / 13 ( 38 % )          ;
; Total memory bits                           ; 16,896 / 59,904 ( 28 % ) ;
; Total RAM block bits                        ; 23,040 / 59,904 ( 38 % ) ;
; Global clocks                               ; 8 / 8 ( 100 % )          ;
; Maximum fan-out node                        ; altera_internal_jtag~TDO ;
; Maximum fan-out                             ; 231                      ;
; Total fan-out                               ; 2253                     ;
; Average fan-out                             ; 4.28                     ;
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