step_a.map.rpt

基于FPGA的直流电机的PWM控制和步进电机的细分驱动控制。使用VHDL语言编写

; sld_rom_sr.vhd                   ; yes             ; Encrypted Megafunction             ; e:/altera/quartus50/libraries/megafunctions/sld_rom_sr.vhd                     ;
; sld_signaltap.vhd                ; yes             ; Encrypted Megafunction             ; e:/altera/quartus50/libraries/megafunctions/sld_signaltap.vhd                  ;
; sld_ela_control.vhd              ; yes             ; Encrypted Megafunction             ; e:/altera/quartus50/libraries/megafunctions/sld_ela_control.vhd                ;
; lpm_shiftreg.tdf                 ; yes             ; Megafunction                       ; e:/altera/quartus50/libraries/megafunctions/lpm_shiftreg.tdf                   ;
; sld_mbpmg.vhd                    ; yes             ; Encrypted Megafunction             ; e:/altera/quartus50/libraries/megafunctions/sld_mbpmg.vhd                      ;
; db/cntr_no8.tdf                  ; yes             ; Auto-Generated Megafunction        ; E:/GW48-PK3/EDA新板子/Chpt12_vga_moto/EP1C3_12_1_2_MOTO/db/cntr_no8.tdf        ;
; db/cntr_f29.tdf                  ; yes             ; Auto-Generated Megafunction        ; E:/GW48-PK3/EDA新板子/Chpt12_vga_moto/EP1C3_12_1_2_MOTO/db/cntr_f29.tdf        ;
; sld_acquisition_buffer.vhd       ; yes             ; Encrypted Megafunction             ; e:/altera/quartus50/libraries/megafunctions/sld_acquisition_buffer.vhd         ;
; db/cntr_vt9.tdf                  ; yes             ; Auto-Generated Megafunction        ; E:/GW48-PK3/EDA新板子/Chpt12_vga_moto/EP1C3_12_1_2_MOTO/db/cntr_vt9.tdf        ;
; db/altsyncram_5f92.tdf           ; yes             ; Auto-Generated Megafunction        ; E:/GW48-PK3/EDA新板子/Chpt12_vga_moto/EP1C3_12_1_2_MOTO/db/altsyncram_5f92.tdf ;
; db/cntr_tt7.tdf                  ; yes             ; Auto-Generated Megafunction        ; E:/GW48-PK3/EDA新板子/Chpt12_vga_moto/EP1C3_12_1_2_MOTO/db/cntr_tt7.tdf        ;
; db/cntr_ln7.tdf                  ; yes             ; Auto-Generated Megafunction        ; E:/GW48-PK3/EDA新板子/Chpt12_vga_moto/EP1C3_12_1_2_MOTO/db/cntr_ln7.tdf        ;
; sld_hub.vhd                      ; yes             ; Encrypted Megafunction             ; e:/altera/quartus50/libraries/megafunctions/sld_hub.vhd                        ;
; lpm_decode.tdf                   ; yes             ; Megafunction                       ; e:/altera/quartus50/libraries/megafunctions/lpm_decode.tdf                     ;
; declut.inc                       ; yes             ; Other                              ; e:/altera/quartus50/libraries/megafunctions/declut.inc                         ;
; db/decode_9ie.tdf                ; yes             ; Auto-Generated Megafunction        ; E:/GW48-PK3/EDA新板子/Chpt12_vga_moto/EP1C3_12_1_2_MOTO/db/decode_9ie.tdf      ;
; sld_dffex.vhd                    ; yes             ; Encrypted Megafunction             ; e:/altera/quartus50/libraries/megafunctions/sld_dffex.vhd                      ;
+----------------------------------+-----------------+------------------------------------+--------------------------------------------------------------------------------+


+--------------------------------------------------------------+
; Analysis & Synthesis Resource Usage Summary                  ;
+-----------------------------------+--------------------------+
; Resource                          ; Usage                    ;
+-----------------------------------+--------------------------+
; Total logic elements              ; 523                      ;
; Total combinational functions     ; 382                      ;
;     -- Total 4-input functions    ; 115                      ;
;     -- Total 3-input functions    ; 105                      ;
;     -- Total 2-input functions    ; 81                       ;
;     -- Total 1-input functions    ; 76                       ;
;     -- Total 0-input functions    ; 5                        ;
; Combinational cells for routing   ; 0                        ;
; Total registers                   ; 358                      ;
; Total logic cells in carry chains ; 116                      ;
; I/O pins                          ; 33                       ;
; Total memory bits                 ; 16896                    ;
; Maximum fan-out node              ; altera_internal_jtag~TDO ;
; Maximum fan-out                   ; 250                      ;
; Total fan-out                     ; 2574                     ;
; Average fan-out                   ; 4.40                     ;
+-----------------------------------+--------------------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity                                                                                                                                                                                                                                                                                                                                                                                                                                                                                            ;
+---------------------------------------------------------------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Compilation Hierarchy Node                                                                        ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name                                                                                                                                                                                                                                                                               ;
+---------------------------------------------------------------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; |step_a                                                                                           ; 523 (5)     ; 358          ; 16896       ; 33   ; 0            ; 165 (1)      ; 141 (4)           ; 217 (0)          ; 116 (0)         ; |step_a                                                                                                                                                                                                                                                                                           ;
;    |21mux:65|                                                                                     ; 1 (1)       ; 0            ; 0           ; 0    ; 0            ; 1 (1)        ; 0 (0)             ; 0 (0)            ; 0 (0)           ; |step_a|21mux:65                                                                                                                                                                                                                                                                                  ;
;    |21mux:66|                                                                                     ; 1 (1)       ; 0            ; 0           ; 0    ; 0            ; 1 (1)        ; 0 (0)             ; 0 (0)            ; 0 (0)           ; |step_a|21mux:66                                                                                                                                                                                                                                                                                  ;
;    |CNT24:127|                                                                                    ; 6 (6)       ; 4            ; 0           ; 0    ; 0            ; 2 (2)        ; 0 (0)             ; 4 (4)            ; 6 (6)           ; |step_a|CNT24:127                                                                                                                                                                                                                                                                                 ;
;    |CNT8:83|                                                                                      ; 5 (5)       ; 5            ; 0           ; 0    ; 0            ; 0 (0)        ; 0 (0)             ; 5 (5)            ; 5 (5)           ; |step_a|CNT8:83                                                                                                                                                                                                                                                                                   ;
;    |DECD:136|                                                                                     ; 4 (4)       ; 2            ; 0           ; 0    ; 0            ; 2 (2)        ; 2 (2)             ; 0 (0)            ; 0 (0)           ; |step_a|DECD:136                                                                                                                                                                                                                                                                                  ;
;    |Dec2:125|                                                                                     ; 1 (1)       ; 1            ; 0           ; 0    ; 0            ; 0 (0)        ; 1 (1)             ; 0 (0)            ; 0 (0)           ; |step_a|Dec2:125                                                                                                                                                                                                                                                                                  ;
;    |FREQTEST:121|                                                                                 ; 35 (0)      ; 33           ; 0           ; 0    ; 0            ; 2 (0)        ; 17 (0)            ; 16 (0)           ; 17 (0)          ; |step_a|FREQTEST:121                                                                                                                                                                                                                                                                              ;
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