📄 stopwatch.fit.rpt
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; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 40 ;
; -- 3 input functions ; 29 ;
; -- 2 input functions ; 19 ;
; -- 1 input functions ; 1 ;
; -- 0 input functions ; 0 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 89 ;
; -- arithmetic mode ; 0 ;
; -- qfbk mode ; 1 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 3 ;
; -- asynchronous clear/load mode ; 0 ;
; ; ;
; Total LABs ; 11 / 291 ( 4 % ) ;
; Logic elements in carry chains ; 0 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 19 / 104 ( 18 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 3 ;
; M4Ks ; 0 / 13 ( 0 % ) ;
; Total memory bits ; 0 / 59,904 ( 0 % ) ;
; Total RAM block bits ; 0 / 59,904 ( 0 % ) ;
; PLLs ; 0 / 1 ( 0 % ) ;
; Global clocks ; 3 / 8 ( 38 % ) ;
; Maximum fan-out node ; start ;
; Maximum fan-out ; 28 ;
; Highest non-global fan-out signal ; start ;
; Highest non-global fan-out ; 28 ;
; Total fan-out ; 350 ;
; Average fan-out ; 3.18 ;
+---------------------------------------------+--------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; clk ; 17 ; 1 ; 0 ; 7 ; 0 ; 22 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; clk_led ; 122 ; 2 ; 18 ; 14 ; 0 ; 3 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; start ; 71 ; 4 ; 26 ; 0 ; 1 ; 28 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; stop ; 73 ; 3 ; 27 ; 1 ; 1 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+-------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
; bt[0] ; 1 ; 1 ; 0 ; 13 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; bt[1] ; 10 ; 1 ; 0 ; 10 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; bt[2] ; 100 ; 3 ; 27 ; 10 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; bt[3] ; 103 ; 3 ; 27 ; 11 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; bt[4] ; 3 ; 1 ; 0 ; 12 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; bt[5] ; 5 ; 1 ; 0 ; 11 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; bt[6] ; 7 ; 1 ; 0 ; 10 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; bt[7] ; 11 ; 1 ; 0 ; 9 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; sg[0] ; 123 ; 2 ; 18 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; sg[1] ; 130 ; 2 ; 10 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; sg[2] ; 6 ; 1 ; 0 ; 11 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; sg[3] ; 111 ; 2 ; 24 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; sg[4] ; 126 ; 2 ; 16 ; 14 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; sg[5] ; 57 ; 4 ; 16 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
; sg[6] ; 41 ; 4 ; 6 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 10 pF ;
+-------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 10 / 22 ( 45 % ) ; 3.3V ; -- ;
; 2 ; 5 / 28 ( 18 % ) ; 3.3V ; -- ;
; 3 ; 3 / 26 ( 12 % ) ; 3.3V ; -- ;
; 4 ; 3 / 28 ( 11 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+-------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+-------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; 1 ; 0 ; 1 ; bt[0] ; output ; LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 2 ; 1 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 3 ; 2 ; 1 ; bt[4] ; output ; LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 4 ; 3 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 5 ; 4 ; 1 ; bt[5] ; output ; LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 6 ; 5 ; 1 ; sg[2] ; output ; LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 7 ; 6 ; 1 ; bt[6] ; output ; LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 8 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 9 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 10 ; 7 ; 1 ; bt[1] ; output ; LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 11 ; 8 ; 1 ; bt[7] ; output ; LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 12 ; 9 ; 1 ; +~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 13 ; 10 ; 1 ; ^DATA0 ; input ; ; ; -- ; ; -- ; -- ;
; 14 ; 11 ; 1 ; ^nCONFIG ; ; ; ; -- ; ; -- ; -- ;
; 15 ; ; ; VCCA_PLL1 ; power ; ; 1.5V ; -- ; ; -- ; -- ;
; 16 ; 12 ; 1 ; GND+ ; ; ; ; Row I/O ; ; -- ; -- ;
; 17 ; 13 ; 1 ; clk ; input ; LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 18 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 19 ; ; ; GNDG_PLL1 ; gnd ; ; ; -- ; ; -- ; -- ;
; 20 ; 14 ; 1 ; ^nCEO ; ; ; ; -- ; ; -- ; -- ;
; 21 ; 15 ; 1 ; ^nCE ; ; ; ; -- ; ; -- ; -- ;
; 22 ; 16 ; 1 ; ^MSEL0 ; ; ; ; -- ; ; -- ; -- ;
; 23 ; 17 ; 1 ; ^MSEL1 ; ; ; ; -- ; ; -- ; -- ;
; 24 ; 18 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ; -- ; -- ;
; 25 ; 19 ; 1 ; +~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; LVTTL ; ; Row I/O ; N ; no ; Off ;
; 26 ; 20 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 27 ; 21 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 28 ; 22 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 29 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 30 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 31 ; 23 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 32 ; 24 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 33 ; 25 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 34 ; 26 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 35 ; 27 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 36 ; 28 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 37 ; 29 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 38 ; 30 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 39 ; 31 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 40 ; 32 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 41 ; 33 ; 4 ; sg[6] ; output ; LVTTL ; ; Column I/O ; Y ; no ; Off ;
; 42 ; 34 ; 4 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 43 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 44 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
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