de2_lcm_ccd.map.rpt
来自「DE2 CCD数码相机源代码」· RPT 代码 · 共 392 行 · 第 1/5 页
RPT
392 行
; |Mirror_Col:u10| ; 19 (19) ; 11 (11) ; 9600 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Mirror_Col:u10 ;
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; |altsyncram:altsyncram_component| ; 0 (0) ; 0 (0) ; 3200 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Mirror_Col:u10|Stack_RAM:comb_29|altsyncram:altsyncram_component ;
; |altsyncram_v6g1:auto_generated| ; 0 (0) ; 0 (0) ; 3200 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Mirror_Col:u10|Stack_RAM:comb_29|altsyncram:altsyncram_component|altsyncram_v6g1:auto_generated ;
; |Stack_RAM:comb_63| ; 0 (0) ; 0 (0) ; 3200 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Mirror_Col:u10|Stack_RAM:comb_63 ;
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; |altsyncram_v6g1:auto_generated| ; 0 (0) ; 0 (0) ; 3200 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Mirror_Col:u10|Stack_RAM:comb_97|altsyncram:altsyncram_component|altsyncram_v6g1:auto_generated ;
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; |dcfifo:dcfifo_component| ; 60 (0) ; 82 (0) ; 6656 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component ;
; |dcfifo_7lb1:auto_generated| ; 60 (15) ; 82 (27) ; 6656 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated ;
; |a_gray2bin_ccb:wrptr_g_gray2bin| ; 8 (8) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_gray2bin_ccb:wrptr_g_gray2bin ;
; |a_gray2bin_ccb:ws_dgrp_gray2bin| ; 8 (8) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_gray2bin_ccb:ws_dgrp_gray2bin ;
; |a_graycounter_b17:wrptr_g1p| ; 10 (10) ; 10 (10) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_graycounter_b17:wrptr_g1p ;
; |a_graycounter_g86:rdptr_g1p| ; 10 (10) ; 10 (10) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_graycounter_g86:rdptr_g1p ;
; |add_sub_26c:wrusedw_sub| ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|add_sub_26c:wrusedw_sub ;
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; |altsyncram_61u:fifo_ram| ; 0 (0) ; 0 (0) ; 6656 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|altsyncram_61u:fifo_ram ;
; |altsyncram_rv91:altsyncram3| ; 0 (0) ; 0 (0) ; 6656 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|altsyncram_61u:fifo_ram|altsyncram_rv91:altsyncram3 ;
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; |dcfifo:dcfifo_component| ; 62 (0) ; 84 (0) ; 5632 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo2|dcfifo:dcfifo_component ;
; |dcfifo_7lb1:auto_generated| ; 62 (15) ; 84 (29) ; 5632 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo2|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated ;
; |a_gray2bin_ccb:wrptr_g_gray2bin| ; 8 (8) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo2|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_gray2bin_ccb:wrptr_g_gray2bin ;
; |a_gray2bin_ccb:ws_dgrp_gray2bin| ; 8 (8) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo2|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_gray2bin_ccb:ws_dgrp_gray2bin ;
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; |a_graycounter_g86:rdptr_g1p| ; 10 (10) ; 10 (10) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo2|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_graycounter_g86:rdptr_g1p ;
; |add_sub_26c:wrusedw_sub| ; 11 (11) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo2|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|add_sub_26c:wrusedw_sub ;
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; |dffpipe_id9:dffpipe8| ; 0 (0) ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:read_fifo2|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|alt_synch_pipe_nc8:ws_dgrp|dffpipe_id9:dffpipe8 ;
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; |dcfifo:dcfifo_component| ; 60 (0) ; 83 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component ;
; |dcfifo_7lb1:auto_generated| ; 60 (15) ; 83 (27) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated ;
; |a_gray2bin_ccb:rdptr_g_gray2bin| ; 8 (8) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_gray2bin_ccb:rdptr_g_gray2bin ;
; |a_gray2bin_ccb:rs_dgwp_gray2bin| ; 8 (8) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_gray2bin_ccb:rs_dgwp_gray2bin ;
; |a_graycounter_b17:wrptr_g1p| ; 10 (10) ; 10 (10) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_graycounter_b17:wrptr_g1p ;
; |a_graycounter_g86:rdptr_g1p| ; 10 (10) ; 10 (10) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|a_graycounter_g86:rdptr_g1p ;
; |add_sub_26c:rdusedw_sub| ; 9 (9) ; 0 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|add_sub_26c:rdusedw_sub ;
; |alt_synch_pipe_mc8:rs_dgwp| ; 0 (0) ; 9 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|alt_synch_pipe_mc8:rs_dgwp ;
; |dffpipe_hd9:dffpipe6| ; 0 (0) ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|alt_synch_pipe_mc8:rs_dgwp|dffpipe_hd9:dffpipe6 ;
; |alt_synch_pipe_nc8:ws_dgrp| ; 0 (0) ; 9 (0) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|alt_synch_pipe_nc8:ws_dgrp ;
; |dffpipe_id9:dffpipe8| ; 0 (0) ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|alt_synch_pipe_nc8:ws_dgrp|dffpipe_id9:dffpipe8 ;
; |altsyncram_61u:fifo_ram| ; 0 (0) ; 0 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|altsyncram_61u:fifo_ram ;
; |altsyncram_rv91:altsyncram3| ; 0 (0) ; 0 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|altsyncram_61u:fifo_ram|altsyncram_rv91:altsyncram3 ;
; |dffpipe_gd9:rs_brp| ; 0 (0) ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|dffpipe_gd9:rs_brp ;
; |dffpipe_gd9:rs_bwp| ; 0 (0) ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo1|dcfifo:dcfifo_component|dcfifo_7lb1:auto_generated|dffpipe_gd9:rs_bwp ;
; |Sdram_FIFO:write_fifo2| ; 60 (0) ; 85 (0) ; 8192 ; 0 ; 0 ; 0 ; 0 ; 0 ; |DE2_LCM_CCD|Sdram_Control_4Port:u6|Sdram_FIFO:write_fifo2 ⌨️ 快捷键说明
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