📄 led.sim.rpt
字号:
; Coverage Summary ;
+-----------------------------------------------------+--------------+
; Type ; Value ;
+-----------------------------------------------------+--------------+
; Total coverage as a percentage ; 62.91 % ;
; Total nodes checked ; 284 ;
; Total output ports checked ; 302 ;
; Total output ports with complete 1/0-value coverage ; 190 ;
; Total output ports with no 1/0-value coverage ; 106 ;
; Total output ports with no 1-value coverage ; 107 ;
; Total output ports with no 0-value coverage ; 111 ;
+-----------------------------------------------------+--------------+
The following table displays output ports that toggle between 1 and 0 during simulation.
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Complete 1/0-Value Coverage ;
+---------------------------------------------------------------------------+---------------------------------------------------------------------------+------------------+
; Node Name ; Output Port Name ; Output Port Type ;
+---------------------------------------------------------------------------+---------------------------------------------------------------------------+------------------+
; |Led|PBSwitch_flop1 ; |Led|PBSwitch_flop1 ; regout ;
; |Led|PB_PulseOut ; |Led|PB_PulseOut ; out0 ;
; |Led|Led[0] ; |Led|Led[0] ; regout ;
; |Led|count~0 ; |Led|count~0 ; out ;
; |Led|count~1 ; |Led|count~1 ; out ;
; |Led|count~2 ; |Led|count~2 ; out ;
; |Led|count~3 ; |Led|count~3 ; out ;
; |Led|count~4 ; |Led|count~4 ; out ;
; |Led|count~5 ; |Led|count~5 ; out ;
; |Led|count~6 ; |Led|count~6 ; out ;
; |Led|count~7 ; |Led|count~7 ; out ;
; |Led|count~8 ; |Led|count~8 ; out ;
; |Led|count~9 ; |Led|count~9 ; out ;
; |Led|count~10 ; |Led|count~10 ; out ;
; |Led|count~11 ; |Led|count~11 ; out ;
; |Led|count~12 ; |Led|count~12 ; out ;
; |Led|count~13 ; |Led|count~13 ; out ;
; |Led|count~14 ; |Led|count~14 ; out ;
; |Led|count~15 ; |Led|count~15 ; out ;
; |Led|count~16 ; |Led|count~16 ; out ;
; |Led|count~17 ; |Led|count~17 ; out ;
; |Led|count~18 ; |Led|count~18 ; out ;
; |Led|count~19 ; |Led|count~19 ; out ;
; |Led|count~20 ; |Led|count~20 ; out ;
; |Led|count~21 ; |Led|count~21 ; out ;
; |Led|count~22 ; |Led|count~22 ; out ;
; |Led|count~23 ; |Led|count~23 ; out ;
; |Led|count~24 ; |Led|count~24 ; out ;
; |Led|count~25 ; |Led|count~25 ; out ;
; |Led|count~26 ; |Led|count~26 ; out ;
; |Led|count~27 ; |Led|count~27 ; out ;
; |Led|count~28 ; |Led|count~28 ; out ;
; |Led|count~29 ; |Led|count~29 ; out ;
; |Led|count~30 ; |Led|count~30 ; out ;
; |Led|count~31 ; |Led|count~31 ; out ;
; |Led|count~32 ; |Led|count~32 ; out ;
; |Led|count~33 ; |Led|count~33 ; out ;
; |Led|count~34 ; |Led|count~34 ; out ;
; |Led|count~35 ; |Led|count~35 ; out ;
; |Led|count~36 ; |Led|count~36 ; out ;
; |Led|count~37 ; |Led|count~37 ; out ;
; |Led|count~38 ; |Led|count~38 ; out ;
; |Led|count~39 ; |Led|count~39 ; out ;
; |Led|count~40 ; |Led|count~40 ; out ;
; |Led|count~41 ; |Led|count~41 ; out ;
; |Led|count~42 ; |Led|count~42 ; out ;
; |Led|count~43 ; |Led|count~43 ; out ;
; |Led|count~44 ; |Led|count~44 ; out ;
; |Led|count~45 ; |Led|count~45 ; out ;
; |Led|count~46 ; |Led|count~46 ; out ;
; |Led|count~47 ; |Led|count~47 ; out ;
; |Led|PBSwitch_flop2 ; |Led|PBSwitch_flop2 ; regout ;
; |Led|count[1] ; |Led|count[1] ; regout ;
; |Led|PB_valid ; |Led|PB_valid ; out ;
; |Led|count[0] ; |Led|count[0] ; regout ;
; |Led|Led~2 ; |Led|Led~2 ; out ;
; |Led|Led~3 ; |Led|Led~3 ; out ;
; |Led|Led~6 ; |Led|Led~6 ; out ;
; |Led|Led~7 ; |Led|Led~7 ; out ;
; |Led|Led[1] ; |Led|Led[1] ; regout ;
; |Led|clk ; |Led|clk ; out ;
; |Led|reset_b ; |Led|reset_b ; out ;
; |Led|PBSwitch ; |Led|PBSwitch ; out ;
; |Led|Led_inv[0] ; |Led|Led_inv[0] ; pin_out ;
; |Led|Led_inv[1] ; |Led|Led_inv[1] ; pin_out ;
; |Led|Equal0~17 ; |Led|Equal0~17 ; out0 ;
; |Led|Equal1~17 ; |Led|Equal1~17 ; out0 ;
; |Led|lpm_add_sub:Add1|result_node[0] ; |Led|lpm_add_sub:Add1|result_node[0] ; out0 ;
; |Led|lpm_add_sub:Add1|result_node[1] ; |Led|lpm_add_sub:Add1|result_node[1] ; out0 ;
; |Led|lpm_add_sub:Add1|result_node[2] ; |Led|lpm_add_sub:Add1|result_node[2] ; out0 ;
; |Led|lpm_add_sub:Add1|result_node[3] ; |Led|lpm_add_sub:Add1|result_node[3] ; out0 ;
; |Led|lpm_add_sub:Add1|addcore:adder|unreg_res_node[0]~0 ; |Led|lpm_add_sub:Add1|addcore:adder|unreg_res_node[0]~0 ; out0 ;
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