📄 taxt.fit.rpt
字号:
; Configuration scheme ; Active Serial ;
; Error detection CRC ; Off ;
; Reserve all unused pins ; As output driving ground ;
; Base pin-out file on sameframe device ; Off ;
+----------------------------------------------+--------------------------+
+------------------+
; Fitter Equations ;
+------------------+
The equations can be found in E:/study/eda/TAXT/taxt.fit.eqn.
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/study/eda/TAXT/taxt.pin.
+--------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+----------------------+
; Resource ; Usage ;
+---------------------------------------------+----------------------+
; Total logic elements ; 799 / 20,060 ( 3 % ) ;
; -- Combinational with no register ; 725 ;
; -- Register only ; 0 ;
; -- Combinational with a register ; 74 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 153 ;
; -- 3 input functions ; 170 ;
; -- 2 input functions ; 310 ;
; -- 1 input functions ; 166 ;
; -- 0 input functions ; 0 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 505 ;
; -- arithmetic mode ; 294 ;
; -- qfbk mode ; 0 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 26 ;
; -- asynchronous clear/load mode ; 36 ;
; ; ;
; Total LABs ; 95 / 2,006 ( 4 % ) ;
; Logic elements in carry chains ; 389 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 17 / 233 ( 7 % ) ;
; -- Clock pins ; 2 / 2 ( 100 % ) ;
; Global signals ; 8 ;
; M4Ks ; 0 / 64 ( 0 % ) ;
; Total memory bits ; 0 / 294,912 ( 0 % ) ;
; Total RAM block bits ; 0 / 294,912 ( 0 % ) ;
; Global clocks ; 8 / 8 ( 100 % ) ;
; Maximum fan-out node ; start ;
; Maximum fan-out ; 38 ;
; Total fan-out ; 2126 ;
; Average fan-out ; 2.60 ;
+---------------------------------------------+----------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; clk_sp ; J3 ; 1 ; 0 ; 18 ; 2 ; 3 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; clk_zj ; J4 ; 1 ; 0 ; 17 ; 0 ; 4 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; push ; R9 ; 4 ; 28 ; 0 ; 1 ; 29 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
; start ; J15 ; 3 ; 69 ; 18 ; 1 ; 38 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; Fitter ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
; led7s[0] ; C8 ; 2 ; 24 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; led7s[1] ; E7 ; 2 ; 18 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; led7s[2] ; A9 ; 2 ; 26 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; led7s[3] ; B9 ; 2 ; 26 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; led7s[4] ; D8 ; 2 ; 24 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; led7s[5] ; D7 ; 2 ; 14 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; led7s[6] ; U8 ; 4 ; 22 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; site[0] ; E8 ; 2 ; 18 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; site[1] ; A8 ; 2 ; 22 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; site[2] ; E6 ; 2 ; 14 ; 33 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; site[3] ; A7 ; 2 ; 16 ; 33 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; site[4] ; B8 ; 2 ; 22 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; site[5] ; B7 ; 2 ; 16 ; 33 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 4 / 63 ( 6 % ) ; 3.3V ; -- ;
; 2 ; 12 / 53 ( 22 % ) ; 3.3V ; -- ;
; 3 ; 1 / 64 ( 1 % ) ; 3.3V ; -- ;
; 4 ; 2 / 53 ( 3 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+-------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+---------------------+--------+--------------+---------+------------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ;
+----------+------------+----------+---------------------+--------+--------------+---------+------------+-----------------+
; A1 ; ; ; GND ; gnd ; ; ; -- ; ;
; A2 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; A3 ; ; ; GND ; gnd ; ; ; -- ; ;
; A4 ; 310 ; 2 ; GND* ; ; ; ; Column I/O ; ;
; A5 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ;
; A6 ; 304 ; 2 ; GND* ; ; ; ; Column I/O ; ;
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