generale.drc

来自「simple thermometr in vhdl」· DRC 代码 · 共 6 行

DRC
6 行
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WARNING:PhysDesignRules:372 - Gated clock. Clock net
   XLXI_24/XLXI_4/ow_master_i/conv_ok_or0000 is sourced by a combinatorial pin.
   This is not good design practice. Use the CE pin to control the loading of
   data into the flip-flop.DRC detected 0 errors and 1 warnings.

generale.drc - 源码说明

本页面展示了「simple thermometr in vhdl」中的 generale.drc 源码文件，采用 DRC 编程语言编写，共 6 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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