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📄 enll.sim.rpt

📁 DES加密算法的VHDL实现,采用流水线技术实现
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; |ENLL|ri[11]                  ; |ENLL|ri[11]                  ; padout           ;
; |ENLL|ri[12]~input            ; |ENLL|ri[12]~input            ; o                ;
; |ENLL|ri[12]                  ; |ENLL|ri[12]                  ; padout           ;
; |ENLL|ri[13]~input            ; |ENLL|ri[13]~input            ; o                ;
; |ENLL|ri[13]                  ; |ENLL|ri[13]                  ; padout           ;
; |ENLL|ri[14]~input            ; |ENLL|ri[14]~input            ; o                ;
; |ENLL|ri[14]                  ; |ENLL|ri[14]                  ; padout           ;
; |ENLL|ri[15]~input            ; |ENLL|ri[15]~input            ; o                ;
; |ENLL|ri[15]                  ; |ENLL|ri[15]                  ; padout           ;
; |ENLL|ri[16]~input            ; |ENLL|ri[16]~input            ; o                ;
; |ENLL|ri[16]                  ; |ENLL|ri[16]                  ; padout           ;
; |ENLL|ri[17]~input            ; |ENLL|ri[17]~input            ; o                ;
; |ENLL|ri[17]                  ; |ENLL|ri[17]                  ; padout           ;
; |ENLL|ri[18]~input            ; |ENLL|ri[18]~input            ; o                ;
; |ENLL|ri[18]                  ; |ENLL|ri[18]                  ; padout           ;
; |ENLL|ri[19]~input            ; |ENLL|ri[19]~input            ; o                ;
; |ENLL|ri[19]                  ; |ENLL|ri[19]                  ; padout           ;
; |ENLL|ri[20]~input            ; |ENLL|ri[20]~input            ; o                ;
; |ENLL|ri[20]                  ; |ENLL|ri[20]                  ; padout           ;
; |ENLL|ri[21]~input            ; |ENLL|ri[21]~input            ; o                ;
; |ENLL|ri[21]                  ; |ENLL|ri[21]                  ; padout           ;
; |ENLL|ri[22]~input            ; |ENLL|ri[22]~input            ; o                ;
; |ENLL|ri[22]                  ; |ENLL|ri[22]                  ; padout           ;
; |ENLL|ri[23]~input            ; |ENLL|ri[23]~input            ; o                ;
; |ENLL|ri[23]                  ; |ENLL|ri[23]                  ; padout           ;
; |ENLL|ri[24]~input            ; |ENLL|ri[24]~input            ; o                ;
; |ENLL|ri[24]                  ; |ENLL|ri[24]                  ; padout           ;
; |ENLL|ri[25]~input            ; |ENLL|ri[25]~input            ; o                ;
; |ENLL|ri[25]                  ; |ENLL|ri[25]                  ; padout           ;
; |ENLL|ri[26]~input            ; |ENLL|ri[26]~input            ; o                ;
; |ENLL|ri[26]                  ; |ENLL|ri[26]                  ; padout           ;
; |ENLL|ri[27]~input            ; |ENLL|ri[27]~input            ; o                ;
; |ENLL|ri[27]                  ; |ENLL|ri[27]                  ; padout           ;
; |ENLL|ri[28]~input            ; |ENLL|ri[28]~input            ; o                ;
; |ENLL|ri[28]                  ; |ENLL|ri[28]                  ; padout           ;
; |ENLL|ri[29]~input            ; |ENLL|ri[29]~input            ; o                ;
; |ENLL|ri[29]                  ; |ENLL|ri[29]                  ; padout           ;
; |ENLL|ri[30]~input            ; |ENLL|ri[30]~input            ; o                ;
; |ENLL|ri[30]                  ; |ENLL|ri[30]                  ; padout           ;
; |ENLL|ri[31]~input            ; |ENLL|ri[31]~input            ; o                ;
; |ENLL|ri[31]                  ; |ENLL|ri[31]                  ; padout           ;
; |ENLL|ri[32]~input            ; |ENLL|ri[32]~input            ; o                ;
; |ENLL|ri[32]                  ; |ENLL|ri[32]                  ; padout           ;
+-------------------------------+-------------------------------+------------------+


The following table displays output ports that do not toggle to 0 during simulation.
+----------------------------------------------------------------------------------+
; Missing 0-Value Coverage                                                         ;
+-------------------------------+-------------------------------+------------------+
; Node Name                     ; Output Port Name              ; Output Port Type ;
+-------------------------------+-------------------------------+------------------+
; |ENLL|ep_xor_key:inst1|ct[23] ; |ENLL|ep_xor_key:inst1|ct[23] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[22] ; |ENLL|ep_xor_key:inst1|ct[22] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[21] ; |ENLL|ep_xor_key:inst1|ct[21] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[20] ; |ENLL|ep_xor_key:inst1|ct[20] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[24] ; |ENLL|ep_xor_key:inst1|ct[24] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[19] ; |ENLL|ep_xor_key:inst1|ct[19] ; combout          ;
; |ENLL|sbox:inst6|Mux15~36     ; |ENLL|sbox:inst6|Mux15~36     ; combout          ;
; |ENLL|enLxorR:inst4|ln[1]     ; |ENLL|enLxorR:inst4|ln[1]     ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[11] ; |ENLL|ep_xor_key:inst1|ct[11] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[10] ; |ENLL|ep_xor_key:inst1|ct[10] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[9]  ; |ENLL|ep_xor_key:inst1|ct[9]  ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[8]  ; |ENLL|ep_xor_key:inst1|ct[8]  ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[12] ; |ENLL|ep_xor_key:inst1|ct[12] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[7]  ; |ENLL|ep_xor_key:inst1|ct[7]  ; combout          ;
; |ENLL|sbox:inst6|Mux6~33      ; |ENLL|sbox:inst6|Mux6~33      ; combout          ;
; |ENLL|enLxorR:inst4|ln[2]     ; |ENLL|enLxorR:inst4|ln[2]     ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[29] ; |ENLL|ep_xor_key:inst1|ct[29] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[28] ; |ENLL|ep_xor_key:inst1|ct[28] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[27] ; |ENLL|ep_xor_key:inst1|ct[27] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[26] ; |ENLL|ep_xor_key:inst1|ct[26] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[30] ; |ENLL|ep_xor_key:inst1|ct[30] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[25] ; |ENLL|ep_xor_key:inst1|ct[25] ; combout          ;
; |ENLL|sbox:inst6|Mux19~31     ; |ENLL|sbox:inst6|Mux19~31     ; combout          ;
; |ENLL|enLxorR:inst4|ln[3]     ; |ENLL|enLxorR:inst4|ln[3]     ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[35] ; |ENLL|ep_xor_key:inst1|ct[35] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[34] ; |ENLL|ep_xor_key:inst1|ct[34] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[33] ; |ENLL|ep_xor_key:inst1|ct[33] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[32] ; |ENLL|ep_xor_key:inst1|ct[32] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[36] ; |ENLL|ep_xor_key:inst1|ct[36] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[31] ; |ENLL|ep_xor_key:inst1|ct[31] ; combout          ;
; |ENLL|sbox:inst6|Mux20~28     ; |ENLL|sbox:inst6|Mux20~28     ; combout          ;
; |ENLL|enLxorR:inst4|ln[4]     ; |ENLL|enLxorR:inst4|ln[4]     ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[47] ; |ENLL|ep_xor_key:inst1|ct[47] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[46] ; |ENLL|ep_xor_key:inst1|ct[46] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[45] ; |ENLL|ep_xor_key:inst1|ct[45] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[44] ; |ENLL|ep_xor_key:inst1|ct[44] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[48] ; |ENLL|ep_xor_key:inst1|ct[48] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[43] ; |ENLL|ep_xor_key:inst1|ct[43] ; combout          ;
; |ENLL|sbox:inst6|Mux28~32     ; |ENLL|sbox:inst6|Mux28~32     ; combout          ;
; |ENLL|enLxorR:inst4|ln[5]     ; |ENLL|enLxorR:inst4|ln[5]     ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[17] ; |ENLL|ep_xor_key:inst1|ct[17] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[16] ; |ENLL|ep_xor_key:inst1|ct[16] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[15] ; |ENLL|ep_xor_key:inst1|ct[15] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[14] ; |ENLL|ep_xor_key:inst1|ct[14] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[18] ; |ENLL|ep_xor_key:inst1|ct[18] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[13] ; |ENLL|ep_xor_key:inst1|ct[13] ; combout          ;
; |ENLL|sbox:inst6|Mux11~23     ; |ENLL|sbox:inst6|Mux11~23     ; combout          ;
; |ENLL|enLxorR:inst4|ln[6]     ; |ENLL|enLxorR:inst4|ln[6]     ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[41] ; |ENLL|ep_xor_key:inst1|ct[41] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[40] ; |ENLL|ep_xor_key:inst1|ct[40] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[39] ; |ENLL|ep_xor_key:inst1|ct[39] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[38] ; |ENLL|ep_xor_key:inst1|ct[38] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[42] ; |ENLL|ep_xor_key:inst1|ct[42] ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[37] ; |ENLL|ep_xor_key:inst1|ct[37] ; combout          ;
; |ENLL|sbox:inst6|Mux27~29     ; |ENLL|sbox:inst6|Mux27~29     ; combout          ;
; |ENLL|enLxorR:inst4|ln[7]     ; |ENLL|enLxorR:inst4|ln[7]     ; combout          ;
; |ENLL|sbox:inst6|Mux16~37     ; |ENLL|sbox:inst6|Mux16~37     ; combout          ;
; |ENLL|enLxorR:inst4|ln[8]     ; |ENLL|enLxorR:inst4|ln[8]     ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[5]  ; |ENLL|ep_xor_key:inst1|ct[5]  ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[4]  ; |ENLL|ep_xor_key:inst1|ct[4]  ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[3]  ; |ENLL|ep_xor_key:inst1|ct[3]  ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[2]  ; |ENLL|ep_xor_key:inst1|ct[2]  ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[6]  ; |ENLL|ep_xor_key:inst1|ct[6]  ; combout          ;
; |ENLL|ep_xor_key:inst1|ct[1]  ; |ENLL|ep_xor_key:inst1|ct[1]  ; combout          ;
; |ENLL|sbox:inst6|Mux0~30      ; |ENLL|sbox:inst6|Mux0~30      ; combout          ;
; |ENLL|enLxorR:inst4|ln[9]     ; |ENLL|enLxorR:inst4|ln[9]     ; combout          ;
; |ENLL|sbox:inst6|Mux14~37     ; |ENLL|sbox:inst6|Mux14~37     ; combout          ;
; |ENLL|enLxorR:inst4|ln[10]    ; |ENLL|enLxorR:inst4|ln[10]    ; combout          ;
; |ENLL|sbox:inst6|Mux22~27     ; |ENLL|sbox:inst6|Mux22~27     ; combout          ;
; |ENLL|enLxorR:inst4|ln[11]    ; |ENLL|enLxorR:inst4|ln[11]    ; combout          ;
; |ENLL|sbox:inst6|Mux25~32     ; |ENLL|sbox:inst6|Mux25~32     ; combout          ;
; |ENLL|enLxorR:inst4|ln[12]    ; |ENLL|enLxorR:inst4|ln[12]    ; combout          ;
; |ENLL|sbox:inst6|Mux4~24      ; |ENLL|sbox:inst6|Mux4~24      ; combout          ;
; |ENLL|enLxorR:inst4|ln[13]    ; |ENLL|enLxorR:inst4|ln[13]    ; combout          ;
; |ENLL|sbox:inst6|Mux17~27     ; |ENLL|sbox:inst6|Mux17~27     ; combout          ;
; |ENLL|enLxorR:inst4|ln[14]    ; |ENLL|enLxorR:inst4|ln[14]    ; combout          ;
; |ENLL|sbox:inst6|Mux30~29     ; |ENLL|sbox:inst6|Mux30~29     ; combout          ;
; |ENLL|enLxorR:inst4|ln[15]    ; |ENLL|enLxorR:inst4|ln[15]    ; combout          ;
; |ENLL|sbox:inst6|Mux9~29      ; |ENLL|sbox:inst6|Mux9~29      ; combout          ;
; |ENLL|enLxorR:inst4|ln[16]    ; |ENLL|enLxorR:inst4|ln[16]    ; combout          ;
; |ENLL|sbox:inst6|Mux1~34      ; |ENLL|sbox:inst6|Mux1~34      ; combout          ;
; |ENLL|enLxorR:inst4|ln[17]    ; |ENLL|enLxorR:inst4|ln[17]    ; combout          ;
; |ENLL|sbox:inst6|Mux7~27      ; |ENLL|sbox:inst6|Mux7~27      ; combout          ;
; |ENLL|enLxorR:inst4|ln[18]    ; |ENLL|enLxorR:inst4|ln[18]    ; combout          ;
; |ENLL|sbox:inst6|Mux23~28     ; |ENLL|sbox:inst6|Mux23~28     ; combout          ;
; |ENLL|enLxorR:inst4|ln[19]    ; |ENLL|enLxorR:inst4|ln[19]    ; combout          ;
; |ENLL|sbox:inst6|Mux13~36     ; |ENLL|sbox:inst6|Mux13~36     ; combout          ;
; |ENLL|enLxorR:inst4|ln[20]    ; |ENLL|enLxorR:inst4|ln[20]    ; combout          ;
; |ENLL|sbox:inst6|Mux31~32     ; |ENLL|sbox:inst6|Mux31~32     ; combout          ;
; |ENLL|enLxorR:inst4|ln[21]    ; |ENLL|enLxorR:inst4|ln[21]    ; combout          ;
; |ENLL|sbox:inst6|Mux26~30     ; |ENLL|sbox:inst6|Mux26~30     ; combout          ;
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