ram.pin
来自「实现简单CPU功能的源码」· PIN 代码 · 共 128 行
PIN
128 行
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-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
------------------------------------------------------------------------------
------------------------------------------------------------------------------
-- NC : No Connect. This pin has no internal connection to the device.
-- VCC_INT : Dedicated power pin, which MUST be connected to VCC (5.0V).
-- VCC_IO : Dedicated power pin, which MUST be connected to VCC (Refer to
-- the table below for voltage).
-- GND : Dedicated ground pin, which MUST be connected to GND.
-- GND+ : Unused input. This pin should be connected to GND. It may also
-- be connected to a valid signal on the board (low, high, or
-- toggling) if that signal is required for a different revision
-- of the design.
-- GND* : Unused I/O pin. This pin can either be left unconnected or
-- connected to GND. Connecting this pin to GND will improve the
-- device's immunity to noise.
------------------------------------------------------------------------------
Quartus II Version 7.1 Build 156 04/30/2007 SJ Full Version
CHIP "RAM" ASSIGNED TO AN: EPF10K10LC84-3
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
-------------------------------------------------------------------------------------------------------------
address[3] : 1 : input : TTL : : : N
address[0] : 2 : input : TTL : : : N
data[3] : 3 : input : TTL : : : N
VCC_INT : 4 : power : : 5.0V : :
q[12] : 5 : output : TTL : : : N
data[6] : 6 : input : TTL : : : N
address[4] : 7 : input : TTL : : : N
data[15] : 8 : input : TTL : : : N
address[6] : 9 : input : TTL : : : N
address[5] : 10 : input : TTL : : : N
data[13] : 11 : input : TTL : : : N
DATA0 : 12 : input : : : :
DCLK : 13 : bidir : : : :
nCE : 14 : input : : : :
TDI : 15 : input : : : :
GND* : 16 : : : : :
GND* : 17 : : : : :
q[3] : 18 : output : TTL : : : N
q[13] : 19 : output : TTL : : : N
VCC_INT : 20 : power : : 5.0V : :
data[2] : 21 : input : TTL : : : N
q[6] : 22 : output : TTL : : : N
q[0] : 23 : output : TTL : : : N
q[5] : 24 : output : TTL : : : N
GND* : 25 : : : : :
GND_INT : 26 : gnd : : : :
data[7] : 27 : input : TTL : : : N
q[11] : 28 : output : TTL : : : N
data[14] : 29 : input : TTL : : : N
q[8] : 30 : output : TTL : : : N
MSEL0 : 31 : input : : : :
MSEL1 : 32 : input : : : :
VCC_INT : 33 : power : : 5.0V : :
nCONFIG : 34 : input : : : :
data[12] : 35 : input : TTL : : : N
address[7] : 36 : input : TTL : : : N
GND* : 37 : : : : :
q[7] : 38 : output : TTL : : : N
data[5] : 39 : input : TTL : : : N
VCC_INT : 40 : power : : 5.0V : :
GND_INT : 41 : gnd : : : :
address[2] : 42 : input : TTL : : : N
inclock : 43 : input : TTL : : : N
address[1] : 44 : input : TTL : : : N
VCC_INT : 45 : power : : 5.0V : :
GND_INT : 46 : gnd : : : :
GND* : 47 : : : : :
GND* : 48 : : : : :
q[9] : 49 : output : TTL : : : N
q[1] : 50 : output : TTL : : : N
data[1] : 51 : input : TTL : : : N
GND* : 52 : : : : :
GND* : 53 : : : : :
GND* : 54 : : : : :
nSTATUS : 55 : bidir : : : :
TRST : 56 : input : : : :
TMS : 57 : input : : : :
data[9] : 58 : input : TTL : : : N
data[10] : 59 : input : TTL : : : N
q[10] : 60 : output : TTL : : : N
data[11] : 61 : input : TTL : : : N
data[8] : 62 : input : TTL : : : N
VCC_INT : 63 : power : : 5.0V : :
q[15] : 64 : output : TTL : : : N
q[4] : 65 : output : TTL : : : N
data[0] : 66 : input : TTL : : : N
data[4] : 67 : input : TTL : : : N
GND_INT : 68 : gnd : : : :
GND* : 69 : : : : :
GND* : 70 : : : : :
q[2] : 71 : output : TTL : : : N
q[14] : 72 : output : TTL : : : N
GND* : 73 : : : : :
TDO : 74 : output : : : :
nCEO : 75 : output : : : :
CONF_DONE : 76 : bidir : : : :
TCK : 77 : input : : : :
GND* : 78 : : : : :
GND* : 79 : : : : :
GND* : 80 : : : : :
GND* : 81 : : : : :
GND_INT : 82 : gnd : : : :
GND* : 83 : : : : :
we : 84 : input : TTL : : : N
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