cpu.fit.rpt
来自「实现简单CPU功能的源码」· RPT 代码 · 共 698 行 · 第 1/3 页
RPT
698 行
; 24 ; VCC_IO ; ;
; 25 ; VCC_INT ; ;
; 26 ; MUL_OUT[3] ; TTL ;
; 27 ; MUL_in[31] ; TTL ;
; 28 ; MUL_in[3] ; TTL ;
; 29 ; MUL_OUT[15] ; TTL ;
; 30 ; MUL_OUT[13] ; TTL ;
; 31 ; MUL_OUT[0] ; TTL ;
; 32 ; MUL_OUT[14] ; TTL ;
; 33 ; MUL_in[29] ; TTL ;
; 34 ; #TMS ; ;
; 35 ; ^nSTATUS ; ;
; 36 ; GND* ; ;
; 37 ; MUL_in[25] ; TTL ;
; 38 ; MUL_in[8] ; TTL ;
; 39 ; GND* ; ;
; 40 ; GND_IO ; ;
; 41 ; GND* ; ;
; 42 ; GND* ; ;
; 43 ; MUL_in[4] ; TTL ;
; 44 ; MUL_in[27] ; TTL ;
; 45 ; VCC_IO ; ;
; 46 ; C[7] ; TTL ;
; 47 ; GND* ; ;
; 48 ; MUL_in[6] ; TTL ;
; 49 ; GND* ; ;
; 50 ; GND_IO ; ;
; 51 ; GND* ; ;
; 52 ; VCC_INT ; ;
; 53 ; VCC_INT ; ;
; 54 ; MUL_in[0] ; TTL ;
; 55 ; MUL_in[1] ; TTL ;
; 56 ; C[27] ; TTL ;
; 57 ; GND_INT ; ;
; 58 ; GND_INT ; ;
; 59 ; GND* ; ;
; 60 ; C[3] ; TTL ;
; 61 ; VCC_IO ; ;
; 62 ; C[22] ; TTL ;
; 63 ; C[4] ; TTL ;
; 64 ; C[24] ; TTL ;
; 65 ; clk ; TTL ;
; 66 ; GND_IO ; ;
; 67 ; GND* ; ;
; 68 ; C[2] ; TTL ;
; 69 ; C[13] ; TTL ;
; 70 ; GND* ; ;
; 71 ; VCC_IO ; ;
; 72 ; C[21] ; TTL ;
; 73 ; GND* ; ;
; 74 ; ^nCONFIG ; ;
; 75 ; VCC_INT ; ;
; 76 ; ^MSEL1 ; ;
; 77 ; ^MSEL0 ; ;
; 78 ; MUL_in[14] ; TTL ;
; 79 ; MUL_in[30] ; TTL ;
; 80 ; MUL_in[15] ; TTL ;
; 81 ; C[23] ; TTL ;
; 82 ; MUL_in[13] ; TTL ;
; 83 ; MUL_in[19] ; TTL ;
; 84 ; GND_INT ; ;
; 85 ; GND_IO ; ;
; 86 ; MUL_in[2] ; TTL ;
; 87 ; MUL_in[28] ; TTL ;
; 88 ; MUL_in[12] ; TTL ;
; 89 ; GND* ; ;
; 90 ; C[17] ; TTL ;
; 91 ; GND* ; ;
; 92 ; C[14] ; TTL ;
; 93 ; VCC_INT ; ;
; 94 ; VCC_IO ; ;
; 95 ; MUL_in[9] ; TTL ;
; 96 ; MUL_in[7] ; TTL ;
; 97 ; MUL_in[21] ; TTL ;
; 98 ; MUL_in[22] ; TTL ;
; 99 ; MUL_in[23] ; TTL ;
; 100 ; MUL_in[11] ; TTL ;
; 101 ; MUL_in[26] ; TTL ;
; 102 ; MUL_in[5] ; TTL ;
; 103 ; GND_INT ; ;
; 104 ; GND_IO ; ;
; 105 ; #TDI ; ;
; 106 ; ^nCE ; ;
; 107 ; ^DCLK ; ;
; 108 ; ^DATA0 ; ;
; 109 ; C[10] ; TTL ;
; 110 ; C[9] ; TTL ;
; 111 ; C[28] ; TTL ;
; 112 ; C[31] ; TTL ;
; 113 ; GND* ; ;
; 114 ; C[20] ; TTL ;
; 115 ; VCC_IO ; ;
; 116 ; C[11] ; TTL ;
; 117 ; C[29] ; TTL ;
; 118 ; GND* ; ;
; 119 ; C[8] ; TTL ;
; 120 ; GND* ; ;
; 121 ; C[16] ; TTL ;
; 122 ; GND* ; ;
; 123 ; VCC_INT ; ;
; 124 ; MUL_in[16] ; TTL ;
; 125 ; MUL_in[17] ; TTL ;
; 126 ; C[25] ; TTL ;
; 127 ; GND_INT ; ;
; 128 ; MUL_OUT[10] ; TTL ;
; 129 ; GND_IO ; ;
; 130 ; MUL_OUT[11] ; TTL ;
; 131 ; C[12] ; TTL ;
; 132 ; GND* ; ;
; 133 ; MUL_in[10] ; TTL ;
; 134 ; VCC_IO ; ;
; 135 ; C[15] ; TTL ;
; 136 ; GND* ; ;
; 137 ; C[0] ; TTL ;
; 138 ; GND* ; ;
; 139 ; GND_IO ; ;
; 140 ; C[26] ; TTL ;
; 141 ; C[6] ; TTL ;
; 142 ; C[19] ; TTL ;
; 143 ; C[30] ; TTL ;
; 144 ; GND* ; ;
+-------+-------------+--------------+
+---------------------------------------+
; Global & Other Fast Signals ;
+------------+-------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+------------+-------+---------+--------+
; MUL_in[16] ; 124 ; 1 ; no ;
; MUL_in[0] ; 54 ; 1 ; no ;
; C[25] ; 126 ; 17 ; no ;
; C[27] ; 56 ; 1 ; no ;
; MUL_in[17] ; 125 ; 1 ; no ;
; MUL_in[1] ; 55 ; 1 ; no ;
+------------+-------+---------+--------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+---------------------+-----------+
; Name ; Fan-Out ;
+---------------------+-----------+
; C[25] ; 17 ;
; MUL_OUT[15]~82 ; 16 ;
; MUL_OUT[6]$latch~2 ; 2 ;
; MUL_OUT[14]$latch~2 ; 2 ;
; MUL_OUT[13]$latch~2 ; 2 ;
; MUL_OUT[2]$latch~2 ; 2 ;
; MUL_OUT[12]$latch~2 ; 2 ;
; MUL_OUT[5]$latch~2 ; 2 ;
; MUL_OUT[11]$latch~2 ; 2 ;
; MUL_OUT[0]$latch~2 ; 2 ;
; MUL_OUT[1]$latch~2 ; 2 ;
; MUL_OUT[10]$latch~2 ; 2 ;
; MUL_OUT[4]$latch~2 ; 2 ;
; MUL_OUT[9]$latch~2 ; 2 ;
; MUL_OUT[3]$latch~2 ; 2 ;
; MUL_OUT[8]$latch~2 ; 2 ;
; MUL_OUT[7]$latch~2 ; 2 ;
; MUL_OUT[15]$latch~2 ; 2 ;
; MUL_OUT[6]~88 ; 1 ;
; MUL_in[13] ; 1 ;
; MUL_in[15] ; 1 ;
; MUL_in[28] ; 1 ;
; MUL_in[23] ; 1 ;
; MUL_in[6] ; 1 ;
; MUL_in[22] ; 1 ;
; MUL_in[29] ; 1 ;
; MUL_in[21] ; 1 ;
; MUL_in[4] ; 1 ;
; MUL_in[20] ; 1 ;
; MUL_in[10] ; 1 ;
; MUL_in[19] ; 1 ;
; MUL_in[27] ; 1 ;
; MUL_in[18] ; 1 ;
; MUL_in[24] ; 1 ;
; MUL_in[17] ; 1 ;
; C[27] ; 1 ;
; MUL_OUT[11]~93 ; 1 ;
; MUL_in[8] ; 1 ;
; MUL_OUT[9]~91 ; 1 ;
; MUL_in[25] ; 1 ;
; MUL_OUT[5]~87 ; 1 ;
; MUL_OUT[7]~89 ; 1 ;
; MUL_in[11] ; 1 ;
; MUL_OUT[12]~94 ; 1 ;
; MUL_in[30] ; 1 ;
; MUL_OUT[1]~83 ; 1 ;
; MUL_in[14] ; 1 ;
; MUL_OUT[15]~97 ; 1 ;
; MUL_in[26] ; 1 ;
; MUL_OUT[13]~95 ; 1 ;
+---------------------+-----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 67 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 1 ;
; 5 ; 0 ;
; 6 ; 1 ;
; 7 ; 1 ;
; 8 ; 2 ;
+--------------------------+----------------+
+----------------------------------------------+
; Local Routing Interconnect ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+
; 0 ; 67 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 1 ;
; 5 ; 0 ;
; 6 ; 1 ;
; 7 ; 1 ;
; 8 ; 2 ;
+-----------------------------+----------------+
+---------------------------------------------+
; LAB External Interconnect ;
+----------------------------+----------------+
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