📄 de2_board.fit.rpt
字号:
; Total LABs ; 114 / 2,076 ( 5 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 36 / 475 ( 8 % ) ;
; -- Clock pins ; 1 / 8 ( 13 % ) ;
; Global signals ; 6 ;
; M4Ks ; 46 / 105 ( 44 % ) ;
; Total memory bits ; 177,152 / 483,840 ( 37 % ) ;
; Total RAM block bits ; 211,968 / 483,840 ( 44 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ;
; PLLs ; 0 / 4 ( 0 % ) ;
; Global clocks ; 6 / 16 ( 38 % ) ;
; Maximum fan-out node ; CLOCK_50~clkctrl ;
; Maximum fan-out ; 752 ;
; Highest non-global fan-out signal ; DE2_Board:inst|jtag_uart_0_avalon_jtag_slave_arbitrator:the_jtag_uart_0_avalon_jtag_slave|cpu_0_data_master_requests_jtag_uart_0_avalon_jtag_slave ;
; Highest non-global fan-out ; 53 ;
; Total fan-out ; 8713 ;
; Average fan-out ; 3.73 ;
+---------------------------------------------+----------------------------------------------------------------------------------------------------------------------------------------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; CLOCK_50 ; N2 ; 2 ; 0 ; 18 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; KEY[0] ; G26 ; 5 ; 65 ; 27 ; 1 ; 11 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; FL_ADDR[0] ; AC18 ; 7 ; 48 ; 0 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[10] ; AE17 ; 7 ; 44 ; 0 ; 2 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[11] ; AF17 ; 7 ; 44 ; 0 ; 3 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[12] ; W16 ; 7 ; 42 ; 0 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[13] ; W15 ; 7 ; 42 ; 0 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[14] ; AC16 ; 7 ; 42 ; 0 ; 2 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[15] ; AD16 ; 7 ; 42 ; 0 ; 3 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[16] ; AE16 ; 7 ; 40 ; 0 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[17] ; AC15 ; 7 ; 40 ; 0 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[18] ; AB15 ; 7 ; 40 ; 0 ; 2 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[19] ; AA15 ; 7 ; 40 ; 0 ; 3 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[1] ; AB18 ; 7 ; 48 ; 0 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[20] ; Y15 ; 7 ; 37 ; 0 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[21] ; Y14 ; 7 ; 37 ; 0 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[2] ; AE19 ; 7 ; 48 ; 0 ; 2 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[3] ; AF19 ; 7 ; 48 ; 0 ; 3 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[4] ; AE18 ; 7 ; 46 ; 0 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[5] ; AF18 ; 7 ; 46 ; 0 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[6] ; Y16 ; 7 ; 46 ; 0 ; 2 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[7] ; AA16 ; 7 ; 46 ; 0 ; 3 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[8] ; AD17 ; 7 ; 44 ; 0 ; 0 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_ADDR[9] ; AC17 ; 7 ; 44 ; 0 ; 1 ; yes ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_CE_N ; V17 ; 7 ; 50 ; 0 ; 2 ; yes ; no ; yes ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_OE_N ; W17 ; 7 ; 50 ; 0 ; 3 ; yes ; no ; yes ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_RST_N ; AA18 ; 7 ; 50 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_WE_N ; AA17 ; 7 ; 50 ; 0 ; 1 ; yes ; no ; yes ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Bidir Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; FL_DQ[0] ; AD19 ; 7 ; 53 ; 0 ; 3 ; 0 ; 8 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_DQ[1] ; AC19 ; 7 ; 53 ; 0 ; 2 ; 0 ; 8 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_DQ[2] ; AF20 ; 7 ; 53 ; 0 ; 1 ; 0 ; 8 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_DQ[3] ; AE20 ; 7 ; 53 ; 0 ; 0 ; 0 ; 8 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_DQ[4] ; AB20 ; 7 ; 55 ; 0 ; 3 ; 0 ; 8 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; FL_DQ[5] ; AC20 ; 7 ; 55 ; 0 ; 2 ; 0 ; 8 ; no ; yes ; yes ; yes ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
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