📄 control1.tan.rpt
字号:
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[6] ; control:inst|DATA[13] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[6] ; control:inst|DATA[12] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; 74175:inst1|15 ; control:inst|DATA[11] ; CLK ; CLK ; None ; None ; 11.400 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[8] ; control:inst|DATA[11] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; 74175:inst1|15 ; control:inst|DATA[10] ; CLK ; CLK ; None ; None ; 11.400 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[8] ; control:inst|DATA[10] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; 74175:inst1|15 ; control:inst|DATA[9] ; CLK ; CLK ; None ; None ; 11.400 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[8] ; control:inst|DATA[9] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[12] ; control:inst|DATA[8] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[12] ; control:inst|DATA[7] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[12] ; control:inst|DATA[6] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[12] ; control:inst|DATA[5] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[12] ; control:inst|DATA[4] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[3] ; control:inst|DATA[3] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[3] ; control:inst|DATA[2] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[3] ; control:inst|DATA[1] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 56.82 MHz ( period = 17.600 ns ) ; control:inst|i[3] ; control:inst|DATA[0] ; CLK ; CLK ; None ; None ; 16.600 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[0] ; control:inst|DATA[8] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[13] ; control:inst|DATA[8] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[0] ; control:inst|DATA[7] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[13] ; control:inst|DATA[7] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[0] ; control:inst|DATA[6] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[13] ; control:inst|DATA[6] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[0] ; control:inst|DATA[5] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[13] ; control:inst|DATA[5] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[0] ; control:inst|DATA[4] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[13] ; control:inst|DATA[4] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[6] ; control:inst|DATA[3] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[6] ; control:inst|DATA[2] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; N/A ; 57.14 MHz ( period = 17.500 ns ) ; control:inst|i[6] ; control:inst|DATA[1] ; CLK ; CLK ; None ; None ; 16.500 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+--------------------+-----------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Hold: 'CLK' ;
+------------------------------------------+----------------+-----------------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Minimum Slack ; From ; To ; From Clock ; To Clock ; Required Hold Relationship ; Required Shortest P2P Time ; Actual Shortest P2P Time ;
+------------------------------------------+----------------+-----------------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Not operational: Clock Skew > Data Delay ; 74175:inst1|16 ; control:inst|DATA[8] ; CLK ; CLK ; None ; None ; 2.000 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|13 ; control:inst|DATA[23] ; CLK ; CLK ; None ; None ; 2.600 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|15 ; control:inst|DATA[21] ; CLK ; CLK ; None ; None ; 2.600 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|13 ; control:inst|DATA[11] ; CLK ; CLK ; None ; None ; 2.600 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|15 ; control:inst|DATA[9] ; CLK ; CLK ; None ; None ; 2.600 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|13 ; control:inst|DATA[7] ; CLK ; CLK ; None ; None ; 2.600 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|15 ; control:inst|DATA[5] ; CLK ; CLK ; None ; None ; 2.600 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|14 ; control:inst|DATA[22] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|16 ; control:inst|DATA[20] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|13 ; control:inst|DATA[19] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|14 ; control:inst|DATA[18] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|16 ; control:inst|DATA[16] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|14 ; control:inst|DATA[14] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|16 ; control:inst|DATA[12] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|14 ; control:inst|DATA[10] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|14 ; control:inst|DATA[6] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|16 ; control:inst|DATA[4] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|13 ; control:inst|DATA[3] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|14 ; control:inst|DATA[2] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|16 ; control:inst|DATA[0] ; CLK ; CLK ; None ; None ; 2.700 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|15 ; control:inst|DATA[17] ; CLK ; CLK ; None ; None ; 2.800 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|15 ; control:inst|DATA[1] ; CLK ; CLK ; None ; None ; 2.800 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|13 ; control:inst|DATA[15] ; CLK ; CLK ; None ; None ; 2.900 ns ;
; Not operational: Clock Skew > Data Delay ; 74175:inst1|15 ; control:inst|DATA[13] ; CLK ; CLK ; None ; None ; 2.900 ns ;
; Not operational: Clock Skew > Data De⌨️ 快捷键说明
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