jsq.tan.rpt
来自「TI公司的TLC5510的用VHDL写的控制器及其仿真」· RPT 代码 · 共 440 行 · 第 1/5 页
RPT
440 行
; N/A ; 222.97 MHz ( period = 4.485 ns ) ; DATA[8] ; DATA[1] ; CLK ; CLK ; None ; None ; 4.221 ns ;
; N/A ; 222.97 MHz ( period = 4.485 ns ) ; DATA[8] ; DATA[2] ; CLK ; CLK ; None ; None ; 4.221 ns ;
; N/A ; 222.97 MHz ( period = 4.485 ns ) ; DATA[8] ; DATA[4] ; CLK ; CLK ; None ; None ; 4.221 ns ;
; N/A ; 222.97 MHz ( period = 4.485 ns ) ; DATA[8] ; DATA[3] ; CLK ; CLK ; None ; None ; 4.221 ns ;
; N/A ; 222.97 MHz ( period = 4.485 ns ) ; DATA[8] ; DATA[5] ; CLK ; CLK ; None ; None ; 4.221 ns ;
; N/A ; 222.97 MHz ( period = 4.485 ns ) ; DATA[8] ; DATA[7] ; CLK ; CLK ; None ; None ; 4.221 ns ;
; N/A ; 222.97 MHz ( period = 4.485 ns ) ; DATA[8] ; DATA[8] ; CLK ; CLK ; None ; None ; 4.221 ns ;
; N/A ; 222.97 MHz ( period = 4.485 ns ) ; DATA[8] ; DATA[6] ; CLK ; CLK ; None ; None ; 4.221 ns ;
; N/A ; 222.97 MHz ( period = 4.485 ns ) ; DATA[2] ; OUT1~reg0 ; CLK ; CLK ; None ; None ; 4.221 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[0] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[13] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[15] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[14] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[10] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[11] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[9] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[12] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[1] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[2] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[4] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[3] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[5] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[7] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[8] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 223.02 MHz ( period = 4.484 ns ) ; DATA[3] ; DATA[6] ; CLK ; CLK ; None ; None ; 4.220 ns ;
; N/A ; 228.68 MHz ( period = 4.373 ns ) ; DATA[11] ; OUT1~reg0 ; CLK ; CLK ; None ; None ; 4.109 ns ;
; N/A ; 230.79 MHz ( period = 4.333 ns ) ; DATA[5] ; OUT1~reg0 ; CLK ; CLK ; None ; None ; 4.069 ns ;
; N/A ; 241.43 MHz ( period = 4.142 ns ) ; DATA[1] ; OUT1~reg0 ; CLK ; CLK ; None ; None ; 3.878 ns ;
; N/A ; 247.59 MHz ( period = 4.039 ns ) ; DATA[12] ; OUT1~reg0 ; CLK ; CLK ; None ; None ; 3.775 ns ;
; N/A ; 252.27 MHz ( period = 3.964 ns ) ; DATA[4] ; OUT1~reg0 ; CLK ; CLK ; None ; None ; 3.700 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+----------+-----------+------------+----------+-----------------------------+---------------------------+-------------------------+
+-----------------------------------------------------------------+
; tsu ;
+-------+--------------+------------+------+-----------+----------+
; Slack ; Required tsu ; Actual tsu ; From ; To ; To Clock ;
+-------+--------------+------------+------+-----------+----------+
; N/A ; None ; 6.743 ns ; EN ; DATA[0] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[13] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[15] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[14] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[10] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[11] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[9] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[12] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[1] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[2] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[4] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[3] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[5] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[7] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[8] ; CLK ;
; N/A ; None ; 6.743 ns ; EN ; DATA[6] ; CLK ;
; N/A ; None ; 5.785 ns ; EN ; OUT1~reg0 ; CLK ;
; N/A ; None ; 1.028 ns ; CLR ; OUT1~reg0 ; CLK ;
+-------+--------------+------------+------+-----------+----------+
+-------------------------------------------------------------------------+
; tco ;
+-------+--------------+------------+-----------+------------+------------+
; Slack ; Required tco ; Actual tco ; From ; To ; From Clock ;
+-------+--------------+------------+-----------+------------+------------+
; N/A ; None ; 9.257 ns ; DATA[7] ; INDATA[7] ; CLK ;
; N/A ; None ; 9.197 ns ; DATA[4] ; INDATA[4] ; CLK ;
; N/A ; None ; 9.128 ns ; DATA[13] ; INDATA[13] ; CLK ;
; N/A ; None ; 8.742 ns ; DATA[10] ; INDATA[10] ; CLK ;
; N/A ; None ; 8.708 ns ; DATA[8] ; INDATA[8] ; CLK ;
; N/A ; None ; 8.687 ns ; DATA[1] ; INDATA[1] ; CLK ;
; N/A ; None ; 8.597 ns ; DATA[11] ; INDATA[11] ; CLK ;
; N/A ; None ; 8.573 ns ; DATA[5] ; INDATA[5] ; CLK ;
; N/A ; None ; 8.501 ns ; DATA[2] ; INDATA[2] ; CLK ;
; N/A ; None ; 8.490 ns ; DATA[14] ; INDATA[14] ; CLK ;
; N/A ; None ; 8.264 ns ; DATA[12] ; INDATA[12] ; CLK ;
; N/A ; None ; 8.225 ns ; DATA[9] ; INDATA[9] ; CLK ;
; N/A ; None ; 8.196 ns ; DATA[0] ; INDATA[0] ; CLK ;
; N/A ; None ; 8.150 ns ; DATA[15] ; INDATA[15] ; CLK ;
; N/A ; None ; 8.147 ns ; DATA[3] ; INDATA[3] ; CLK ;
; N/A ; None ; 8.145 ns ; OUT1~reg0 ; OUT1 ; CLK ;
; N/A ; None ; 7.768 ns ; DATA[6] ; INDATA[6] ; CLK ;
+-------+--------------+------------+-----------+------------+------------+
+-----------------------------------------------------------------------+
; th ;
+---------------+-------------+-----------+------+-----------+----------+
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