📄 send_test.fit.rpt
字号:
; Pin-Out File ;
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The pin-out file can be found in G:/我的文档/uart/altera_uart/send_test/send_test.pin.
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; Fitter Resource Usage Summary ;
+---------------------------------------------+----------------------+
; Resource ; Usage ;
+---------------------------------------------+----------------------+
; Total logic elements ; 28 / 4,608 ( < 1 % ) ;
; -- Combinational with no register ; 6 ;
; -- Register only ; 0 ;
; -- Combinational with a register ; 22 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 8 ;
; -- 3 input functions ; 4 ;
; -- <=2 input functions ; 16 ;
; -- Register only ; 0 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 13 ;
; -- arithmetic mode ; 15 ;
; ; ;
; Total registers* ; 22 / 4,851 ( < 1 % ) ;
; -- Dedicated logic registers ; 22 / 4,608 ( < 1 % ) ;
; -- I/O registers ; 0 / 243 ( 0 % ) ;
; ; ;
; Total LABs: partially or completely used ; 2 / 288 ( < 1 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 12 / 89 ( 13 % ) ;
; -- Clock pins ; 2 / 4 ( 50 % ) ;
; Global signals ; 1 ;
; M4Ks ; 0 / 26 ( 0 % ) ;
; Total memory bits ; 0 / 119,808 ( 0 % ) ;
; Total RAM block bits ; 0 / 119,808 ( 0 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 26 ( 0 % ) ;
; PLLs ; 0 / 2 ( 0 % ) ;
; Global clocks ; 1 / 8 ( 13 % ) ;
; Average interconnect usage ; 0% ;
; Peak interconnect usage ; 0% ;
; Maximum fan-out node ; clk~clkctrl ;
; Maximum fan-out ; 22 ;
; Highest non-global fan-out signal ; Equal0~75 ;
; Highest non-global fan-out ; 17 ;
; Total fan-out ; 137 ;
; Average fan-out ; 2.08 ;
+---------------------------------------------+----------------------+
* Register count does not include registers inside RAM blocks or DSP blocks.
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; Input Pins ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; TxD_data[0] ; 143 ; 2 ; 1 ; 14 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; TxD_data[1] ; 43 ; 4 ; 3 ; 0 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; TxD_data[2] ; 125 ; 2 ; 14 ; 14 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; TxD_data[3] ; 18 ; 1 ; 0 ; 6 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; TxD_data[4] ; 21 ; 1 ; 0 ; 6 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; TxD_data[5] ; 22 ; 1 ; 0 ; 6 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; TxD_data[6] ; 118 ; 2 ; 21 ; 14 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; TxD_data[7] ; 113 ; 2 ; 26 ; 14 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; TxD_start ; 31 ; 1 ; 0 ; 2 ; 3 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; clk ; 17 ; 1 ; 0 ; 6 ; 0 ; 1 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; TxD ; 67 ; 4 ; 24 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; User ; 0 pF ;
; TxD_busy ; 32 ; 1 ; 0 ; 2 ; 4 ; no ; no ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
+----------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
+-----------------------------------------------------------+
; I/O Bank Usage ;
+----------+-----------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+-----------------+---------------+--------------+
; 1 ; 8 / 19 ( 42 % ) ; 3.3V ; -- ;
; 2 ; 4 / 23 ( 17 % ) ; 3.3V ; -- ;
; 3 ; 1 / 23 ( 4 % ) ; 3.3V ; -- ;
; 4 ; 2 / 24 ( 8 % ) ; 3.3V ; -- ;
+----------+-----------------+---------------+--------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ; Bus Hold ; Weak Pull Up ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
; 1 ; 0 ; 1 ; ~ASDO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; On ;
; 2 ; 1 ; 1 ; ~nCSO~ / RESERVED_INPUT_WITH_WEAK_PULLUP ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; On ;
; 3 ; 2 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 4 ; 3 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 5 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 6 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 7 ; 10 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 8 ; 11 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 9 ; 12 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 10 ; 13 ; 1 ; #TDO ; output ; ; ; -- ; ; -- ; -- ;
; 11 ; 14 ; 1 ; #TMS ; input ; ; ; -- ; ; -- ; -- ;
; 12 ; 15 ; 1 ; #TCK ; input ; ; ; -- ; ; -- ; -- ;
; 13 ; 16 ; 1 ; #TDI ; input ; ; ; -- ; ; -- ; -- ;
; 14 ; 17 ; 1 ; ^DATA0 ; input ; ; ; -- ; ; -- ; -- ;
; 15 ; 18 ; 1 ; ^DCLK ; ; ; ; -- ; ; -- ; -- ;
; 16 ; 19 ; 1 ; ^nCE ; ; ; ; -- ; ; -- ; -- ;
; 17 ; 20 ; 1 ; clk ; input ; 3.3-V LVTTL ; ; Row I/O ; Y ; no ; Off ;
; 18 ; 21 ; 1 ; TxD_data[3] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 19 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 20 ; 22 ; 1 ; ^nCONFIG ; ; ; ; -- ; ; -- ; -- ;
; 21 ; 23 ; 1 ; TxD_data[4] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 22 ; 24 ; 1 ; TxD_data[5] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 23 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 24 ; 25 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 25 ; 26 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 26 ; 27 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 27 ; 28 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 28 ; 32 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 29 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 30 ; 40 ; 1 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 31 ; 41 ; 1 ; TxD_start ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
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