📄 efcount.fit.rpt
字号:
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; Slow Slew Rate ; Off ; Off ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers -- Cyclone ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Perform Physical Synthesis for Combinational Logic for Performance ; Off ; Off ;
; Perform Register Duplication for Performance ; Off ; Off ;
; Perform Register Retiming for Performance ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Logic Cell Insertion - Logic Duplication ; Auto ; Auto ;
; Auto Register Duplication ; Auto ; Auto ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Stop After Congestion Map Generation ; Off ; Off ;
; Save Intermediate Fitting Results ; Off ; Off ;
+--------------------------------------------------------------------+--------------------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/Quartus 2/quartus/a_Quar Projects/efcount/efcount.pin.
+----------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+------------------------+
; Resource ; Usage ;
+---------------------------------------------+------------------------+
; Total logic elements ; 117 / 12,060 ( < 1 % ) ;
; -- Combinational with no register ; 47 ;
; -- Register only ; 0 ;
; -- Combinational with a register ; 70 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 33 ;
; -- 3 input functions ; 10 ;
; -- 2 input functions ; 69 ;
; -- 1 input functions ; 0 ;
; -- 0 input functions ; 5 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 57 ;
; -- arithmetic mode ; 60 ;
; -- qfbk mode ; 1 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 1 ;
; -- asynchronous clear/load mode ; 70 ;
; ; ;
; Total registers ; 70 / 12,603 ( < 1 % ) ;
; Total LABs ; 17 / 1,206 ( 1 % ) ;
; Logic elements in carry chains ; 62 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 19 / 185 ( 10 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; Global signals ; 4 ;
; M4Ks ; 0 / 52 ( 0 % ) ;
; Total memory bits ; 0 / 239,616 ( 0 % ) ;
; Total RAM block bits ; 0 / 239,616 ( 0 % ) ;
; PLLs ; 0 / 2 ( 0 % ) ;
; Global clocks ; 4 / 8 ( 50 % ) ;
; Average interconnect usage ; 0% ;
; Peak interconnect usage ; 1% ;
; Maximum fan-out node ; CLR ;
; Maximum fan-out ; 68 ;
; Highest non-global fan-out signal ; efcount:b2v_inst1|ena ;
; Highest non-global fan-out ; 33 ;
; Total fan-out ; 552 ;
; Average fan-out ; 4.00 ;
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+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
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; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; BCLK ; H1 ; 1 ; 0 ; 14 ; 0 ; 32 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; CL ; J1 ; 1 ; 0 ; 11 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; CLR ; G1 ; 1 ; 0 ; 15 ; 2 ; 68 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; PA ; F2 ; 1 ; 0 ; 21 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; PB ; F1 ; 1 ; 0 ; 20 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; SEL[0] ; H5 ; 1 ; 0 ; 16 ; 0 ; 24 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; SEL[1] ; C6 ; 2 ; 10 ; 27 ; 0 ; 24 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; SEL[2] ; E6 ; 2 ; 8 ; 27 ; 0 ; 8 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; SPUL ; M5 ; 4 ; 8 ; 0 ; 1 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
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