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📁 运用VHDL语言实现四位超前进位加法器。
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请注意:

	第78例到第89例是一个芯片完整描述的各个部分,但是

	它们的源描述所使用的包的源描述超过了演示版限制的300行,

	目前不能进行编译与模拟,

	如果您需要对其进行编译与模拟,请与北京理工大学

	ASIC研究所联系,获取Talent系统的完全版本.



	联系方法:

		电话:010-68912434

		信函:北京理工大学ASIC研究所 刘明业 教授收

		邮编:100081

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