📄 uart_regs.fit.rpt
字号:
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+-----------+--------------+------------------+-------------+----------------------+
+-----------------------------------------------------------+
; I/O Bank Usage ;
+------------------------------------------------------------
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+-----------------+---------------+--------------+
; 1 ; 6 / 39 ( 15 % ) ; 3.3V ; -- ;
; 2 ; 2 / 39 ( 5 % ) ; 3.3V ; -- ;
; 3 ; 2 / 43 ( 4 % ) ; 3.3V ; -- ;
; 4 ; 7 / 45 ( 15 % ) ; 3.3V ; -- ;
; 5 ; 0 / 39 ( 0 % ) ; 3.3V ; -- ;
; 6 ; 3 / 39 ( 7 % ) ; 3.3V ; -- ;
; 7 ; 6 / 45 ( 13 % ) ; 3.3V ; -- ;
; 8 ; 1 / 44 ( 2 % ) ; 3.3V ; -- ;
; 9 ; 0 / 6 ( 0 % ) ; 3.3V ; -- ;
; 11 ; 1 / 6 ( 16 % ) ; 3.3V ; -- ;
+----------+-----------------+---------------+--------------+
+------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+-------------------------------------------------------------------------------------------------------------------
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; I/O Standard ; Voltage ; I/O Type ; Termination ;
+----------+------------+----------+---------------------------+--------------+---------+------------+-------------+
; A2 ; ; 1 ; GND ; ; ; -- ; -- ;
; A3 ; 451 ; 3 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; A4 ; ; 3 ; VCCIO3 ; ; 3.3V ; -- ; -- ;
; A5 ; 444 ; 3 ; int_o ; LVTTL ; ; Column I/O ; Off ;
; A6 ; 438 ; 3 ; mc_cs3 ; LVTTL ; ; Column I/O ; Off ;
; A7 ; 430 ; 3 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; A8 ; 429 ; 3 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; A9 ; 427 ; 3 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; A10 ; 416 ; 3 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; A11 ; ; 3 ; VCCIO3 ; ; 3.3V ; -- ; -- ;
; A12 ; 407 ; 3 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; A13 ; ; 1 ; GND ; ; ; -- ; -- ;
; A14 ; ; 1 ; GND ; ; ; -- ; -- ;
; A15 ; 391 ; 4 ; clk ; LVTTL ; ; Column I/O ; Off ;
; A16 ; ; 4 ; VCCIO4 ; ; 3.3V ; -- ; -- ;
; A17 ; 371 ; 4 ; srx_pad_i ; LVTTL ; ; Column I/O ; Off ;
; A18 ; ; 1 ; NC ; ; ; -- ; -- ;
; A19 ; 355 ; 4 ; stx_pad_o ; LVTTL ; ; Column I/O ; Off ;
; A20 ; 351 ; 4 ; wb_addr_i[0] ; LVTTL ; ; Column I/O ; Off ;
; A21 ; 346 ; 4 ; wb_addr_i[1] ; LVTTL ; ; Column I/O ; Off ;
; A22 ; 338 ; 4 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; A23 ; ; 4 ; VCCIO4 ; ; 3.3V ; -- ; -- ;
; A24 ; 337 ; 4 ; wb_addr_i[2] ; LVTTL ; ; Column I/O ; Off ;
; A25 ; ; 1 ; GND ; ; ; -- ; -- ;
; AA1 ; 89 ; 1 ; wb_dat_i[0] ; LVTTL ; ; Row I/O ; Off ;
; AA2 ; 88 ; 1 ; wb_dat_i[1] ; LVTTL ; ; Row I/O ; Off ;
; AA3 ; 91 ; 1 ; wb_dat_i[2] ; LVTTL ; ; Row I/O ; Off ;
; AA4 ; 90 ; 1 ; wb_dat_i[5] ; LVTTL ; ; Row I/O ; Off ;
; AA5 ; 86 ; 1 ; wb_dat_i[4] ; LVTTL ; ; Row I/O ; Off ;
; AA6 ; 85 ; 1 ; wb_dat_i[6] ; LVTTL ; ; Row I/O ; Off ;
; AA7 ; 116 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA8 ; 128 ; 8 ; wb_dat_i[7] ; LVTTL ; ; Column I/O ; Off ;
; AA9 ; 134 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA10 ; 139 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA11 ; 148 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA12 ; 163 ; 11 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA13 ; 167 ; 11 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA14 ; 165 ; 11 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA15 ; 177 ; 7 ; ^nIO_PULLUP ; ; ; -- ; -- ;
; AA16 ; ; 1 ; NC ; ; ; -- ; -- ;
; AA17 ; 191 ; 7 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA18 ; 196 ; 7 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA19 ; 203 ; 7 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA20 ; 208 ; 7 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA21 ; 213 ; 7 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AA22 ; 243 ; 6 ; RESERVED_INPUT ; ; ; Row I/O ; -- ;
; AA23 ; 239 ; 6 ; RESERVED_INPUT ; ; ; Row I/O ; -- ;
; AA24 ; 238 ; 6 ; RESERVED_INPUT ; ; ; Row I/O ; -- ;
; AA25 ; 241 ; 6 ; RESERVED_INPUT ; ; ; Row I/O ; -- ;
; AA26 ; 240 ; 6 ; wb_dat_i[3] ; LVTTL ; ; Row I/O ; Off ;
; AB1 ; ; 1 ; NC ; ; ; -- ; -- ;
; AB2 ; ; 1 ; NC ; ; ; -- ; -- ;
; AB3 ; 95 ; 1 ; RESERVED_INPUT ; ; ; Row I/O ; -- ;
; AB4 ; 94 ; 1 ; RESERVED_INPUT ; ; ; Row I/O ; -- ;
; AB5 ; 108 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AB6 ; ; 1 ; NC ; ; ; -- ; -- ;
; AB7 ; 113 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AB8 ; ; 1 ; NC ; ; ; -- ; -- ;
; AB9 ; 136 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AB10 ; 141 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AB11 ; 143 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AB12 ; 162 ; 11 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AB13 ; 166 ; 11 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AB14 ; 164 ; 11 ; wb_dat_o[3] ; LVTTL ; ; Column I/O ; Off ;
; AB15 ; 186 ; 7 ; GND ; ; ; -- ; -- ;
; AB16 ; 184 ; 7 ; wb_dat_o[0] ; LVTTL ; ; Column I/O ; Off ;
; AB17 ; 195 ; 7 ; wb_dat_o[1] ; LVTTL ; ; Column I/O ; Off ;
; AB18 ; 217 ; 7 ; GND ; ; ; -- ; -- ;
; AB19 ; 204 ; 7 ; wb_dat_o[2] ; LVTTL ; ; Column I/O ; Off ;
; AB20 ; 210 ; 7 ; wb_dat_o[4] ; LVTTL ; ; Column I/O ; Off ;
; AB21 ; 229 ; 7 ; wb_dat_o[5] ; LVTTL ; ; Column I/O ; Off ;
; AB22 ; 224 ; 7 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AB23 ; 235 ; 6 ; wb_dat_o[6] ; LVTTL ; ; Row I/O ; Off ;
; AB24 ; 234 ; 6 ; wb_dat_o[7] ; LVTTL ; ; Row I/O ; Off ;
; AB25 ; ; 1 ; NC ; ; ; -- ; -- ;
; AB26 ; ; 1 ; NC ; ; ; -- ; -- ;
; AC1 ; ; 1 ; VCCIO1 ; ; 3.3V ; -- ; -- ;
; AC2 ; 96 ; 1 ; RESERVED_INPUT ; ; ; Row I/O ; -- ;
; AC3 ; 99 ; 1 ; RESERVED_INPUT ; ; ; Row I/O ; -- ;
; AC4 ; 98 ; 1 ; RESERVED_INPUT ; ; ; Row I/O ; -- ;
; AC5 ; ; 1 ; NC ; ; ; -- ; -- ;
; AC6 ; ; 1 ; NC ; ; ; -- ; -- ;
; AC7 ; 107 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AC8 ; ; 1 ; NC ; ; ; -- ; -- ;
; AC9 ; 130 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AC10 ; 137 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
; AC11 ; 146 ; 8 ; RESERVED_INPUT ; ; ; Column I/O ; -- ;
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