📄 sram.fit.rpt
字号:
; 101 ; 150 ; 3 ; rdaddress[11] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 102 ; ; 3 ; VCCIO3 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 103 ; 153 ; 3 ; GND* ; ; ; ; Row I/O ; ; no ; Off ;
; 104 ; 154 ; 3 ; rdaddress[4] ; input ; 3.3-V LVTTL ; ; Row I/O ; N ; no ; Off ;
; 105 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 106 ; ; ; GND_PLL2 ; gnd ; ; ; -- ; ; -- ; -- ;
; 107 ; ; ; VCCD_PLL2 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 108 ; ; ; GND_PLL2 ; gnd ; ; ; -- ; ; -- ; -- ;
; 109 ; ; ; VCCA_PLL2 ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 110 ; ; ; GNDA_PLL2 ; gnd ; ; ; -- ; ; -- ; -- ;
; 111 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 112 ; 155 ; 2 ; q[9] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 113 ; 156 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 114 ; 157 ; 2 ; data[8] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 115 ; 158 ; 2 ; data[15] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 116 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 117 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 118 ; 161 ; 2 ; q[15] ; output ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 119 ; 162 ; 2 ; wraddress[7] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 120 ; 163 ; 2 ; rdaddress[10] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 121 ; 164 ; 2 ; data[14] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 122 ; 165 ; 2 ; rdaddress[0] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 123 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 124 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 125 ; 173 ; 2 ; rdaddress[8] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 126 ; 174 ; 2 ; rdaddress[5] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 127 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 128 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 129 ; 180 ; 2 ; wraddress[8] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 130 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 131 ; ; ; VCCINT ; power ; ; 1.2V ; -- ; ; -- ; -- ;
; 132 ; 185 ; 2 ; data[4] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 133 ; 186 ; 2 ; wraddress[3] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 134 ; 187 ; 2 ; wraddress[4] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 135 ; 195 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 136 ; 196 ; 2 ; data[12] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 137 ; 197 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 138 ; ; 2 ; VCCIO2 ; power ; ; 3.3V ; -- ; ; -- ; -- ;
; 139 ; 198 ; 2 ; data[9] ; input ; 3.3-V LVTTL ; ; Column I/O ; N ; no ; Off ;
; 140 ; ; ; GND ; gnd ; ; ; -- ; ; -- ; -- ;
; 141 ; 199 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 142 ; 200 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 143 ; 201 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
; 144 ; 202 ; 2 ; GND* ; ; ; ; Column I/O ; ; no ; Off ;
+----------+------------+----------+------------------------------------------+--------+--------------+---------+------------+-----------------+----------+--------------+
Note: Pin directions (input, output or bidir) are based on device operating in user mode.
+-------------------------------------------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+----------------------------------+-------+------------------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+----------------------------------+-------+------------------------------------+
; 3.3-V LVTTL ; 0 pF ; Not Available ;
; 3.3-V LVCMOS ; 0 pF ; Not Available ;
; 2.5 V ; 0 pF ; Not Available ;
; 1.8 V ; 0 pF ; Not Available ;
; 1.5 V ; 0 pF ; Not Available ;
; 3.3-V PCI ; 10 pF ; 25 Ohm (Parallel) ;
; 3.3-V PCI-X ; 10 pF ; 25 Ohm (Parallel) ;
; SSTL-2 Class I ; 0 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-2 Class II ; 0 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-18 Class I ; 0 pF ; 50 Ohm (Parallel), 25 Ohm (Serial) ;
; SSTL-18 Class II ; 0 pF ; 25 Ohm (Parallel), 25 Ohm (Serial) ;
; 1.5-V HSTL Class I ; 0 pF ; 50 Ohm (Parallel) ;
; 1.5-V HSTL Class II ; 0 pF ; 25 Ohm (Parallel) ;
; 1.8-V HSTL Class I ; 0 pF ; 50 Ohm (Parallel) ;
; 1.8-V HSTL Class II ; 0 pF ; 25 Ohm (Parallel) ;
; Differential SSTL-2 ; 0 pF ; (See SSTL-2) ;
; Differential 2.5-V SSTL Class II ; 0 pF ; (See SSTL-2 Class II) ;
; Differential 1.8-V SSTL Class I ; 0 pF ; (See 1.8-V SSTL Class I) ;
; Differential 1.8-V SSTL Class II ; 0 pF ; (See 1.8-V SSTL Class II) ;
; Differential 1.5-V HSTL Class I ; 0 pF ; (See 1.5-V HSTL Class I) ;
; Differential 1.5-V HSTL Class II ; 0 pF ; (See 1.5-V HSTL Class II) ;
; Differential 1.8-V HSTL Class I ; 0 pF ; (See 1.8-V HSTL Class I) ;
; Differential 1.8-V HSTL Class II ; 0 pF ; (See 1.8-V HSTL Class II) ;
; LVDS ; 0 pF ; 100 Ohm (Differential) ;
; mini-LVDS ; 0 pF ; 100 Ohm (Differential) ;
; RSDS ; 0 pF ; 100 Ohm (Differential) ;
; Simple RSDS ; 0 pF ; Not Available ;
; Differential LVPECL ; 0 pF ; 100 Ohm (Differential) ;
+----------------------------------+-------+------------------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+----------------------------------------------------------------------------------------------------------------------+--------------+
; Compilation Hierarchy Node ; Logic Cells ; Dedicated Logic Registers ; I/O Registers ; Memory Bits ; M4Ks ; DSP Elements ; DSP 9x9 ; DSP 18x18 ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Full Hierarchy Name ; Library Name ;
+----------------------------------------+-------------+---------------------------+---------------+-------------+------+--------------+---------+-----------+------+--------------+--------------+-------------------+------------------+----------------------------------------------------------------------------------------------------------------------+--------------+
; |sram ; 21 (0) ; 2 (0) ; 0 (0) ; 131072 ; 32 ; 0 ; 0 ; 0 ; 62 ; 0 ; 19 (0) ; 1 (0) ; 1 (0) ; |sram ; work ;
; |altsyncram:altsyncram_component| ; 21 (0) ; 2 (0) ; 0 (0) ; 131072 ; 32 ⌨️ 快捷键说明
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