📄 ds_fh.fit.rpt
字号:
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Aggressive Routability Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; PCI I/O ; Off ; Off ;
; Weak Pull-Up Resistor ; Off ; Off ;
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers -- Stratix II/III/Cyclone II/III ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Ignore PLL Mode When Merging PLLs ; Off ; Off ;
; Perform Physical Synthesis for Combinational Logic ; Off ; Off ;
; Perform Register Duplication ; Off ; Off ;
; Perform Register Retiming ; Off ; Off ;
; Perform Asynchronous Signal Pipelining ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Stop After Congestion Map Generation ; Off ; Off ;
; Use smart compilation ; Off ; Off ;
+--------------------------------------------------------+--------------------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/Quartus/DS_FH/DS_FH.pin.
+------------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+--------------------------------+
; Resource ; Usage ;
+---------------------------------------------+--------------------------------+
; Total logic elements ; 976 / 8,256 ( 12 % ) ;
; -- Combinational with no register ; 299 ;
; -- Register only ; 257 ;
; -- Combinational with a register ; 420 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 286 ;
; -- 3 input functions ; 156 ;
; -- <=2 input functions ; 277 ;
; -- Register only ; 257 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 601 ;
; -- arithmetic mode ; 118 ;
; ; ;
; Total registers* ; 677 / 8,646 ( 8 % ) ;
; -- Dedicated logic registers ; 677 / 8,256 ( 8 % ) ;
; -- I/O registers ; 0 / 390 ( 0 % ) ;
; ; ;
; Total LABs: partially or completely used ; 76 / 516 ( 15 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 38 / 138 ( 28 % ) ;
; -- Clock pins ; 1 / 4 ( 25 % ) ;
; Global signals ; 8 ;
; M4Ks ; 2 / 36 ( 6 % ) ;
; Total memory bits ; 5,120 / 165,888 ( 3 % ) ;
; Total RAM block bits ; 9,216 / 165,888 ( 6 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 36 ( 0 % ) ;
; PLLs ; 0 / 2 ( 0 % ) ;
; Global clocks ; 8 / 8 ( 100 % ) ;
; Average interconnect usage ; 1% ;
; Peak interconnect usage ; 3% ;
; Maximum fan-out node ; sys_clk~clkctrl ;
; Maximum fan-out ; 390 ;
; Highest non-global fan-out signal ; mux_hopset:inst7|hopset[4]~522 ;
; Highest non-global fan-out ; 90 ;
; Total fan-out ; 4752 ;
; Average fan-out ; 2.88 ;
+---------------------------------------------+--------------------------------+
* Register count does not include registers inside RAM blocks or DSP blocks.
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; ALE ; 60 ; 4 ; 3 ; 0 ; 2 ; 8 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; P0[0] ; 76 ; 4 ; 18 ; 0 ; 1 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; P0[1] ; 75 ; 4 ; 16 ; 0 ; 0 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; P0[2] ; 74 ; 4 ; 16 ; 0 ; 1 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; P0[3] ; 72 ; 4 ; 16 ; 0 ; 2 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; P0[4] ; 70 ; 4 ; 14 ; 0 ; 0 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; P0[5] ; 69 ; 4 ; 12 ; 0 ; 0 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; P0[6] ; 68 ; 4 ; 12 ; 0 ; 1 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; P0[7] ; 67 ; 4 ; 9 ; 0 ; 0 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; P26 ; 61 ; 4 ; 3 ; 0 ; 1 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; WR ; 63 ; 4 ; 3 ; 0 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; User ;
; sys_clk ; 23 ; 1 ; 0 ; 9 ; 0 ; 2 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
; sys_reset ; 24 ; 1 ; 0 ; 9 ; 1 ; 1 ; 0 ; yes ; no ; no ; no ; no ; Off ; 3.3-V LVTTL ; Off ; Fitter ;
+-----------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
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