vhdl code7.vhd

来自「d flip flop t flip flop counter mux usin」· VHDL 代码 · 共 2 行

VHD
2 行
字号 
library ieee;use ieee.std_logic_1164.all; entity MUX is	port(		A: in std_logic;		B: in std_logic;		S: in std_logic;		Z: out std_logic	);end MUX; architecture main of MUX isbegin	with S select Z <= A when '0', B when '1';end main;

vhdl code7.vhd - 源码说明

本页面展示了「d flip flop t flip flop counter mux using active hdl can be run using 3.2 version and creating new d」中的 vhdl code7.vhd 源码文件，采用 VHDL 编程语言编写，共 2 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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