📄 dds.sim.rpt
字号:
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Memory report data cannot be output to ASCII.
Please use Quartus II to view the memory report data.
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; |dds|rom_cose:cose1|altsyncram:altsyncram_component|altsyncram_2571:auto_generated|ALTSYNCRAM ;
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; Coverage Summary ;
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; Type ; Value ;
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; Total coverage as a percentage ; 66.57 % ;
; Total nodes checked ; 359 ;
; Total output ports checked ; 359 ;
; Total output ports with complete 1/0-value coverage ; 239 ;
; Total output ports with no 1/0-value coverage ; 109 ;
; Total output ports with no 1-value coverage ; 110 ;
; Total output ports with no 0-value coverage ; 119 ;
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The following table displays output ports that toggle between 1 and 0 during simulation.
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; Complete 1/0-Value Coverage ;
+--------------------------------------------------------------------------------------------------+--------------------------------------------------------------------------------------------+------------------+
; Node Name ; Output Port Name ; Output Port Type ;
+--------------------------------------------------------------------------------------------------+--------------------------------------------------------------------------------------------+------------------+
; |dds|ADD_B~0 ; |dds|ADD_B~0 ; out ;
; |dds|ADD_B~1 ; |dds|ADD_B~1 ; out ;
; |dds|ADD_B~2 ; |dds|ADD_B~2 ; out ;
; |dds|ADD_B~3 ; |dds|ADD_B~3 ; out ;
; |dds|ADD_B~4 ; |dds|ADD_B~4 ; out ;
; |dds|ADD_B~5 ; |dds|ADD_B~5 ; out ;
; |dds|ADD_B~6 ; |dds|ADD_B~6 ; out ;
; |dds|ADD_B~7 ; |dds|ADD_B~7 ; out ;
; |dds|ADD_B~8 ; |dds|ADD_B~8 ; out ;
; |dds|ADD_B~9 ; |dds|ADD_B~9 ; out ;
; |dds|ADD_B[31] ; |dds|ADD_B[31] ; regout ;
; |dds|ADD_B[30] ; |dds|ADD_B[30] ; regout ;
; |dds|ADD_B[29] ; |dds|ADD_B[29] ; regout ;
; |dds|ADD_B[28] ; |dds|ADD_B[28] ; regout ;
; |dds|ADD_B[27] ; |dds|ADD_B[27] ; regout ;
; |dds|ADD_B[26] ; |dds|ADD_B[26] ; regout ;
; |dds|ADD_B[25] ; |dds|ADD_B[25] ; regout ;
; |dds|ADD_B[24] ; |dds|ADD_B[24] ; regout ;
; |dds|ADD_B[23] ; |dds|ADD_B[23] ; regout ;
; |dds|ADD_B[22] ; |dds|ADD_B[22] ; regout ;
; |dds|ADD_B[18] ; |dds|ADD_B[18] ; regout ;
; |dds|ADD_B[17] ; |dds|ADD_B[17] ; regout ;
; |dds|ADD_B[16] ; |dds|ADD_B[16] ; regout ;
; |dds|ADD_B[15] ; |dds|ADD_B[15] ; regout ;
; |dds|ADD_B[14] ; |dds|ADD_B[14] ; regout ;
; |dds|ADD_B[13] ; |dds|ADD_B[13] ; regout ;
; |dds|ADD_B[12] ; |dds|ADD_B[12] ; regout ;
; |dds|ADD_B[11] ; |dds|ADD_B[11] ; regout ;
; |dds|ADD_B[10] ; |dds|ADD_B[10] ; regout ;
; |dds|ADD_B[9] ; |dds|ADD_B[9] ; regout ;
; |dds|ADD_B[8] ; |dds|ADD_B[8] ; regout ;
; |dds|ADD_B[7] ; |dds|ADD_B[7] ; regout ;
; |dds|ADD_B[6] ; |dds|ADD_B[6] ; regout ;
; |dds|ADD_B[5] ; |dds|ADD_B[5] ; regout ;
; |dds|ADD_B[4] ; |dds|ADD_B[4] ; regout ;
; |dds|ADD_B[3] ; |dds|ADD_B[3] ; regout ;
; |dds|ADD_B[2] ; |dds|ADD_B[2] ; regout ;
; |dds|ADD_B[1] ; |dds|ADD_B[1] ; regout ;
; |dds|ADD_B[0] ; |dds|ADD_B[0] ; regout ;
; |dds|cose_DR[15] ; |dds|cose_DR[15] ; regout ;
; |dds|cose_DR[14] ; |dds|cose_DR[14] ; regout ;
; |dds|cose_DR[13] ; |dds|cose_DR[13] ; regout ;
; |dds|cose_DR[12] ; |dds|cose_DR[12] ; regout ;
; |dds|cose_DR[11] ; |dds|cose_DR[11] ; regout ;
; |dds|cose_DR[10] ; |dds|cose_DR[10] ; regout ;
; |dds|cose_DR[9] ; |dds|cose_DR[9] ; regout ;
; |dds|cose_DR[8] ; |dds|cose_DR[8] ; regout ;
; |dds|cose_DR[7] ; |dds|cose_DR[7] ; regout ;
; |dds|cose_DR[6] ; |dds|cose_DR[6] ; regout ;
; |dds|cose_DR[5] ; |dds|cose_DR[5] ; regout ;
; |dds|cose_DR[4] ; |dds|cose_DR[4] ; regout ;
; |dds|cose_DR[3] ; |dds|cose_DR[3] ; regout ;
; |dds|cose_DR[2] ; |dds|cose_DR[2] ; regout ;
; |dds|cose_DR[1] ; |dds|cose_DR[1] ; regout ;
; |dds|cose_DR[0] ; |dds|cose_DR[0] ; regout ;
; |dds|sine_DR[15] ; |dds|sine_DR[15] ; regout ;
; |dds|sine_DR[14] ; |dds|sine_DR[14] ; regout ;
; |dds|sine_DR[13] ; |dds|sine_DR[13] ; regout ;
; |dds|sine_DR[12] ; |dds|sine_DR[12] ; regout ;
; |dds|sine_DR[11] ; |dds|sine_DR[11] ; regout ;
; |dds|sine_DR[10] ; |dds|sine_DR[10] ; regout ;
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