run.scs

来自「phase frequency detector verilog」· SCS 代码 · 共 3 行

SCS
3 行
字号 
*transient tran stop=1ms

run.scs - 源码说明

本页面展示了「phase frequency detector verilog」中的 run.scs 源码文件，采用 SCS 编程语言编写，共 3 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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