📄 de2_top.fit.rpt
字号:
; -- Combinational with a register ; 493 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 434 ;
; -- 3 input functions ; 103 ;
; -- <=2 input functions ; 205 ;
; -- Register only ; 316 ;
; -- Combinational cells for routing ; 238 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 605 ;
; -- arithmetic mode ; 137 ;
; ; ;
; Total registers ; 809 / 33,216 ( 2 % ) ;
; Total LABs ; 113 / 2,076 ( 5 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 425 / 475 ( 89 % ) ;
; -- Clock pins ; 8 / 8 ( 100 % ) ;
; Global signals ; 15 ;
; M4Ks ; 12 / 105 ( 11 % ) ;
; Total memory bits ; 46,080 / 483,840 ( 10 % ) ;
; Total RAM block bits ; 55,296 / 483,840 ( 11 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ;
; PLLs ; 0 / 4 ( 0 % ) ;
; Global clocks ; 15 / 16 ( 94 % ) ;
; Maximum fan-out node ; CLOCK_27~clkctrl ;
; Maximum fan-out ; 372 ;
; Highest non-global fan-out signal ; sld_signaltap:auto_signaltap_0|sld_ela_control:ela_control|trigger_setup_ena ;
; Highest non-global fan-out ; 154 ;
; Total fan-out ; 5561 ;
; Average fan-out ; 2.47 ;
+---------------------------------------------+------------------------------------------------------------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; AUD_ADCDAT ; B5 ; 3 ; 3 ; 36 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; CLOCK_27 ; D13 ; 3 ; 31 ; 36 ; 3 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; CLOCK_50 ; N2 ; 2 ; 0 ; 18 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; ENET_INT ; B21 ; 4 ; 59 ; 36 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; EXT_CLOCK ; P26 ; 6 ; 65 ; 19 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; IRDA_RXD ; AE25 ; 6 ; 65 ; 2 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; KEY[0] ; G26 ; 5 ; 65 ; 27 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; KEY[1] ; N23 ; 5 ; 65 ; 20 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; KEY[2] ; P23 ; 6 ; 65 ; 18 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; KEY[3] ; W26 ; 6 ; 65 ; 10 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; OTG_DREQ0 ; F6 ; 2 ; 0 ; 33 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; OTG_DREQ1 ; E5 ; 2 ; 0 ; 34 ; 4 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; OTG_INT0 ; B3 ; 2 ; 0 ; 34 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; OTG_INT1 ; C3 ; 2 ; 0 ; 33 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; PS2_CLK ; D26 ; 5 ; 65 ; 31 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; PS2_DAT ; C24 ; 5 ; 65 ; 32 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[0] ; N25 ; 5 ; 65 ; 19 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[10] ; N1 ; 2 ; 0 ; 18 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[11] ; P1 ; 1 ; 0 ; 18 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[12] ; P2 ; 1 ; 0 ; 18 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[13] ; T7 ; 1 ; 0 ; 11 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[14] ; U3 ; 1 ; 0 ; 12 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[15] ; U4 ; 1 ; 0 ; 12 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[16] ; V1 ; 1 ; 0 ; 12 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[17] ; V2 ; 1 ; 0 ; 12 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[1] ; N26 ; 5 ; 65 ; 19 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[2] ; P25 ; 6 ; 65 ; 19 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[3] ; AE14 ; 7 ; 33 ; 0 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[4] ; AF14 ; 7 ; 33 ; 0 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[5] ; AD13 ; 8 ; 33 ; 0 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[6] ; AC13 ; 8 ; 33 ; 0 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[7] ; C13 ; 3 ; 31 ; 36 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[8] ; B13 ; 4 ; 31 ; 36 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SW[9] ; A13 ; 4 ; 31 ; 36 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
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