📄 traffic_light.fit.rpt
字号:
The equations can be found in E:/CPLD/Program/VHDL/traffic_light/traffic_light.fit.eqn.
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/CPLD/Program/VHDL/traffic_light/traffic_light.pin.
+--------------------------------------------------------+
; Fitter Resource Usage Summary ;
+-----------------------------------+--------------------+
; Resource ; Usage ;
+-----------------------------------+--------------------+
; Logic cells ; 117 / 128 ( 91 % ) ;
; Registers ; 99 / 128 ( 77 % ) ;
; Number of pterms used ; 372 ;
; User inserted logic elements ; 0 ;
; I/O pins ; 27 / 68 ( 40 % ) ;
; -- Clock pins ; 1 / 2 ( 50 % ) ;
; -- Dedicated input pins ; 0 / 2 ( 0 % ) ;
; Global signals ; 1 ;
; Shareable expanders ; 8 / 128 ( 6 % ) ;
; Parallel expanders ; 17 / 120 ( 14 % ) ;
; Cells using turbo bit ; 117 / 128 ( 91 % ) ;
; Maximum fan-out node ; frequency:inst4|4 ;
; Maximum fan-out ; 52 ;
; Highest non-global fan-out signal ; frequency:inst4|4 ;
; Highest non-global fan-out ; 52 ;
; Total fan-out ; 584 ;
; Average fan-out ; 3.84 ;
+-----------------------------------+--------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; I/O Standard ; Location assigned by ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; clk4m ; 83 ; -- ; -- ; 1 ; 0 ; yes ; no ; TTL ; User ;
; hold ; 18 ; -- ; 2 ; 34 ; 0 ; no ; no ; TTL ; User ;
; reset ; 16 ; -- ; 2 ; 7 ; 0 ; no ; no ; TTL ; User ;
+-------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+------------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ; Load ;
+------------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
; clk1k ; 17 ; -- ; 2 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; clkl ; 12 ; -- ; 1 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; dp ; 64 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; greena ; 34 ; -- ; 4 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; greenb ; 41 ; -- ; 4 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; leddisp[0] ; 45 ; -- ; 5 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; leddisp[1] ; 51 ; -- ; 5 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; leddisp[2] ; 56 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; leddisp[3] ; 58 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; leddisp[4] ; 60 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; leddisp[5] ; 49 ; -- ; 5 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; leddisp[6] ; 54 ; -- ; 6 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; reda ; 24 ; -- ; 3 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; redb ; 35 ; -- ; 4 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; sel[0] ; 69 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; sel[1] ; 70 ; -- ; 7 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; sel[2] ; 74 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; sel[3] ; 75 ; -- ; 8 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; yellowa ; 30 ; -- ; 3 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
; yellowb ; 37 ; -- ; 4 ; no ; no ; no ; no ; TTL ; User ; Unspecified ;
+------------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
+-------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; 1 ; 0 ; -- ; GND+ ; ; ; ; ;
; 2 ; 1 ; -- ; GND+ ; ; ; ; ;
; 3 ; 2 ; -- ; VCCINT ; power ; ; 5.0V ; ;
; 4 ; 3 ; -- ; RESERVED ; ; ; ; ;
; 5 ; 4 ; -- ; RESERVED ; ; ; ; ;
; 6 ; 5 ; -- ; RESERVED ; ; ; ; ;
; 7 ; 6 ; -- ; GND ; gnd ; ; ; ;
; 8 ; 7 ; -- ; RESERVED ; ; ; ; ;
; 9 ; 8 ; -- ; RESERVED ; ; ; ; ;
; 10 ; 9 ; -- ; RESERVED ; ; ; ; ;
; 11 ; 10 ; -- ; RESERVED ; ; ; ; ;
; 12 ; 11 ; -- ; clkl ; output ; TTL ; ; Y ;
; 13 ; 12 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 14 ; 13 ; -- ; +TDI ; input ; TTL ; ; N ;
; 15 ; 14 ; -- ; RESERVED ; ; ; ; ;
; 16 ; 15 ; -- ; reset ; input ; TTL ; ; Y ;
; 17 ; 16 ; -- ; clk1k ; output ; TTL ; ; Y ;
; 18 ; 17 ; -- ; hold ; input ; TTL ; ; Y ;
; 19 ; 18 ; -- ; GND ; gnd ; ; ; ;
; 20 ; 19 ; -- ; RESERVED ; ; ; ; ;
; 21 ; 20 ; -- ; RESERVED ; ; ; ; ;
; 22 ; 21 ; -- ; RESERVED ; ; ; ; ;
; 23 ; 22 ; -- ; +TMS ; input ; TTL ; ; N ;
; 24 ; 23 ; -- ; reda ; output ; TTL ; ; Y ;
; 25 ; 24 ; -- ; RESERVED ; ; ; ; ;
; 26 ; 25 ; -- ; VCCIO ; power ; ; 5.0V ; ;
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