📄 dianzhen.pin
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--
-- This is a Quartus II output file. It is for reporting purposes only, and is
-- not intended for use as a Quartus II input file. This file cannot be used
-- to make Quartus II pin assignments - for instructions on how to make pin
-- assignments, please see Quartus II help.
---------------------------------------------------------------------------------
---------------------------------------------------------------------------------
-- NC : No Connect. This pin has no internal connection to the device.
-- VCCINT : Dedicated power pin, which MUST be connected to VCC (3.3V).
-- VCCIO : Dedicated power pin, which MUST be connected to VCC
-- of its bank.
-- Bank 1: 3.3V
-- Bank 2: 3.3V
-- GND : Dedicated ground pin. Dedicated GND pins MUST be connected to GND.
-- It can also be used to report unused dedicated pins. The connection
-- on the board for unused dedicated pins depends on whether this will
-- be used in a future design. One example is device migration. When
-- using device migration, refer to the device pin-tables. If it is a
-- GND pin in the pin table or if it will not be used in a future design
-- for another purpose the it MUST be connected to GND. If it is an unused
-- dedicated pin, then it can be connected to a valid signal on the board
-- (low, high, or toggling) if that signal is required for a different
-- revision of the design.
-- GND+ : Unused input pin. It can also be used to report unused dual-purpose pins.
-- This pin should be connected to GND. It may also be connected to a
-- valid signal on the board (low, high, or toggling) if that signal
-- is required for a different revision of the design.
-- GND* : Unused I/O pin. This pin can either be left unconnected or
-- connected to GND. Connecting this pin to GND will improve the
-- device's immunity to noise.
---------------------------------------------------------------------------------
Quartus II Version 4.1 Build 181 06/29/2004 SJ Full Version
CHIP "dianzhen" ASSIGNED TO AN: EPM240T100C3
Pin Name/Usage : Location : Dir. : I/O Standard : Voltage : I/O Bank : User Assignment
-------------------------------------------------------------------------------------------------------------
GND* : 1 : : : : 2 :
GND* : 2 : : : : 1 :
q[4] : 3 : output : LVTTL : : 1 : N
GND* : 4 : : : : 1 :
q[3] : 5 : output : LVTTL : : 1 : N
GND* : 6 : : : : 1 :
GND* : 7 : : : : 1 :
clk1 : 8 : output : LVTTL : : 1 : N
VCCIO1 : 9 : power : : 3.3V : 1 :
GNDIO : 10 : gnd : : : 1 :
GNDINT : 11 : gnd : : : 1 :
statebutton : 12 : input : LVTTL : : 1 : N
VCCINT : 13 : power : : 3.3V : :
clk : 14 : input : LVTTL : : 1 : N
GND* : 15 : : : : 1 :
GND* : 16 : : : : 1 :
GND* : 17 : : : : 1 :
clk2 : 18 : output : LVTTL : : 1 : N
GND* : 19 : : : : 1 :
col[0] : 20 : output : LVTTL : : 1 : N
GND* : 21 : : : : 1 :
TMS : 22 : input : : : 1 :
TDI : 23 : input : : : 1 :
TCK : 24 : input : : : 1 :
TDO : 25 : output : : : 1 :
GND* : 26 : : : : 1 :
GND* : 27 : : : : 1 :
GND* : 28 : : : : 1 :
GND* : 29 : : : : 1 :
GND* : 30 : : : : 1 :
VCCIO1 : 31 : power : : 3.3V : 1 :
GNDIO : 32 : gnd : : : 1 :
GND* : 33 : : : : 1 :
clk3 : 34 : output : LVTTL : : 1 : N
row[7] : 35 : output : LVTTL : : 1 : N
voice : 36 : output : LVTTL : : 1 : N
col[5] : 37 : output : LVTTL : : 1 : N
col[1] : 38 : output : LVTTL : : 1 : N
col[2] : 39 : output : LVTTL : : 1 : N
q1[0] : 40 : output : LVTTL : : 1 : N
q1[3] : 41 : output : LVTTL : : 1 : N
q1[2] : 42 : output : LVTTL : : 1 : N
press[2] : 43 : output : LVTTL : : 1 : N
q1[1] : 44 : output : LVTTL : : 1 : N
VCCIO1 : 45 : power : : 3.3V : 1 :
GNDIO : 46 : gnd : : : 1 :
press[0] : 47 : output : LVTTL : : 1 : N
press[3] : 48 : output : LVTTL : : 1 : N
col[3] : 49 : output : LVTTL : : 1 : N
countbutton : 50 : input : LVTTL : : 1 : N
row[4] : 51 : output : LVTTL : : 1 : N
row[1] : 52 : output : LVTTL : : 2 : N
GND* : 53 : : : : 2 :
GND* : 54 : : : : 2 :
GND* : 55 : : : : 2 :
col[4] : 56 : output : LVTTL : : 2 : N
press[1] : 57 : output : LVTTL : : 2 : N
row[2] : 58 : output : LVTTL : : 2 : N
VCCIO2 : 59 : power : : 3.3V : 2 :
GNDIO : 60 : gnd : : : 1 :
row[5] : 61 : output : LVTTL : : 2 : N
row[6] : 62 : output : LVTTL : : 2 : N
VCCINT : 63 : power : : 3.3V : :
row[0] : 64 : output : LVTTL : : 2 : N
GNDINT : 65 : gnd : : : 1 :
GND* : 66 : : : : 2 :
GND* : 67 : : : : 2 :
col[6] : 68 : output : LVTTL : : 2 : N
GND* : 69 : : : : 2 :
GND* : 70 : : : : 2 :
col[7] : 71 : output : LVTTL : : 2 : N
GND* : 72 : : : : 2 :
GND* : 73 : : : : 2 :
GND* : 74 : : : : 2 :
row[3] : 75 : output : LVTTL : : 2 : N
GND* : 76 : : : : 2 :
GND* : 77 : : : : 2 :
GND* : 78 : : : : 2 :
GNDIO : 79 : gnd : : : 1 :
VCCIO2 : 80 : power : : 3.3V : 2 :
q[0] : 81 : output : LVTTL : : 2 : N
q[1] : 82 : output : LVTTL : : 2 : N
q[6] : 83 : output : LVTTL : : 2 : N
q[7] : 84 : output : LVTTL : : 2 : N
GND* : 85 : : : : 2 :
GND* : 86 : : : : 2 :
GND* : 87 : : : : 2 :
clk4 : 88 : output : LVTTL : : 2 : N
GND* : 89 : : : : 2 :
GND* : 90 : : : : 2 :
GND* : 91 : : : : 2 :
GND* : 92 : : : : 2 :
GNDIO : 93 : gnd : : : 1 :
VCCIO2 : 94 : power : : 3.3V : 2 :
GND* : 95 : : : : 2 :
GND* : 96 : : : : 2 :
GND* : 97 : : : : 2 :
GND* : 98 : : : : 2 :
q[2] : 99 : output : LVTTL : : 2 : N
q[5] : 100 : output : LVTTL : : 2 : N
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