📄 watch.tan.rpt
字号:
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[4] ; counter[5] ; clk ; clk ; None ; None ; 1.529 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[4] ; counter[4] ; clk ; clk ; None ; None ; 1.529 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[4] ; counter[3] ; clk ; clk ; None ; None ; 1.529 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[4] ; counter[2] ; clk ; clk ; None ; None ; 1.529 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[3] ; counter[5] ; clk ; clk ; None ; None ; 1.510 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[3] ; counter[4] ; clk ; clk ; None ; None ; 1.510 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[3] ; counter[3] ; clk ; clk ; None ; None ; 1.510 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[3] ; counter[2] ; clk ; clk ; None ; None ; 1.510 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[2] ; counter[5] ; clk ; clk ; None ; None ; 1.399 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[2] ; counter[4] ; clk ; clk ; None ; None ; 1.391 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[2] ; counter[3] ; clk ; clk ; None ; None ; 1.391 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[2] ; counter[2] ; clk ; clk ; None ; None ; 1.391 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[0] ; counter[5] ; clk ; clk ; None ; None ; 1.624 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[5] ; counter[5] ; clk ; clk ; None ; None ; 1.272 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[5] ; counter[4] ; clk ; clk ; None ; None ; 1.272 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[5] ; counter[3] ; clk ; clk ; None ; None ; 1.272 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[5] ; counter[2] ; clk ; clk ; None ; None ; 1.272 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[0] ; counter[1] ; clk ; clk ; None ; None ; 1.252 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[0] ; counter[4] ; clk ; clk ; None ; None ; 1.553 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[1] ; counter[5] ; clk ; clk ; None ; None ; 1.536 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[0] ; counter[3] ; clk ; clk ; None ; None ; 1.482 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[1] ; counter[4] ; clk ; clk ; None ; None ; 1.465 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[0] ; counter[2] ; clk ; clk ; None ; None ; 1.411 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[1] ; counter[3] ; clk ; clk ; None ; None ; 1.394 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[1] ; counter[2] ; clk ; clk ; None ; None ; 1.323 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[0] ; counter[0] ; clk ; clk ; None ; None ; 0.866 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[1] ; counter[1] ; clk ; clk ; None ; None ; 0.848 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[3] ; display2[5]$latch ; clk ; clk ; None ; None ; 3.412 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[2] ; display2[5]$latch ; clk ; clk ; None ; None ; 3.394 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[4] ; display2[2]$latch ; clk ; clk ; None ; None ; 3.287 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[2] ; display2[2]$latch ; clk ; clk ; None ; None ; 3.096 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[4] ; display2[3]$latch ; clk ; clk ; None ; None ; 3.091 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[3] ; display2[3]$latch ; clk ; clk ; None ; None ; 3.090 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[5] ; display2[5]$latch ; clk ; clk ; None ; None ; 3.088 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[4] ; display2[0]$latch ; clk ; clk ; None ; None ; 3.194 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[3] ; display2[0]$latch ; clk ; clk ; None ; None ; 3.193 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[3] ; display2[1]$latch ; clk ; clk ; None ; None ; 2.972 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[2] ; display2[1]$latch ; clk ; clk ; None ; None ; 2.954 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[3] ; display2[4]$latch ; clk ; clk ; None ; None ; 2.931 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[4] ; display2[4]$latch ; clk ; clk ; None ; None ; 2.891 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[1] ; display2[5]$latch ; clk ; clk ; None ; None ; 3.204 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[5] ; display2[2]$latch ; clk ; clk ; None ; None ; 2.833 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[2] ; display2[4]$latch ; clk ; clk ; None ; None ; 2.747 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[4] ; display2[5]$latch ; clk ; clk ; None ; None ; 2.653 ns ;
; N/A ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; counter[5] ; display2[3]$latch ; clk ; clk ; None ; None ; 2.629 ns ;
+-------+------------------------------------------------+------------+-------------------+------------+----------+-----------------------------+---------------------------+-------------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Hold: 'clk' ;
+------------------------------------------+------------+-------------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Minimum Slack ; From ; To ; From Clock ; To Clock ; Required Hold Relationship ; Required Shortest P2P Time ; Actual Shortest P2P Time ;
+------------------------------------------+------------+-------------------+------------+----------+----------------------------+----------------------------+--------------------------+
; Not operational: Clock Skew > Data Delay ; counter[0] ; display2[4]$latch ; clk ; clk ; None ; None ; 1.339 ns ;
; Not operational: Clock Skew > Data Delay ; counter[5] ; display2[4]$latch ; clk ; clk ; None ; None ; 1.436 ns ;
; Not operational: Clock Skew > Data Delay ; counter[1] ; display2[4]$latch ; clk ; clk ; None ; None ; 2.107 ns ;
; Not operational: Clock Skew > Data Delay ; counter[0] ; display2[5]$latch ; clk ; clk ; None ; None ; 2.119 ns ;
; Not operational: Clock Skew > Data Delay ; counter[0] ; display2[0]$latch ; clk ; clk ; None ; None ; 2.221 ns ;
; Not operational: Clock Skew > Data Delay ; counter[2] ; display2[4]$latch ; clk ; clk ; None ; None ; 1.905 ns ;
; Not operational: Clock Skew > Data Delay ; counter[0] ; display2[3]$latch ; clk ; clk ; None ; None ; 2.357 ns ;
; Not operational: Clock Skew > Data Delay ; counter[0] ; display2[2]$latch ; clk ; clk ; None ; None ; 2.374 ns ;
; Not operational: Clock Skew > Data Delay ; counter[0] ; display2[1]$latch ; clk ; clk ; None ; None ; 2.429 ns ;
; Not operational: Clock Skew > Data Delay ; counter[3] ; display2[2]$latch ; clk ; clk ; None ; None ; 2.109 ns ;
; Not operational: Clock Skew > Data Delay ; counter[4] ; display2[4]$latch ; clk ; clk ; None ; None ; 2.157 ns ;
; Not operational: Clock Skew > Data Delay ; counter[1] ; display2[1]$latch ; clk ; clk ; None ; None ; 2.560 ns ;
; Not operational: Clock Skew > Data Delay ; counter[1] ; display2[0]$latch ; clk ; clk ; None ; None ; 2.608 ns ;
; Not operational: Clock Skew > Data Delay ; counter[1] ; display2[3]$latch ; clk ; clk ; None ; None ; 2.614 ns ;
; Not operational: Clock Skew > Data Delay ; counter[2] ; display2[0]$latch ; clk ; clk ; None ; None ; 2.360 ns ;
; Not operational: Clock Skew > Data Delay ; counter[2] ; display2[3]$latch ; clk ; clk ; None ; None ; 2.378 ns ;
; Not operational: Clock Skew > Data Delay ; counter[3] ; display2[4]$latch ; clk ; clk ; None ; None ; 2.441 ns ;
; Not operational: Clock Skew > Data Delay ; counter[1] ; display2[2]$latch ; clk ; clk ; None ; None ; 2.763 ns ;
; Not operational: Clock Skew > Data Delay ; counter[5] ; display2[1]$latch ; clk ; clk ; None ; None ; 2.444 ns ;
; Not operational: Clock Skew > Data Delay ; counter[5] ; display2[0]$latch ; clk ; clk ; None ; None ; 2.504 ns ;
; Not operational: Clock Skew > Data Delay ; counter[4] ; display2[1]$latch ; clk ; clk ; None ; None ; 2.474 ns ;
; Not operational: Clock Skew > Data Delay ; counter[5] ; display2[3]$latch ; clk ; clk ; None ; None ; 2.504 ns ;
; Not operational: Clock Skew > Data Delay ; counter[4] ; display2[5]$latch ; clk ; clk ; None ; None ; 2.653 ns ;
; Not operational: Clock Skew > Data Delay ; counter[5] ; display2[2]$latch ; clk ; clk ; None ; None ; 2.658 ns ;
; Not operational: Clock Skew > Data Delay ; counter[3] ; display2[1]$latch ; clk ; clk ; None ; None ; 2.694 ns ;
; Not operational: Clock Skew > Data Delay ; counter[2] ; display2[1]$latch ; clk ; clk ; None ; None ; 2.707 ns ;
; Not operational: Clock Skew > Data Delay ; counter[1] ; display2[5]$latch ; clk ; clk ; None ; None ; 3.050 ns ;
; Not operational: Clock Skew > Data Delay ; counter[3] ; display2[0]$latch ; clk ; clk ; None ; None ; 2.955 ns ;
; Not operational: Clock Skew > Data Delay ; counter[4] ; display2[0]$latch ; clk ; clk ; None ; None ; 2.956 ns ;
; Not operational: Clock Skew > Data Delay ; counter[2] ; display2[2]$latch ; clk ; clk ; None ; None ; 2.921 ns ;
; Not operational: Clock Skew > Data Delay ; counter[5] ; display2[5]$latch ; clk ; clk ; None ; None ; 2.928 ns ;
; Not operational: Clock Skew > Data Delay ; counter[3] ; display2[3]$latch ; clk ; clk ; None ; None ; 2.957 ns ;
; Not operational: Clock Skew > Data Delay ; counter[4] ; display2[3]$latch ; clk ; clk ; None ; None ; 2.959 ns ;
; Not operational: Clock Skew > Data Delay ; counter[4] ; display2[2]$latch ; clk ; clk ; None ; None ; 3.113 ns ;
; Not operational: Clock Skew > Data Delay ; counter[3] ; display2[5]$latch ; clk ; clk ; None ; None ; 3.215 ns ;
; Not operational: Clock Skew > Data Delay ; counter[2] ; display2[5]$latch ; clk ; clk ; None ; None ; 3.224 ns ;
+------------------------------------------+------------+-------------------+------------+----------+----------------------------+----------------------------+--------------------------+
+----------------------------------------------------------------------------------+
; tco ;
+-------+--------------+------------+-------------------+-------------+------------+
; Slack ; Required tco ; Actual tco ; From ; To ; From Clock ;
+-------+--------------+------------+-------------------+-------------+------------+
; N/A ; None ; 11.681 ns ; display2[0]$latch ; display2[6] ; clk ;
; N/A ; None ; 11.681 ns ; display2[0]$latch ; display2[0] ; clk ;
; N/A ; None ; 11.281 ns ; display2[4]$latch ; display2[4] ; clk ;
; N/A ; None ; 10.946 ns ; display2[1]$latch ; display2[1] ; clk ;
; N/A ; None ; 10.846 ns ; display2[3]$latch ; display2[3] ; clk ;
; N/A ; None ; 10.658 ns ; display2[2]$latch ; display2[2] ; clk ;
; N/A ; None ; 10.639 ns ; display2[5]$latch ; display2[5] ; clk ;
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