sram_test.tan.rpt
来自「Verilog语言对SRAM的操作,也提一些简单的快速操作SRAM的技巧。」· RPT 代码 · 共 425 行 · 第 1/5 页
RPT
425 行
; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; clk ; ; User Pin ; None ; 0.000 ns ; 0.000 ns ; -- ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Setup: 'clk' ;
+-----------------------------------------+-----------------------------------------------------+-----------+-------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; Slack ; Actual fmax (period) ; From ; To ; From Clock ; To Clock ; Required Setup Relationship ; Required Longest P2P Time ; Actual Longest P2P Time ;
+-----------------------------------------+-----------------------------------------------------+-----------+-------------+------------+----------+-----------------------------+---------------------------+-------------------------+
; N/A ; 74.32 MHz ( period = 13.455 ns ) ; delay[18] ; addr_r[8] ; clk ; clk ; None ; None ; 12.746 ns ;
; N/A ; 74.32 MHz ( period = 13.455 ns ) ; delay[18] ; addr_r[9] ; clk ; clk ; None ; None ; 12.746 ns ;
; N/A ; 74.32 MHz ( period = 13.455 ns ) ; delay[18] ; addr_r[10] ; clk ; clk ; None ; None ; 12.746 ns ;
; N/A ; 74.32 MHz ( period = 13.455 ns ) ; delay[18] ; addr_r[11] ; clk ; clk ; None ; None ; 12.746 ns ;
; N/A ; 74.32 MHz ( period = 13.455 ns ) ; delay[18] ; addr_r[12] ; clk ; clk ; None ; None ; 12.746 ns ;
; N/A ; 74.32 MHz ( period = 13.455 ns ) ; delay[18] ; addr_r[13] ; clk ; clk ; None ; None ; 12.746 ns ;
; N/A ; 74.32 MHz ( period = 13.455 ns ) ; delay[18] ; addr_r[14] ; clk ; clk ; None ; None ; 12.746 ns ;
; N/A ; 76.99 MHz ( period = 12.989 ns ) ; delay[16] ; addr_r[8] ; clk ; clk ; None ; None ; 12.280 ns ;
; N/A ; 76.99 MHz ( period = 12.989 ns ) ; delay[16] ; addr_r[9] ; clk ; clk ; None ; None ; 12.280 ns ;
; N/A ; 76.99 MHz ( period = 12.989 ns ) ; delay[16] ; addr_r[10] ; clk ; clk ; None ; None ; 12.280 ns ;
; N/A ; 76.99 MHz ( period = 12.989 ns ) ; delay[16] ; addr_r[11] ; clk ; clk ; None ; None ; 12.280 ns ;
; N/A ; 76.99 MHz ( period = 12.989 ns ) ; delay[16] ; addr_r[12] ; clk ; clk ; None ; None ; 12.280 ns ;
; N/A ; 76.99 MHz ( period = 12.989 ns ) ; delay[16] ; addr_r[13] ; clk ; clk ; None ; None ; 12.280 ns ;
; N/A ; 76.99 MHz ( period = 12.989 ns ) ; delay[16] ; addr_r[14] ; clk ; clk ; None ; None ; 12.280 ns ;
; N/A ; 77.21 MHz ( period = 12.951 ns ) ; delay[18] ; sdlink ; clk ; clk ; None ; None ; 12.242 ns ;
; N/A ; 77.22 MHz ( period = 12.950 ns ) ; delay[18] ; cstate.IDLE ; clk ; clk ; None ; None ; 12.241 ns ;
; N/A ; 77.25 MHz ( period = 12.945 ns ) ; delay[18] ; cstate.WRT0 ; clk ; clk ; None ; None ; 12.236 ns ;
; N/A ; 77.80 MHz ( period = 12.854 ns ) ; delay[15] ; addr_r[8] ; clk ; clk ; None ; None ; 12.145 ns ;
; N/A ; 77.80 MHz ( period = 12.854 ns ) ; delay[15] ; addr_r[9] ; clk ; clk ; None ; None ; 12.145 ns ;
; N/A ; 77.80 MHz ( period = 12.854 ns ) ; delay[15] ; addr_r[10] ; clk ; clk ; None ; None ; 12.145 ns ;
; N/A ; 77.80 MHz ( period = 12.854 ns ) ; delay[15] ; addr_r[11] ; clk ; clk ; None ; None ; 12.145 ns ;
; N/A ; 77.80 MHz ( period = 12.854 ns ) ; delay[15] ; addr_r[12] ; clk ; clk ; None ; None ; 12.145 ns ;
; N/A ; 77.80 MHz ( period = 12.854 ns ) ; delay[15] ; addr_r[13] ; clk ; clk ; None ; None ; 12.145 ns ;
; N/A ; 77.80 MHz ( period = 12.854 ns ) ; delay[15] ; addr_r[14] ; clk ; clk ; None ; None ; 12.145 ns ;
; N/A ; 77.83 MHz ( period = 12.849 ns ) ; delay[18] ; wr_data[0] ; clk ; clk ; None ; None ; 12.140 ns ;
; N/A ; 78.05 MHz ( period = 12.813 ns ) ; delay[17] ; addr_r[8] ; clk ; clk ; None ; None ; 12.104 ns ;
; N/A ; 78.05 MHz ( period = 12.813 ns ) ; delay[17] ; addr_r[9] ; clk ; clk ; None ; None ; 12.104 ns ;
; N/A ; 78.05 MHz ( period = 12.813 ns ) ; delay[17] ; addr_r[10] ; clk ; clk ; None ; None ; 12.104 ns ;
; N/A ; 78.05 MHz ( period = 12.813 ns ) ; delay[17] ; addr_r[11] ; clk ; clk ; None ; None ; 12.104 ns ;
; N/A ; 78.05 MHz ( period = 12.813 ns ) ; delay[17] ; addr_r[12] ; clk ; clk ; None ; None ; 12.104 ns ;
; N/A ; 78.05 MHz ( period = 12.813 ns ) ; delay[17] ; addr_r[13] ; clk ; clk ; None ; None ; 12.104 ns ;
; N/A ; 78.05 MHz ( period = 12.813 ns ) ; delay[17] ; addr_r[14] ; clk ; clk ; None ; None ; 12.104 ns ;
; N/A ; 78.59 MHz ( period = 12.724 ns ) ; delay[23] ; addr_r[8] ; clk ; clk ; None ; None ; 12.015 ns ;
; N/A ; 78.59 MHz ( period = 12.724 ns ) ; delay[23] ; addr_r[9] ; clk ; clk ; None ; None ; 12.015 ns ;
; N/A ; 78.59 MHz ( period = 12.724 ns ) ; delay[23] ; addr_r[10] ; clk ; clk ; None ; None ; 12.015 ns ;
; N/A ; 78.59 MHz ( period = 12.724 ns ) ; delay[23] ; addr_r[11] ; clk ; clk ; None ; None ; 12.015 ns ;
; N/A ; 78.59 MHz ( period = 12.724 ns ) ; delay[23] ; addr_r[12] ; clk ; clk ; None ; None ; 12.015 ns ;
; N/A ; 78.59 MHz ( period = 12.724 ns ) ; delay[23] ; addr_r[13] ; clk ; clk ; None ; None ; 12.015 ns ;
; N/A ; 78.59 MHz ( period = 12.724 ns ) ; delay[23] ; addr_r[14] ; clk ; clk ; None ; None ; 12.015 ns ;
; N/A ; 79.50 MHz ( period = 12.578 ns ) ; delay[24] ; addr_r[8] ; clk ; clk ; None ; None ; 11.869 ns ;
; N/A ; 79.50 MHz ( period = 12.578 ns ) ; delay[24] ; addr_r[9] ; clk ; clk ; None ; None ; 11.869 ns ;
; N/A ; 79.50 MHz ( period = 12.578 ns ) ; delay[24] ; addr_r[10] ; clk ; clk ; None ; None ; 11.869 ns ;
; N/A ; 79.50 MHz ( period = 12.578 ns ) ; delay[24] ; addr_r[11] ; clk ; clk ; None ; None ; 11.869 ns ;
; N/A ; 79.50 MHz ( period = 12.578 ns ) ; delay[24] ; addr_r[12] ; clk ; clk ; None ; None ; 11.869 ns ;
; N/A ; 79.50 MHz ( period = 12.578 ns ) ; delay[24] ; addr_r[13] ; clk ; clk ; None ; None ; 11.869 ns ;
; N/A ; 79.50 MHz ( period = 12.578 ns ) ; delay[24] ; addr_r[14] ; clk ; clk ; None ; None ; 11.869 ns ;
; N/A ; 79.88 MHz ( period = 12.519 ns ) ; delay[25] ; addr_r[8] ; clk ; clk ; None ; None ; 11.810 ns ;
; N/A ; 79.88 MHz ( period = 12.519 ns ) ; delay[25] ; addr_r[9] ; clk ; clk ; None ; None ; 11.810 ns ;
; N/A ; 79.88 MHz ( period = 12.519 ns ) ; delay[25] ; addr_r[10] ; clk ; clk ; None ; None ; 11.810 ns ;
; N/A ; 79.88 MHz ( period = 12.519 ns ) ; delay[25] ; addr_r[11] ; clk ; clk ; None ; None ; 11.810 ns ;
; N/A ; 79.88 MHz ( period = 12.519 ns ) ; delay[25] ; addr_r[12] ; clk ; clk ; None ; None ; 11.810 ns ;
; N/A ; 79.88 MHz ( period = 12.519 ns ) ; delay[25] ; addr_r[13] ; clk ; clk ; None ; None ; 11.810 ns ;
; N/A ; 79.88 MHz ( period = 12.519 ns ) ; delay[25] ; addr_r[14] ; clk ; clk ; None ; None ; 11.810 ns ;
; N/A ; 80.10 MHz ( period = 12.485 ns ) ; delay[16] ; sdlink ; clk ; clk ; None ; None ; 11.776 ns ;
; N/A ; 80.10 MHz ( period = 12.484 ns ) ; delay[16] ; cstate.IDLE ; clk ; clk ; None ; None ; 11.775 ns ;
; N/A ; 80.13 MHz ( period = 12.479 ns ) ; delay[16] ; cstate.WRT0 ; clk ; clk ; None ; None ; 11.770 ns ;
; N/A ; 80.76 MHz ( period = 12.383 ns ) ; delay[16] ; wr_data[0] ; clk ; clk ; None ; None ; 11.674 ns ;
; N/A ; 80.97 MHz ( period = 12.350 ns ) ; delay[15] ; sdlink ; clk ; clk ; None ; None ; 11.641 ns ;
; N/A ; 80.98 MHz ( period = 12.349 ns ) ; delay[15] ; cstate.IDLE ; clk ; clk ; None ; None ; 11.640 ns ;
; N/A ; 81.01 MHz ( period = 12.344 ns ) ; delay[15] ; cstate.WRT0 ; clk ; clk ; None ; None ; 11.635 ns ;
; N/A ; 81.24 MHz ( period = 12.309 ns ) ; delay[17] ; sdlink ; clk ; clk ; None ; None ; 11.600 ns ;
; N/A ; 81.25 MHz ( period = 12.308 ns ) ; delay[17] ; cstate.IDLE ; clk ; clk ; None ; None ; 11.599 ns ;
; N/A ; 81.28 MHz ( period = 12.303 ns ) ; delay[17] ; cstate.WRT0 ; clk ; clk ; None ; None ; 11.594 ns ;
; N/A ; 81.65 MHz ( period = 12.248 ns ) ; delay[15] ; wr_data[0] ; clk ; clk ; None ; None ; 11.539 ns ;
; N/A ; 81.83 MHz ( period = 12.220 ns ) ; delay[23] ; sdlink ; clk ; clk ; None ; None ; 11.511 ns ;
; N/A ; 81.84 MHz ( period = 12.219 ns ) ; delay[23] ; cstate.IDLE ; clk ; clk ; None ; None ; 11.510 ns ;
; N/A ; 81.87 MHz ( period = 12.214 ns ) ; delay[23] ; cstate.WRT0 ; clk ; clk ; None ; None ; 11.505 ns ;
; N/A ; 81.92 MHz ( period = 12.207 ns ) ; delay[17] ; wr_data[0] ; clk ; clk ; None ; None ; 11.498 ns ;
; N/A ; 81.97 MHz ( period = 12.199 ns ) ; delay[18] ; wr_data[1] ; clk ; clk ; None ; None ; 11.490 ns ;
; N/A ; 81.97 MHz ( period = 12.199 ns ) ; delay[18] ; wr_data[2] ; clk ; clk ; None ; None ; 11.490 ns ;
; N/A ; 81.97 MHz ( period = 12.199 ns ) ; delay[18] ; wr_data[3] ; clk ; clk ; None ; None ; 11.490 ns ;
; N/A ; 81.97 MHz ( period = 12.199 ns ) ; delay[18] ; wr_data[4] ; clk ; clk ; None ; None ; 11.490 ns ;
; N/A ; 81.97 MHz ( period = 12.199 ns ) ; delay[18] ; wr_data[5] ; clk ; clk ; None ; None ; 11.490 ns ;
; N/A ; 81.97 MHz ( period = 12.199 ns ) ; delay[18] ; wr_data[6] ; clk ; clk ; None ; None ; 11.490 ns ;
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