serial.tan.rpt
来自「基于FPGA的串口通信」· RPT 代码 · 共 223 行 · 第 1/5 页
RPT
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; N/A ; 149.77 MHz ( period = 6.677 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[7] ; clk32 ; clk32 ; None ; None ; 6.416 ns ;
; N/A ; 149.77 MHz ( period = 6.677 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[6] ; clk32 ; clk32 ; None ; None ; 6.416 ns ;
; N/A ; 149.77 MHz ( period = 6.677 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[8] ; clk32 ; clk32 ; None ; None ; 6.416 ns ;
; N/A ; 149.77 MHz ( period = 6.677 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[10] ; clk32 ; clk32 ; None ; None ; 6.416 ns ;
; N/A ; 149.77 MHz ( period = 6.677 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[11] ; clk32 ; clk32 ; None ; None ; 6.416 ns ;
; N/A ; 150.24 MHz ( period = 6.656 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[0] ; clk32 ; clk32 ; None ; None ; 6.395 ns ;
; N/A ; 150.24 MHz ( period = 6.656 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[3] ; clk32 ; clk32 ; None ; None ; 6.395 ns ;
; N/A ; 150.24 MHz ( period = 6.656 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[2] ; clk32 ; clk32 ; None ; None ; 6.395 ns ;
; N/A ; 150.24 MHz ( period = 6.656 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[1] ; clk32 ; clk32 ; None ; None ; 6.395 ns ;
; N/A ; 150.24 MHz ( period = 6.656 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[5] ; clk32 ; clk32 ; None ; None ; 6.395 ns ;
; N/A ; 150.24 MHz ( period = 6.656 ns ) ; fenpin:fp|reg1[2] ; fenpin:fp|reg1[4] ; clk32 ; clk32 ; None ; None ; 6.395 ns ;
; N/A ; 153.96 MHz ( period = 6.495 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[9] ; clk32 ; clk32 ; None ; None ; 6.234 ns ;
; N/A ; 153.96 MHz ( period = 6.495 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[7] ; clk32 ; clk32 ; None ; None ; 6.234 ns ;
; N/A ; 153.96 MHz ( period = 6.495 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[6] ; clk32 ; clk32 ; None ; None ; 6.234 ns ;
; N/A ; 153.96 MHz ( period = 6.495 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[8] ; clk32 ; clk32 ; None ; None ; 6.234 ns ;
; N/A ; 153.96 MHz ( period = 6.495 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[10] ; clk32 ; clk32 ; None ; None ; 6.234 ns ;
; N/A ; 153.96 MHz ( period = 6.495 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[11] ; clk32 ; clk32 ; None ; None ; 6.234 ns ;
; N/A ; 154.46 MHz ( period = 6.474 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[0] ; clk32 ; clk32 ; None ; None ; 6.213 ns ;
; N/A ; 154.46 MHz ( period = 6.474 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[3] ; clk32 ; clk32 ; None ; None ; 6.213 ns ;
; N/A ; 154.46 MHz ( period = 6.474 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[2] ; clk32 ; clk32 ; None ; None ; 6.213 ns ;
; N/A ; 154.46 MHz ( period = 6.474 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[1] ; clk32 ; clk32 ; None ; None ; 6.213 ns ;
; N/A ; 154.46 MHz ( period = 6.474 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[5] ; clk32 ; clk32 ; None ; None ; 6.213 ns ;
; N/A ; 154.46 MHz ( period = 6.474 ns ) ; fenpin:fp|reg1[4] ; fenpin:fp|reg1[4] ; clk32 ; clk32 ; None ; None ; 6.213 ns ;
; N/A ; 156.67 MHz ( period = 6.383 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[9] ; clk32 ; clk32 ; None ; None ; 6.122 ns ;
; N/A ; 156.67 MHz ( period = 6.383 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[7] ; clk32 ; clk32 ; None ; None ; 6.122 ns ;
; N/A ; 156.67 MHz ( period = 6.383 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[6] ; clk32 ; clk32 ; None ; None ; 6.122 ns ;
; N/A ; 156.67 MHz ( period = 6.383 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[8] ; clk32 ; clk32 ; None ; None ; 6.122 ns ;
; N/A ; 156.67 MHz ( period = 6.383 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[10] ; clk32 ; clk32 ; None ; None ; 6.122 ns ;
; N/A ; 156.67 MHz ( period = 6.383 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[11] ; clk32 ; clk32 ; None ; None ; 6.122 ns ;
; N/A ; 157.18 MHz ( period = 6.362 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[0] ; clk32 ; clk32 ; None ; None ; 6.101 ns ;
; N/A ; 157.18 MHz ( period = 6.362 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[3] ; clk32 ; clk32 ; None ; None ; 6.101 ns ;
; N/A ; 157.18 MHz ( period = 6.362 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[2] ; clk32 ; clk32 ; None ; None ; 6.101 ns ;
; N/A ; 157.18 MHz ( period = 6.362 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[1] ; clk32 ; clk32 ; None ; None ; 6.101 ns ;
; N/A ; 157.18 MHz ( period = 6.362 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[5] ; clk32 ; clk32 ; None ; None ; 6.101 ns ;
; N/A ; 157.18 MHz ( period = 6.362 ns ) ; fenpin:fp|reg1[1] ; fenpin:fp|reg1[4] ; clk32 ; clk32 ; None ; None ; 6.101 ns ;
; N/A ; 164.69 MHz ( period = 6.072 ns ) ; fenpin:fp|reg1[10] ; fenpin:fp|reg1[9] ; clk32 ; clk32 ; None ; None ; 5.811 ns ;
; N/A ; 164.69 MHz ( period = 6.072 ns ) ; fenpin:fp|reg1[10] ; fenpin:fp|reg1[7] ; clk32 ; clk32 ; None ; None ; 5.811 ns ;
; N/A ; 164.69 MHz ( period = 6.072 ns ) ; fenpin:fp|reg1[10] ; fenpin:fp|reg1[6] ; clk32 ; clk32 ; None ; None ; 5.811 ns ;
; N/A ; 164.69 MHz ( period = 6.072 ns ) ; fenpin:fp|reg1[10] ; fenpin:fp|reg1[8] ; clk32 ; clk32 ; None ; None ; 5.811 ns ;
; N/A ; 164.69 MHz ( period = 6.072 ns ) ; fenpin:fp|reg1[10] ; fenpin:fp|reg1[10] ; clk32 ; clk32 ; None ; None ; 5.811 ns ;
; N/A ; 164.69 MHz ( period = 6.072 ns ) ; fenpin:fp|reg1[10] ; fenpin:fp|reg1[11] ; clk32 ; clk32 ; None ; None ; 5.811 ns ;
; N/A ; 165.26 MHz ( period = 6.051 ns ) ; fenpin:fp|reg1[5] ; fenpin:fp|reg1[9] ; clk32 ; clk32 ; None ; None ; 5.790 ns ;
; N/A ; 165.26 MHz ( period = 6.051 ns ) ; fenpin:fp|reg1[10] ; fenpin:fp|reg1[0] ; clk32 ; clk32 ; None ; None ; 5.790 ns ;
; N/A ; 165.26 MHz ( period = 6.051 ns ) ; fenpin:fp|reg1[10] ; fenpin:fp|reg1[3] ; clk32 ; clk32 ; None ; None ; 5.790 ns ;
; N/A ; 165.26 MHz ( period = 6.051 ns ) ; fenpin:fp|reg1[10] ; fenpin:fp|reg1[2] ; clk32 ; clk32 ; None ; None ; 5.790 ns ;
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